LMK5C33216AS1

アクティブ

BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネッ

製品詳細

Operating temperature range (°C) -40 to 105
Operating temperature range (°C) -40 to 105
VQFN (RGC) 64 81 mm² (9 mm × 9 mm)
  • 超低ジッタ BAW VCO ベースのワイヤレス クロック
    • 491.52MHz での RMS ジッタ 40fs (標準値) / 57fs (最大値)
    • 245.76MHz での RMS ジッタ 50fs (標準値) / 62fs (最大値)
  • アナログ位相ロック ループ (APLL) と対になった 3 つの高性能デジタル位相ロック ループ (DPLL)
    • 1mHz~4kHz にプログラム可能な DPLL ループ帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 2 つの差動またはシングルエンド DPLL 入力
    • 入力周波数:1Hz (1PPS) ~ 800MHz
    • デジタル ホールドオーバーおよびヒットレス スイッチング
  • プログラム可能な HSDS、AC-LVPECL、LVDS、HSCL 形式による、16 の差動出力
    • 最大 20 つの合計周波数出力 (OUT[1:0]_P/N、GPIO1 および GPIO2 の 6 つの LVCMOS 周波数出力と、OUT[15:0]_P/N の 14 つの差動出力で構成した場合)
    • プログラム可能なスイングおよび同相モードによる 1Hz (1PPS)~1250MHz の出力周波数
    • PCIe Gen 1~6 準拠
  • I2C、3 線式 SPI、または 4 線式 SPI
  • -40℃~85℃の動作温度範囲
  • 超低ジッタ BAW VCO ベースのワイヤレス クロック
    • 491.52MHz での RMS ジッタ 40fs (標準値) / 57fs (最大値)
    • 245.76MHz での RMS ジッタ 50fs (標準値) / 62fs (最大値)
  • アナログ位相ロック ループ (APLL) と対になった 3 つの高性能デジタル位相ロック ループ (DPLL)
    • 1mHz~4kHz にプログラム可能な DPLL ループ帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 2 つの差動またはシングルエンド DPLL 入力
    • 入力周波数:1Hz (1PPS) ~ 800MHz
    • デジタル ホールドオーバーおよびヒットレス スイッチング
  • プログラム可能な HSDS、AC-LVPECL、LVDS、HSCL 形式による、16 の差動出力
    • 最大 20 つの合計周波数出力 (OUT[1:0]_P/N、GPIO1 および GPIO2 の 6 つの LVCMOS 周波数出力と、OUT[15:0]_P/N の 14 つの差動出力で構成した場合)
    • プログラム可能なスイングおよび同相モードによる 1Hz (1PPS)~1250MHz の出力周波数
    • PCIe Gen 1~6 準拠
  • I2C、3 線式 SPI、または 4 線式 SPI
  • -40℃~85℃の動作温度範囲

LMK5C33216AS1 は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

このデバイスは、IEEE-1588 PTP をプライマリ基準クロック ソースと同期するためのソフトウェア サポートがバンドルされたデバイスです。詳細については、テキサス・インスツルメンツにお問い合わせください。

デバイスは、ヒットレス スイッチングとジッタ減衰を実現するために、プログラマブルなループ帯域幅 (LBW)、外部ループ フィルタキャパシタを特長とする 3 つの DPLL と 3 つのAPLLを内蔵しており、最大限の柔軟性と使いやすさを備えています。

APLL3は、TI 独自のバルク弾性波 (BAW) 技術を採用した超高性能PLLを特長としています。BAW APLLは、DPLLの基準入力周波数とジッタ特性に関係なく、RMSジッタ (20MHz):40fs (標準値) / 60fs (最大値) の 491.52MHz 出力クロックを生成できます。APLL2 および APLL1 (従来の LC VOC)には、2 番目または 3 番目の周波数ドメイン、同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準入力を監視し、入力が検出または失われると、被っとレススイッチを自動的に実行します。ゼロ遅延モード (ZDM) により、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI を介して完全にプログラム可能です。内蔵 EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。

LMK5C33216AS1 は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

このデバイスは、IEEE-1588 PTP をプライマリ基準クロック ソースと同期するためのソフトウェア サポートがバンドルされたデバイスです。詳細については、テキサス・インスツルメンツにお問い合わせください。

デバイスは、ヒットレス スイッチングとジッタ減衰を実現するために、プログラマブルなループ帯域幅 (LBW)、外部ループ フィルタキャパシタを特長とする 3 つの DPLL と 3 つのAPLLを内蔵しており、最大限の柔軟性と使いやすさを備えています。

APLL3は、TI 独自のバルク弾性波 (BAW) 技術を採用した超高性能PLLを特長としています。BAW APLLは、DPLLの基準入力周波数とジッタ特性に関係なく、RMSジッタ (20MHz):40fs (標準値) / 60fs (最大値) の 491.52MHz 出力クロックを生成できます。APLL2 および APLL1 (従来の LC VOC)には、2 番目または 3 番目の周波数ドメイン、同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準入力を監視し、入力が検出または失われると、被っとレススイッチを自動的に実行します。ゼロ遅延モード (ZDM) により、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI を介して完全にプログラム可能です。内蔵 EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。

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* データシート LMK5C33216AS1 3DPLL、3-APLL、 2 入力、16 出力 ネットワーク シンクロナイザ IEEE-1588 PTP スタックソフトウェア内蔵 データシート (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2025/03/03

設計と開発

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設計ツール

CLOCK-PERFDATA-DESIGN — Clock performance data and register settings for clock generators, network synchronizers, jitter cleaners, and other clocking devices.

Configuration, raw phase noise data, noise plots, and register data for common use cases on clock generators, network synchronizers, jitter cleaners, and other clocking devices
サポート対象の製品とハードウェア
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFN (RGC) 64 Ultra Librarian

購入と品質

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サポートとトレーニング

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