LP2998
- AEC-Q100 Test Guidance with the following results
(SO PowerPAD-8):- Device HBM ESD Classification Level H1C
- Junction Temperature Range –40°C to 125°C
- 1.35 V Minimum VDDQ
- Source and Sink Current
- Low Output Voltage Offset
- No External Resistors Required
- Linear Topology
- Suspend to Ram (STR) Functionality
- Low External Component Count
- Thermal Shutdown
The LP2998 linear regulator is designed to meet JEDEC SSTL-2 and JEDEC SSTL-18 specifications for termination of DDR-SDRAM and DDR2 memory. The device also supports DDR3 and DDR3L VTT bus termination with VDDQ min of 1.35 V. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5 A continuous current and transient peaks up to 3 A in the application as required for DDR-SDRAM termination. The LP2998 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DIMMs.
An additional feature found on the LP2998 is an active low shutdown (SD) pin that provides Suspend To RAM (STR) functionality. When SD is pulled low the VTT output will tri-state providing a high impedance output, but, VREF will remain active. A power savings advantage can be obtained in this mode through lower quiescent current.
技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | LP2998/LP2998-Q1 DDR Termination Regulator データシート (Rev. K) | PDF | HTML | 2014/08/20 | ||
| アプリケーション・ノート | DDR VTT Power Solutions: A Competitive Analysis (Rev. A) | 2020/07/09 | ||||
| アプリケーション・ノート | Limiting DDR Termination Regulators’ Inrush Current | 2016/08/23 | ||||
| アプリケーション・ノート | AN-1254 DDR-SDRAM Termination Simplified Using a Linear Regulator (Rev. A) | 2013/05/06 | ||||
| アプリケーション・ノート | Pwr Ref Design f/'C6472 12-Vin Digital Pwr Controllers and LDOs | 2010/04/28 | ||||
| アプリケーション・ノート | Power Two Xilinx(TM) LX240 Virtex-6(TM) Devices | 2010/04/20 | ||||
| アプリケーション・ノート | Power Ref Design for TMS320C6472 5Vin DC/DC Converters (1x C6472) | 2010/03/31 | ||||
| アプリケーション・ノート | 'C6472 12Vin Flexible Pwr Design Using DCDC Controllers and LDOs (8x C6472) | 2010/03/26 | ||||
| アプリケーション・ノート | TMS320C6472 5V Input Pwr Design, Integrated FET DC/DC Converters and Controllers | 2010/03/26 | ||||
| アプリケーション・ノート | Power Reference Design for the 'C6472, 12V DCDC Controllers, and LDOs | 2010/03/26 |
設計と開発
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LP2998EVAL — LP2998 評価ボード
The LP2998 evaluation board is designed to provide the design Engineer with a fully functional prototype system in which to evaluate the LP2998 in both a static environment and with a complete memory system.
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PMP10600.1 リファレンス デザインでは、Xilinx® 製 Zynq® 7000 シリーズ（XC7Z015）の FPGA に電力を供給するために必要とされるすべての電源レールを実装できます。 このデザインでは、複数の LMZ3 シリーズ モジュール、複数の LDO、1 つの DDR 終端レギュレータを採用しています。 また、パワーアップ/ダウン シーケンシングを実行する 1 個の LM3880 を採用しています。 このリファレンス デザインでは、12V 入力を使用します。
PMP10601 — Xilinx® Zynq® 7000 シリーズ（XC7Z015）電源ソリューション、8W - リファレンス デザイン
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PMP10630 — Xilinx Kintex UltraScale XCKU040 FPGA 向けの 6W 電源ソリューションのリファレンス デザイン
PMP10630 は、Xilinx® Kintex® UltraScale™ XCKU040 FPGA 向けの包括的な高密度パワー ソリューションを実現するリファレンス デザインです。このリファレンス デザインは、SIMPLE SWITCHER® モジュールと複数の LDO を組み合わせており、36 x 43mm（1.4 x 1.7 インチ）の小型ソリューション サイズで、必要な電圧レールすべてを提供します。このリファレンス デザインは、LMZ31704 LMZ3 シリーズのモジュールを搭載し、コア レールと 3 個の LMZ21700/1 ナノ シリーズ (...)
PMP9766 — 超コンデンサ用バックアップ電源、アクティブ セル バランシング付、リファレンス デザイン
このリファレンス デザインは、昇降圧コンバータと縦に 2 つ積み重ねたスーパーキャパシタを使用して、瞬間的に電源切断に対処するバックアップ電源回路を示します。統合された TPS63020 昇降圧コンバータ回路をベースとする実装により、全体のソリューション サイズを小型化できます。また、この設計では、アクティブ セル バランシング回路も提供します。この構成はテスト済みであり、包括的なテスト レポートと動作説明が付属します。
TIDA-010011 — 保護リレー プロセッサ モジュール向け高効率電源アーキテクチャのリファレンス デザイン
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| HSOIC (DDA) | 8 | Ultra Librarian |
| SOIC (D) | 8 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。