ホーム ロジックと電圧変換 フリップ フロップ、ラッチ、レジスタ D タイプ フリップ フロップ

SN74AHC273

アクティブ

クリア搭載、オクタル D タイプ フリップ フロップ

製品詳細

Number of channels 8 Technology family AHC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 110 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 40 Features Balanced outputs, High speed (tpd 10-50ns), Over-voltage tolerant inputs Operating temperature range (°C) -40 to 125 Rating Catalog
Number of channels 8 Technology family AHC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 110 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 40 Features Balanced outputs, High speed (tpd 10-50ns), Over-voltage tolerant inputs Operating temperature range (°C) -40 to 125 Rating Catalog
TSSOP (PW) 20 41.6 mm² (6.5 mm × 6.4 mm) SOIC (DW) 20 131.84 mm² (12.8 mm × 10.3 mm) VSSOP (DGS) 20 24.99 mm² (5.1 mm × 4.9 mm) VQFN (RKS) 20 11.25 mm² (4.5 mm × 2.5 mm) TVSOP (DGV) 20 32 mm² (5 mm × 6.4 mm) SOP (NS) 20 98.28 mm² (12.6 mm × 7.8 mm) PDIP (N) 20 228.702 mm² (24.33 mm × 9.4 mm) SSOP (DB) 20 56.16 mm² (7.2 mm × 7.8 mm)
  • 2V~5.5V の VCC で動作
  • シングル レール出力を備えた 8 つのフリップ フロップ
  • 直接クリア入力
  • 各フリップ フロップへの個別データ入力
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 2000V、人体モデル (A114-A)
    • 1000V、デバイス帯電モデル (C101)
  • MIL-PRF-38535 準拠の製品については、特に記述のない限り、すべてのパラメータはテスト済みです。その他のすべての製品については、量産プロセスにすべてのパラメータのテストが含まれているとは限りません。
  • 2V~5.5V の VCC で動作
  • シングル レール出力を備えた 8 つのフリップ フロップ
  • 直接クリア入力
  • 各フリップ フロップへの個別データ入力
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 2000V、人体モデル (A114-A)
    • 1000V、デバイス帯電モデル (C101)
  • MIL-PRF-38535 準拠の製品については、特に記述のない限り、すべてのパラメータはテスト済みです。その他のすべての製品については、量産プロセスにすべてのパラメータのテストが含まれているとは限りません。

これらのデバイスはポジティブ エッジ トリガ D タイプ フリップ フロップで、ダイレクト クリア (CLR) 入力を備えています。

データ (D) 入力のデータがセットアップ時間の要件と合致していれば、クロック パルス (CLK) の立ち上がりエッジでデータが Q 出力へ転送されます。クロックのトリガは、特定の電圧レベルで発生し、正方向パルスの遷移時間とは直接関係しません。CLK が HIGH レベルまたは LOW レベルのとき、 D 入力は出力に影響を与えません。

これらのデバイスはポジティブ エッジ トリガ D タイプ フリップ フロップで、ダイレクト クリア (CLR) 入力を備えています。

データ (D) 入力のデータがセットアップ時間の要件と合致していれば、クロック パルス (CLK) の立ち上がりエッジでデータが Q 出力へ転送されます。クロックのトリガは、特定の電圧レベルで発生し、正方向パルスの遷移時間とは直接関係しません。CLK が HIGH レベルまたは LOW レベルのとき、 D 入力は出力に影響を与えません。

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* データシート SNx4AHC273 クリア搭載、オクタル D タイプ フリップ フロップ データシート (Rev. J 翻訳版) PDF | HTML 英語版 (Rev.J) PDF | HTML 2024/08/20
アプリケーション・ノート Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022/12/15

設計と開発

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評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
サポート対象の製品とハードウェア
在庫あり
制限:
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入手不可
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
TSSOP (PW) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
VSSOP (DGS) 20 Ultra Librarian
VQFN (RKS) 20 Ultra Librarian
TVSOP (DGV) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian
PDIP (N) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian

購入と品質

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