SN74LV21A
- 2V～5.5V の V CC で動作
- 最大 t pd：6ns (5V 時)
- 標準 V OLP (出力グランド・バウンス) < 0.8V (V CC = 3.3V、T A = 25℃)
- 標準 V OHV (出力 V OH アンダーシュート) > 2.3V (V CC = 3.3V、TA = 25℃)
- I off により部分的パワーダウン・モード動作をサポート
- JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
これらのデュアル 4 入力正論理 AND ゲートは、2V～5.5V V CC 動作用に設計されています。
SN74LV21A デバイスはブール関数 Y = A • B • C • D を正論理で実行します。
これらのデバイスは、I off を使用する部分的パワーダウン・アプリケーション用の動作が完全に規定されています。I off 回路が出力をディセーブルにするので、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。
技術資料
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| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | SN74LV21A デュアル 4 入力正論理 AND ゲート データシート (Rev. F 翻訳版) | PDF | HTML | 英語版 (Rev.F) | PDF | HTML | 2023/08/01 |
設計と開発
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評価ボード
14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板
14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。
在庫あり
制限：
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入手不可
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| TSSOP (PW) | 14 | Ultra Librarian |
| SOP (NS) | 14 | Ultra Librarian |
| SOIC (D) | 14 | Ultra Librarian |
| TVSOP (DGV) | 14 | Ultra Librarian |
| SSOP (DB) | 14 | Ultra Librarian |