JAJSVI2 データシート

JAJSVI2 October 2024 LP5899-Q1

PRODUCTION DATA

7.3.3 FIFO

LP5899-Q1 は、送信 FIFO と受信 FIFO の両方を搭載しています。FIFO の名前は、連続クロックシリアルインターフェイス (CCSI) の視点から見た場合のものです。つまり、送信 FIFO (TXFIFO) とは、SPI ペリフェラルによって受信され、CCSI コントローラによって送信されるデータです。受信 FIFO (RXFIFO) は、CCSI ペリフェラルによって受信されたデータであり、SPI ペリフェラル経由でコントローラによって読み取り可能です。

どちらの FIFO も、16 ビット幅の先入れ先出しメモリバッファです。FIFO は、データが SPI クロックドメインと CCSI クロックドメインの間でクロスする間のタイミング要件を満たすために、データワードの格納に使用されます。TXFIFO は、SPI クロックドメインから CCSI クロックドメインへのクロスオーバー中にデータを保持します。RXFIFO は、CCSI クロックドメインから SPI クロックドメインへのクロスオーバー中に、データを保持します。

SPI クロックドメインが CCSI クロックドメインよりも高い周波数で動作する場合、TXFIFO は、CCSI コントローラによってまだ送信されていない、SPI ペリフェラルによってすでに受信されたデータを格納します。カウンタ (TXFFST) は、TXFIFO に現在格納されているワード数を追跡します。SPI ペリフェラルが CCSI コントローラよりも高いクロック周波数で動作する例を、図 7-5 に示します。この図では、すべてのデータワードは 16 ビットです。つまり、ブロックの幅が大きいほどクロック周波数は低くなることを意味しています。

LP5899-Q1 CCSI コントローラより高い周波数で動作する SPI ペリフェラルの例

図 7-5 CCSI コントローラより高い周波数で動作する SPI ペリフェラルの例

SPI ペリフェラルが CCSI コントローラよりも低いクロック周波数で動作する場合、CCSI コントローラによる送信が開始される前に、TXFIFO は最初に SPI ペリフェラルによって受信された多数のデータワードを格納するために使用されます。この方法に従うことで、データワードが SPI ペリフェラルによってまだ受信されていないため、CCSI のデータストリームは連続クロックを停止させることなく、連続させることができます。図 7-6 に、この状況の例を示します。

LP5899-Q1 CCSI コントローラより低い周波数で動作する SPI ペリフェラルの例

図 7-6 CCSI コントローラより低い周波数で動作する SPI ペリフェラルの例

RXFIFO の場合、CCSI ペリフェラルはデータを受信して、RXFIFO に格納します。SPI ペリフェラルは RXFIFO からデータを読み取り、SPI コントローラに送信します。また、RXFIFO には、現在格納されているデータワードの数を追跡するためのカウンタ (RXFFST) が存在します。

END バイトが受信されると、格納は停止します。END バイト自体は RXFIFO に格納されません。また、START ビットと CHECK ビットは格納されません。