JAJSXJ8 November   2025 ADC32RF72

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性 - 消費電力
    6. 5.6 電気的特性 - DC 仕様
    7. 5.7 電気的特性 - AC 仕様
    8. 5.8 タイミング要件
    9. 5.9 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 アナログ入力
        1. 7.3.1.1 入力帯域幅
        2. 7.3.1.2 バックグラウンドキャリブレーション
      2. 7.3.2 ADC チャネルの選択とパワー ダウン モード
      3. 7.3.3 サンプリング クロック入力
      4. 7.3.4 SYSREF
        1. 7.3.4.1 SYSREF モニタ
      5. 7.3.5 デジタルシグナルプロセッサ (DSP) 機能
        1. 7.3.5.1 DSP 入力マルチプレクサ
        2. 7.3.5.2 非整数遅延
        3. 7.3.5.3 イコライゼーション用のプログラム可能な FIR フィルタ
        4. 7.3.5.4 DSP 出力マルチプレクサ
        5. 7.3.5.5 デジタルダウンコンバータ (DDC)
          1. 7.3.5.5.1 デシメーションフィルタ入力
          2. 7.3.5.5.2 デシメーションモード
          3. 7.3.5.5.3 デシメーション フィルタ応答
          4. 7.3.5.5.4 数値制御発振器 (NCO)
            1. 7.3.5.5.4.1 NCO の更新
            2. 7.3.5.5.4.2 NCO リセット
      6. 7.3.6 デジタル出力インターフェイス
        1. 7.3.6.1 JESD204B/C インターフェイス
          1. 7.3.6.1.1 JESD204B 初期レーン アライメント (ILA)
          2. 7.3.6.1.2 SYNC 信号
          3. 7.3.6.1.3 JESD204B/C フレーム アセンブリ
          4. 7.3.6.1.4 バイパスモードの JESD204B/C フレームアセンブリ
          5. 7.3.6.1.5 実際のデシメーションを使用する JESD204B/C フレーム アセンブリ
          6. 7.3.6.1.6 複雑なデシメーションを使用する JESD204B、C フレーム アセンブリ
        2. 7.3.6.2 JESD 出力リファレンスクロック
    4. 7.4 デバイスの機能モード
      1. 7.4.1 デバイス動作モードの比較
    5. 7.5 プログラミング
      1. 7.5.1 GPIO 制御
      2. 7.5.2 SPI レジスタへの書き込み
      3. 7.5.3 SPI レジスタの読み取り
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション：スペクトル アナライザ
      1. 8.2.1 設計要件
        1. 8.2.1.1 入力信号パス：広帯域レシーバ
        2. 8.2.1.2 クロック処理
      2. 8.2.2 詳細な設計手順
        1. 8.2.2.1 サンプリングクロックの要件
      3. 8.2.3 アプリケーション特性の波形
    3. 8.3 代表的なアプリケーション：時間ドメインデジタイザ
      1. 8.3.1 設計要件
        1. 8.3.1.1 入力信号パス：時間ドメインデジタイザ
      2. 8.3.2 アプリケーション特性の波形
    4. 8.4 初期化セットアップ
    5. 8.5 電源に関する推奨事項
    6. 8.6 レイアウト
      1. 8.6.1 レイアウトのガイドライン
      2. 8.6.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
      2. 9.1.2 サード・パーティ製品に関する免責事項
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

7.3.5.1 DSP 入力マルチプレクサ

図 7-12 に示すように、DSP ブロックの入力には 4 つのデジタルマルチプレクサがあります。バスは adc_out[3:0] を基準とし、各インデックスは特定の ADC の固有の出力ストリームを表します。たとえば、ADC0 の出力は adc_out[0] です。各 DSP_IN マルチプレクサの出力は、DSP ブロックのシングル DSP 入力データストリームに対応します。DSP 入力データストリームの集計セットは、dsp_in[3:0] と呼ばれます。dsp_in[0] は 0 番目の DSP 入力データストリームに対応します。各 DSP 入力データストリームは、次のいずれかから供給できます：

  • 2 つの adc_out ストリームのいずれか (adc_out[0] とその他のいずれか 1 つ)。これは C(2,1) と表記されます。
  • 2 つの adc_out ストリームの平均。

注: 命名法 C(n,k) は、n 個の異なる項目を含む集合から k 個の項目を選択する可能性のある組み合わせを表しています。
たとえば、adc_out={adc0,adc1,adc2,adc3} という集合があるとすれば、この集合から 2 つの項目を選択する方法は以下の 6 つとなります：C(adc_out,2)={{ADC0,ADC1},{ADC0,ADC2},{ADC0,ADC3},{ADC1,ADC2},{ADC1,ADC3},{ADC2,ADC3}}
ADC32RF72 DSP 入力マルチプレクサの概要図 7-12 DSP 入力マルチプレクサの概要

次のパラメータをプログラムできます：

表 7-8 DSP 入力マルチプレクサ構成のプログラミング (x = 0、1、2、3)
システムパラメータ名サイズデフォルトアクセス権説明
DSP_IN_SRC_SEL{x}40、1、2、3R/W

DSP ブロックへの dsp_in[0..3] 入力ストリームの入力データソースを選択します。

0：ADC0 データ。

1：ADC1 データ。

2：ADC2 データ。

3：ADC3 データ。

4：ADC0 と ADC1 の 2　倍平均。

5：ADC0 と ADC2 の 2　倍平均。

6：ADC0 と ADC3 の 2　倍平均。

7：ADC1 と ADC2 の 2　倍平均。

8：ADC1 と ADC3 の 2　倍平均。

9：ADC2 と ADC3 の 2　倍平均。

その他：未使用