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SN74AHC367

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6-Kanal-Puffer, 2 bis 5,5 V mit Tri-State-Ausgängen

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SN74AHC367

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Produktdetails

Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 6 IOL (max) (mA) 8 Supply current (max) (µA) 40 IOH (max) (mA) -8 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 6 IOL (max) (mA) 8 Supply current (max) (µA) 40 IOH (max) (mA) -8 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
PDIP (N) 16 181.42 mm² 19.3 x 9.4 SOIC (D) 16 59.4 mm² 9.9 x 6 TSSOP (PW) 16 32 mm² 5 x 6.4
  • Operating range 2-V to 5.5-V V CC
  • Latch-up performance exceeds 100 mA per JESD 78, class II
  • Operating range 2-V to 5.5-V V CC
  • Latch-up performance exceeds 100 mA per JESD 78, class II

The ’AHC367 devices are hex buffers and line drivers designed for 2-V to 5.5-V V CC operation.

The ’AHC367 devices are hex buffers and line drivers designed for 2-V to 5.5-V V CC operation.
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Technische Dokumentation

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Typ Titel Datum
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Application note Live Insertion 01 Okt 1996

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML
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Simulationsmodell

SN74AHC367 Behavioral SPICE Model

SCLM263.ZIP (7 KB) - PSpice Model
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Referenzdesigns

TIDA-010023 — Kostenoptimiertes Referenzdesign für Strommessung und -Schutz mit < 1 % Genauigkeit für 3-Phasen-Inv

This reference design demonstrates a cost optimized three-phase inverter leg (low-side shunt) current sensing solution with high accuracy and faster response for sensorless 2-shunt or 3-shunt field oriented control (FOC). This reference design demonstrates inverter leg current sensing with full (...)
Design guide: PDF
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PDIP (N) 16 Optionen anzeigen
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TSSOP (PW) 16 Optionen anzeigen
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