ADC31JB68
- シングル・チャネル
- 16 ビット分解能
- 最大クロック速度：500Msps
- 小型の 40 ピン QFN パッケージ (6 x 6mm)
- 入力バッファの入力帯域幅 (3dB)：1300MHz
- アパーチャ・ジッタ：80fs
- オンチップのクロック分周器：/1、/2、/4
- オンチップのディザ
- フォアグラウンドとバックグラウンドの較正による一貫した動的性能
- 入力振幅と位相調整
- 入力フルスケール：1.7Vpp
- 電源電圧：1.2/1.8/3V
- JESD204B インターフェイス
- サブクラス 1 に準拠
- 5Gbps の 2 レーン
- マルチチップの同期をサポート
- 主な仕様
- 消費電力： 500Msps で 915mW
- -1dBFS、fin = 210MHz 時の性能
- SNR：69.3dBFS
- NSD：–153.3 dBFS/Hz
- SFDR：80dBc
- 非 HD2、HD3：-91dBFS
- -1dBFS、fin = 450MHz 時の性能
- SNR：67dBFS
- NSD：-151dBFS/Hz
- SFDR：77dBc HD2、3
- 非 HD2、HD3：-89dBFS
ADC31JB68 は低消費電力、広帯域幅、16 ビット、500MSPS のアナログ / デジタル・コンバータ (ADC) です。バッファ付きのアナログ入力により、広い周波数帯域にわたって入力インピーダンスが均一で、サンプルとホールドのグリッチ・エネルギーが最小化されます。このデバイスは、最大 1.3GHz の入力信号をサンプリングするよう設計されています。
ADC31JB68 は、広い入力周波数範囲にわたって、優れたスプリアス・フリー・ダイナミック・レンジ (SFDR) を維持し、消費電力も非常にわずかです。オンチップのディザ機能により、非常にクリーンなノイズ・フロアが得られます。フォアグラウンドおよびバックグラウンドの較正が組み込まれているため、温度範囲全体にわたって一貫した性能を実現し、部品間の差異も最小化されます。
このデバイスは、2 つのレーンのそれぞれで、データ・レートが最大 5Gbps の JESD204B シリアル・インターフェイスをサポートしているため、高集積システムを実現できます。
ADC31JB68 は 6mm × 6mm の 40 ピン QFN パッケージで供給されます。
技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | ADC31JB68 シングル・チャネル、16 ビット、500MSPS A/D コンバータ データシート (Rev. B 翻訳版) | PDF | HTML | 英語版 (Rev.B) | PDF | HTML | 2019/05/16 |
設計と開発
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| WQFN (RTA) | 40 | Ultra Librarian |
購入と品質
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