ADS54J40

アクティブ

デュアルチャネル、14 ビット、1.0GSPS、A/D コンバータ (ADC)

製品詳細

Sample rate (max) (Msps) 1000 Resolution (Bits) 14 Number of input channels 2 Interface type JESD204B Analog input BW (MHz) 1200 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 1.9 Power consumption (typ) (mW) 2700 Architecture Pipeline SNR (dB) 69.7 ENOB (Bits) 11.3 SFDR (dB) 89 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 1000 Resolution (Bits) 14 Number of input channels 2 Interface type JESD204B Analog input BW (MHz) 1200 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 1.9 Power consumption (typ) (mW) 2700 Architecture Pipeline SNR (dB) 69.7 ENOB (Bits) 11.3 SFDR (dB) 89 Operating temperature range (°C) -40 to 85 Input buffer Yes
VQFNP (RMP) 72 100 mm² (10 mm × 10 mm)
  • 14 ビット分解能、デュアル・チャネル、1GSPS の ADC
  • ノイズ・フロア:-158dBFS/Hz
  • スペクトラム性能 (fIN = 170MHz、-1dBFS 時)
    • SNR69.0dBFS
    • NSD:-155.9dBFS/Hz
    • SFDR:86dBc (インターリーブ・トーンを含む)
    • SFDR:89dBc (HD2、HD3、およびインターリーブ・トーンを除く)
  • スペクトラム性能 (fIN = 350MHz、-1dBFS 時)
    • SNR66.3dBFS
    • NSD:-153.3dBFS/Hz
    • SFDR:75dBc
    • SFDR:85dBc (HD2、HD3、およびインターリーブ・トーンを除く)
  • チャネル分離:fIN = 170MHz のとき 100dBc
  • 入力フルスケール:1.9Vpp
  • 入力帯域幅 (3dB):1.2GHz
  • オンチップ・ディザリング
  • 広帯域 DDC ブロックを搭載
  • サブクラス 1 をサポートする JESD204B インターフェイス
    • 10.0Gbps で、ADC ごとに 2 レーン
    • 5.0Gbps で、ADC ごとに 4 レーン
    • マルチチップの同期をサポート
  • 消費電力:1GSPS で 1.35W/チャネル
  • パッケージ:72 ピン VQFNP (10mm × 10mm)
  • 14 ビット分解能、デュアル・チャネル、1GSPS の ADC
  • ノイズ・フロア:-158dBFS/Hz
  • スペクトラム性能 (fIN = 170MHz、-1dBFS 時)
    • SNR69.0dBFS
    • NSD:-155.9dBFS/Hz
    • SFDR:86dBc (インターリーブ・トーンを含む)
    • SFDR:89dBc (HD2、HD3、およびインターリーブ・トーンを除く)
  • スペクトラム性能 (fIN = 350MHz、-1dBFS 時)
    • SNR66.3dBFS
    • NSD:-153.3dBFS/Hz
    • SFDR:75dBc
    • SFDR:85dBc (HD2、HD3、およびインターリーブ・トーンを除く)
  • チャネル分離:fIN = 170MHz のとき 100dBc
  • 入力フルスケール:1.9Vpp
  • 入力帯域幅 (3dB):1.2GHz
  • オンチップ・ディザリング
  • 広帯域 DDC ブロックを搭載
  • サブクラス 1 をサポートする JESD204B インターフェイス
    • 10.0Gbps で、ADC ごとに 2 レーン
    • 5.0Gbps で、ADC ごとに 4 レーン
    • マルチチップの同期をサポート
  • 消費電力:1GSPS で 1.35W/チャネル
  • パッケージ:72 ピン VQFNP (10mm × 10mm)

ADS54J40 は低電力で広帯域幅の 14 ビット、1.0GSPS、デュアル・チャネルの A/D コンバータ (ADC) です。信号対雑音比 (SNR) が高くなるように設計した本デバイスは、広い瞬時帯域幅にわたって最高のダイナミック・レンジを求めるアプリケーションのために –158dBFS/Hz のノイズ・フロアを実現しています。このデバイスは、最大 10.0Gbps のデータ転送速度の JESD204B シリアル・インターフェイスをサポートしており、ADC ごとに 2 レーンまたは 4 レーンをサポートできます。アナログ・バッファ入力により、広い周波数帯域にわたって入力インピーダンスが均一で、サンプルとホールドのグリッチ・エネルギーが最小化されます。必要に応じて、各 ADC チャネルを広帯域のデジタル・ダウン・コンバータ (DDC) ブロックへ接続できます。ADS54J40 は、非常に小さな消費電力で広い入力周波数範囲にわたって、非常に優れたスプリアス・フリー・ダイナミック・レンジ (SFDR) を実現します。

JESD204B インターフェイスにより、インターフェイスの配線数を削減でき、システムの集積度を高めることができます。内蔵のフェーズ・ロック・ループ (PLL) は ADC サンプリング・クロックを逓倍し、各チャネルからの 14 ビット・データをシリアル化するためのビット・クロックを生成します。

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ADS54J40 は低電力で広帯域幅の 14 ビット、1.0GSPS、デュアル・チャネルの A/D コンバータ (ADC) です。信号対雑音比 (SNR) が高くなるように設計した本デバイスは、広い瞬時帯域幅にわたって最高のダイナミック・レンジを求めるアプリケーションのために –158dBFS/Hz のノイズ・フロアを実現しています。このデバイスは、最大 10.0Gbps のデータ転送速度の JESD204B シリアル・インターフェイスをサポートしており、ADC ごとに 2 レーンまたは 4 レーンをサポートできます。アナログ・バッファ入力により、広い周波数帯域にわたって入力インピーダンスが均一で、サンプルとホールドのグリッチ・エネルギーが最小化されます。必要に応じて、各 ADC チャネルを広帯域のデジタル・ダウン・コンバータ (DDC) ブロックへ接続できます。ADS54J40 は、非常に小さな消費電力で広い入力周波数範囲にわたって、非常に優れたスプリアス・フリー・ダイナミック・レンジ (SFDR) を実現します。

JESD204B インターフェイスにより、インターフェイスの配線数を削減でき、システムの集積度を高めることができます。内蔵のフェーズ・ロック・ループ (PLL) は ADC サンプリング・クロックを逓倍し、各チャネルからの 14 ビット・データをシリアル化するためのビット・クロックを生成します。

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技術資料

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* データシート ADS54J40 デュアル・チャネル、14 ビット、1.0GSPS A/D コンバータ データシート (Rev. C 翻訳版) 英語版 (Rev.C) PDF | HTML 2021/07/12

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

ADS54J40EVM — ADS54J40 デュアルチャネル、14 ビット、1.0GSPS、A/D コンバータの評価基板

ADS54J40EVM は、ADS54J40 と、TI ( テキサス・インスツルメンツ) のクロック ジッタ クリーナである LMK04828 を評価するための評価基板 (EVM) です。ADS54J40 は、低消費電力、14 ビット、1GSPS の A/D コンバータ (ADC) であり、バッファ付きアナログ入出力に加えて、JESD204B インターフェイスを実装しています。この評価基板 (EVM) は、トランス結合型のアナログ入力を複数採用しており、多様な信号源と広い周波数範囲に対応できます。LMK04828 は、超低ジッタで超低位相ノイズの ADC サンプル (...)

ユーザー ガイド: PDF
サポート対象の製品とハードウェア
在庫あり
制限:
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入手不可
ファームウェア

TI204C-IP — Request for JESD204 rapid design IP

JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように、設計者の皆様を支援します。

JESD204 rapid design IP は、TI の高速データ (...)

サポート対象の製品とハードウェア
評価基板 (EVM) 向けの GUI

DATACONVERTERPRO-SW — 高速データ コンバータ向け Pro GUI インストーラー、v5.31

この高速データ コンバータ Pro GUIは、PC (Windows® XP/7/10 対応) 向けプログラムであり、TI の大半の高速データ コンバータである A/D コンバータ (ADC) や D/A コンバータ (DAC) と、アナログ フロント エンド (AFE) の各プラットフォームの評価を支援するために設計されました。DATACONVERTERPRO-SW は、データ キャプチャとパターン ジェネレータのカードである TSW14xxx シリーズ全体をサポートする設計を採用しており、時間ドメインと周波数ドメインの両方でデータ (...)

サポート対象の製品とハードウェア
評価基板 (EVM) 向けの GUI

SLAC594 — ADS54Jxx EVM GUI

サポート対象の製品とハードウェア
シミュレーション・モデル

ADS54J20/40/60 IBIS MODEL

SBAM205.ZIP (46 KB) - IBIS モデル
サポート対象の製品とハードウェア
シミュレーション・モデル

ADS54J20/40/60 IBIS-AMI Model

SBAM325.ZIP (5519 KB) - IBIS-AMI モデル
サポート対象の製品とハードウェア
計算ツール

ANALOG-ENGINEER-CALC — PC software analog engineer's calculator

アナログ エンジニア向けカリキュレータは、アナログ回路設計エンジニアが日常的に使用する反復的な計算の多くを迅速化します。この PC ベース ツールはグラフィカル インターフェイスにより、帰還抵抗を使用したオペアンプのゲイン設定から、A/D コンバータ (ADC) のドライブ バッファ回路の安定化に最適な部品の選択に至るまで、一般的に行われている各種計算のリストを表示します。

スタンドアロン ツールとして使用できるほか、『アナログ回路設計式一覧ポケット ガイド』で説明されているコンセプトと組み合わせることもできます。

サポート対象の製品とハードウェア
リファレンス・デザイン

TIDA-01378 — アップストリーム DOCSIS 3.1 アプリケーション向け広帯域レシーバのリファレンス デザイン

このリファレンス デザインは、LMH2832 デジタル制御可変ゲイン アンプ (DVGA) と ADS54J40 アナログ - デジタル コンバータ (ADC) を使用した広帯域レシーバ アプリケーション用のアナログ フロントエンド (AFE) 信号チェーンで構成されています。このデザインは主に、ケーブル モデム終端システム (CMTS) 用に指定されたアップストリーム DOCSIS 3.1 受信アプリケーションを対象としており、最大 196MHz のアップストリーム信号帯域幅をサポートしています。この回路は、DOCSIS 3.1 (...)
サポート対象の製品とハードウェア
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFNP (RMP) 72 Ultra Librarian

購入と品質

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

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