製品詳細

Resolution (Bits) 16 Number of DAC channels (#) 2 Interface type Parallel LVDS Sample/update rate (MSPS) 1000 Features Ultra High Speed Rating Catalog Interpolation 1x, 2x, 4x Power consumption (Typ) (mW) 1300 SFDR (dB) 81 Architecture Current Sink Operating temperature range (C) -40 to 85 Reference type Int
Resolution (Bits) 16 Number of DAC channels (#) 2 Interface type Parallel LVDS Sample/update rate (MSPS) 1000 Features Ultra High Speed Rating Catalog Interpolation 1x, 2x, 4x Power consumption (Typ) (mW) 1300 SFDR (dB) 81 Architecture Current Sink Operating temperature range (C) -40 to 85 Reference type Int
VQFN (RGC) 64 81 mm² 9 x 9
  • 16-Bit Digital-to-Analog Converter (DAC)
  • 1.0 GSPS Update Rate
  • 16-Bit Wideband Input LVDS Data Bus
    • 8 Sample Input FIFO
    • Interleaved I/Q Data for Dual-DAC Mode
  • High Performance
    • 73-dBc ACLR WCDMA TM1 at 180 MHz
  • 2x-32x Clock Multiplying PLL/VCO
  • 2x or 4x Interpolation Filters
    • Stopband Transition 0.4 to 0.6 Fdata
    • Filters Configurable in Either Low-Pass or High-Pass
      Mode Allows Selection of Higher Order Image
  • Fs/4 Coarse Mixer
  • On-Chip 1.2-V Reference
  • Differential Scalable Output: 2 to 20 mA
  • Package: 64-Pin 9-mm × 9-mm QFN
  • APPLICATIONS
    • Cellular Base Stations
    • Broadband Wireless Access (BWA)
    • WiMAX 802.16
    • Fixed Wireless Backhaul
    • Cable Modem Termination System (CMTS)

All other trademarks are the property of their respective owners

  • 16-Bit Digital-to-Analog Converter (DAC)
  • 1.0 GSPS Update Rate
  • 16-Bit Wideband Input LVDS Data Bus
    • 8 Sample Input FIFO
    • Interleaved I/Q Data for Dual-DAC Mode
  • High Performance
    • 73-dBc ACLR WCDMA TM1 at 180 MHz
  • 2x-32x Clock Multiplying PLL/VCO
  • 2x or 4x Interpolation Filters
    • Stopband Transition 0.4 to 0.6 Fdata
    • Filters Configurable in Either Low-Pass or High-Pass
      Mode Allows Selection of Higher Order Image
  • Fs/4 Coarse Mixer
  • On-Chip 1.2-V Reference
  • Differential Scalable Output: 2 to 20 mA
  • Package: 64-Pin 9-mm × 9-mm QFN
  • APPLICATIONS
    • Cellular Base Stations
    • Broadband Wireless Access (BWA)
    • WiMAX 802.16
    • Fixed Wireless Backhaul
    • Cable Modem Termination System (CMTS)

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The DAC5682Z is a dual-channel 16-bit 1.0 GSPS DAC with wideband LVDS data input, integrated 2x/4x interpolation filters, onboard clock multiplier, and internal voltage reference. The DAC5682Z offers superior linearity, noise, crosstalk, and PLL phase noise performance.

The DAC5682Z integrates a wideband LVDS port with on-chip termination. Full-rate input data can be transferred to a single DAC channel, or half-rate and 1/4-rate input data can be interpolated by onboard 2x or 4x FIR filters. Each interpolation FIR is configurable in either low-pass or high-pass mode, allowing selection of a higher order output spectral image. An on-chip delay lock loop (DLL) simplifies LVDS interfacing by providing skew control for the LVDS input data clock.

The DAC5682Z allows both complex or real output. An optional Fs/4 coarse mixer in complex mode provides coarse frequency upconversion and the dual DAC output produces a complex Hilbert Transform pair. An external RF quadrature modulator then performs the final single sideband up-conversion. The interpolation filters and complex coarse mixers efficiently provide frequency plan flexibility while enabling higher output DAC rates to simplify image rejection filtering.

The DAC5682Z is characterized for operation over the industrial temperature range of –40°C to 85°C and is available in a 64-pin QFN package. Other single-channel members of the family include the interpolating DAC5681Z and the noninterpolating DAC5681.

The DAC5682Z is a dual-channel 16-bit 1.0 GSPS DAC with wideband LVDS data input, integrated 2x/4x interpolation filters, onboard clock multiplier, and internal voltage reference. The DAC5682Z offers superior linearity, noise, crosstalk, and PLL phase noise performance.

The DAC5682Z integrates a wideband LVDS port with on-chip termination. Full-rate input data can be transferred to a single DAC channel, or half-rate and 1/4-rate input data can be interpolated by onboard 2x or 4x FIR filters. Each interpolation FIR is configurable in either low-pass or high-pass mode, allowing selection of a higher order output spectral image. An on-chip delay lock loop (DLL) simplifies LVDS interfacing by providing skew control for the LVDS input data clock.

The DAC5682Z allows both complex or real output. An optional Fs/4 coarse mixer in complex mode provides coarse frequency upconversion and the dual DAC output produces a complex Hilbert Transform pair. An external RF quadrature modulator then performs the final single sideband up-conversion. The interpolation filters and complex coarse mixers efficiently provide frequency plan flexibility while enabling higher output DAC rates to simplify image rejection filtering.

The DAC5682Z is characterized for operation over the industrial temperature range of –40°C to 85°C and is available in a 64-pin QFN package. Other single-channel members of the family include the interpolating DAC5681Z and the noninterpolating DAC5681.

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技術資料

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* データシート DAC5682Z 16-Bit, 1.0 GSPS 2x-4x Interpolating Dual-Channel Digital-to-Analog Converter (DAC) データシート (Rev. F) PDF | HTML 2015年 1月 20日
Analog Design Journal Q3 2009 Issue Analog Applications Journal 2018年 9月 24日
ユーザー・ガイド TSW3100 High Speed Digital Pattern Generator. (Rev. C) 2016年 5月 26日
EVM ユーザー ガイド (英語) TSW3070EVM: Amplifier Interface to Current Sink DAC - (Rev. A) 2016年 5月 23日
設計ガイド Wide bandwidth and High Voltage Arbitrary Waveform Generator Front End 2013年 9月 3日
アプリケーション・ノート High Speed, Digital-to-Analog Converters Basics (Rev. A) 2012年 10月 23日
ユーザー・ガイド TSW1400 Pattern Generators 2012年 5月 3日
ユーザー・ガイド GC5325 System Evaluation Kit (Rev. F) 2011年 4月 20日
アプリケーション・ノート Design of Diff Filters for Hi-Speed Signal Chains (Rev. B) 2010年 4月 30日
アプリケーション・ノート 高速データ変換 英語版をダウンロード 2009年 12月 11日
Analog Design Journal Interfacing op amps to high-speed DACs, Part 1: Current-sinking DACs 2009年 7月 14日
アプリケーション・ノート データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす 2009年 4月 22日
アプリケーション・ノート Passive Interface for Current Output DACs 2008年 11月 10日
アプリケーション・ノート CDCE72010 as clocking solution for High Speed Analog-to-Digital Converters 2008年 6月 8日
アプリケーション・ノート Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 2008年 6月 2日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

評価ボード

DAC5681EVM — DAC5681 評価モジュール

The DAC5681EVM is a circuit board that allows designers to evaluate the performance of Texas Instruments' single-channel 16-bit 1.0 GSPS digital-to-analog converter (DAC) featuring a fll 1GSPS DDR LVDS interface. The EVM provides a flexible environment to test the DAC5681 under a variety of clock, (...)
TI.com で取り扱いなし
評価ボード

DAC5681ZEVM — DAC5681Z 16 ビット、1.0GSPS、1x ~ 4x 補間 D/A コンバータの評価基板

DAC5681ZEVM は、TI のシングル・チャネル、16 ビット、1.0GSPS D/A コンバータ (DAC) の性能を評価するための回路基板です。この DAC の特長は、フルレートが 1GSPS の DDR LVDS インターフェイス、2x/4x 補間フィルタ、オンボード・クロック逓倍器、内部電圧リファレンスを搭載していることです。この評価基板 (EVM) を採用すると、さまざまなクロック条件と入力条件を使用して DAC5681Z をテストするためのフレキシブルな環境を実現できます。

この評価基板を TSW3100 (...)

TI.com で取り扱いなし
評価ボード

TRF3703-17EVM — TRF3703-17 評価モジュール

The TRF3703-17EVM evaluation module (EVM) is intended for the evaluation of the TRF3703-17 direct-launch quadrature modulator for applications in the transmit path of base stations and communications equipment.

TI.com で取り扱いなし
評価ボード

ABACO-3P-FMC204FPGA — Abaco Systems® FMC204 FPGA mezzanine card

FMC204 は、クワッド・チャネル A/D およびデュアル・チャネル D/A FMC ドーター・カードです。このカードは、TI の DAC5681Z デュアル・チャネル 16 ビット 1Gsps デバイスをベースにしています。FMC204 ドーター・カードは、FMC (ANSI/VITA 57.1) 規格に機械的および電気的に準拠しています。FMC204 は、高ピン数コネクタとフロント・パネル I/O を備えており、伝導冷却環境で使用できます。
From: Abaco Systems
インターフェイス・アダプタ

FMC-DAC-ADAPTER — 高速 DAC / FMC(Xilinx)ヘッダ・アダプタ・カード

The FMC-DAC-Adapter passive interconnect board enables the output of TI’s LVDS input high speed DACs to be directly connected to a standard FMC interconnect header, a typical input on the latest Xilinx FPGA EVMs. This enables users of TI’s high speed DAC EVMs to directly interface to Xilinx FPGA’s (...)
TI.com で取り扱いなし
評価基板 (EVM) 向けの GUI

DAC5682z EVM Software (Rev. A)

SLAC497A.ZIP (59041 KB)
評価基板 (EVM) 向けの GUI

TSW3100EVM GUI v2.7 (Rev. B)

SLLC420B.ZIP (199990 KB)
サポート・ソフトウェア

DATACONVERTERPRO-SW — 高速データ・コンバータ・プロ・ソフトウェア

この「高速データ・コンバータ Pro GUI」は、PC (Windows® XP/7/10 対応) 向けプログラムであり、TI の大半の高速データ・コンバータとアナログ・フロント・エンド (AFE) の各プラットフォームの評価を支援する設計を採用しています。DATACONVERTERPRO-SW は、データ・キャプチャとパターン・ジェネレータのカードである TSW14xxx (...)
シミュレーション・モデル

DAC5681, DAC5681Z, DAC5682Z IBIS Model (Rev. A) DAC5681, DAC5681Z, DAC5682Z IBIS Model (Rev. A)

シミュレーション・ツール

PSPICE-FOR-TI TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
計算ツール

DAC5682 LPF Calculator DAC5682 LPF Calculator

リファレンス・デザイン

TIDA-01187 — 高速データ・コンバータを使用する LIDAR パルス・タイム・オブ・フライト(ToF)のリファレンス・デザイン

高精度で距離を測定するために、タイム・オブ・フライト(ToF)を使用する光学的な手法は、レーザー・セーフティー・スキャナ、レンジ・ファインダー(距離計)、ドローン、ガイダンス・システムなどさまざまなアプリケーションで活用されています。このデザインは、ターゲット識別、サンプリング・レート要件の緩和、簡素化したシグナル・チェーンなど、高速データ・コンバータ・ベースのソリューションにおける利点を詳細に示します。また、このデザインは、光学系、ドライバ、レシーバのフロント・エンド回路や、A/D コンバータ(ADC)、D/A コンバータ(DAC)、信号処理にも対応しています。
リファレンス・デザイン

TIDA-00075 — 高帯域、および、高電圧任意波形ジェネレータ・フロント En

This design shows how to use an active interface with the current sink output of the DAC5682Z - typical applications for this include front ends for arbitrary waveform generators. The EVM includes the DAC5682Z for digital-to-analog conversion, an OPA695 to demonstrate an active interface (...)
パッケージ ピン数 ダウンロード
VQFN (RGC) 64 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

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