データシート
TS5A2066
- 低いオン抵抗(10Ω)
- 制御入力は5V許容
- 低い電荷注入
- 非常に優れたオン抵抗マッチング
- 低い全高調波歪(THD)
- 1.65V～5.5Vの単電源で動作
- JESD 78、Class II準拠で100mA超の
ラッチアップ性能 - ESD性能はJESD 22に準拠しテスト済み
- 人体モデルで2000V (A114-B、クラスII)
- 荷電デバイス・モデルで1000V (C101)
- 人体モデルで2000V (A114-B、クラスII)
TS5A2066デバイスはデュアル単極単投(SPST)アナログ・スイッチで、1.65V～5.5Vで動作するよう設計されています。このデバイスはデジタルとアナログの両方の信号を処理でき、VCCまでの信号をどちらの方向にも転送できます。
技術資料
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6 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | TS5A2066 デュアル・チャネル、10Ω SPSTアナログ・スイッチ データシート (Rev. F 翻訳版) | PDF | HTML | 英語版 (Rev.F) | PDF | HTML | 2018年 8月 24日 |
| アプリケーション・ノート | Selecting the Correct Texas Instruments Signal Switch (Rev. E) | PDF | HTML | 2022年 6月 2日 | |||
| アプリケーション・ノート | Multiplexers and Signal Switches Glossary (Rev. B) | PDF | HTML | 2021年 12月 1日 | |||
| アプリケーション・ノート | Preventing Excess Power Consumption on Analog Switches | 2008年 7月 3日 | ||||
| その他の技術資料 | TS5A2066DCTR Waiver | 2007年 10月 17日 | ||||
| アプリケーション・ノート | Semiconductor Packing Material Electrostatic Discharge (ESD) Protection | 2004年 7月 8日 |
設計および開発
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インターフェイス・アダプタ
LEADED-ADAPTER1 — TI の 5、8、10、16、24 ピン リード付きパッケージの迅速なテスト向けの表面実装から DIP ヘッダへのアダプタ
EVM-LEADED1 ボードは、TI の一般的なリード付きパッケージによる迅速なテストとブレッド ボードへの対応を可能にします。 TI の D、DBQ、DCT、DCU、DDF、DGS、DGV、PW 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントを用意しています。
ユーザー ガイド: PDF
インターフェイス・アダプタ
LEADLESS-ADAPTER1 — TI の 6、8、10、12、14、16、20 ピン リードレス パッケージのテスト向けの表面実装から DIP ヘッダへのアダプタ
EVM-LEADLESS1 ボードは、TI の一般的なリードレス パッケージによる迅速なテストとブレッド ボードへの対応を可能にします。 このボードには、TI の DRC、DTP、DQE、RBW、RGY、RSE、RSV、RSW RTE、RTJ、RUK、RUC、RUG、RUM、RUT、YZP 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントが用意されています。
ユーザー ガイド: PDF
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| DSBGA (YZP) | 8 | Ultra Librarian |
| SSOP (DCT) | 8 | Ultra Librarian |
| VSSOP (DCU) | 8 | Ultra Librarian |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。