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SN74LVC1G32

現行

1 通道、2 輸入、1.65-V 至 5.5-V 32-mA 驅動強度 OR 閘

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SN74LVC1G32

現行
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產品詳細資料

Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 5.5 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 32 IOH (max) (mA) -32 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 5.5 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 32 IOH (max) (mA) -32 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
DSBGA (YZP) 5 2.1875 mm² 1.75 x 1.25 SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-5X3 (DRL) 5 2.56 mm² 1.6 x 1.6 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1 USON (DRY) 6 1.45 mm² 1.45 x 1 X2SON (DPW) 5 0.64 mm² 0.8 x 0.8 X2SON (DSF) 6 1 mm² 1 x 1
  • Available in the Ultra-Small 0.64 mm2
    Package (DPW) with 0.5-mm Pitch
  • Supports 5-V VCC Operation
  • Inputs Accept Voltages to 5.5-V
  • Supports Down Translation to VCC
  • Max tpd of 3.6 ns at 3.3-V
  • Low Power Consumption, 10-µA Max ICC
  • ±24-mA Output Drive at 3.3-V
  • Ioff Supports Live Insertion, Partial-Power-Down
    Mode, and Back-Drive Protection
  • Latch-Up Performance Exceeds 100 mA Per
    JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)
  • Available in the Ultra-Small 0.64 mm2
    Package (DPW) with 0.5-mm Pitch
  • Supports 5-V VCC Operation
  • Inputs Accept Voltages to 5.5-V
  • Supports Down Translation to VCC
  • Max tpd of 3.6 ns at 3.3-V
  • Low Power Consumption, 10-µA Max ICC
  • ±24-mA Output Drive at 3.3-V
  • Ioff Supports Live Insertion, Partial-Power-Down
    Mode, and Back-Drive Protection
  • Latch-Up Performance Exceeds 100 mA Per
    JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)

This single 2-input positive-OR gate is designed for 1.65-V to 5.5-V VCC operation.

The SN74LVC1G32 device performs the Boolean function Y = A + B or Y = A\ + B\ in positive logic.

The CMOS device has high output drive while maintaining low static power dissipation over a broad VCC operating range.

The SN74LVC1G32 device is available in a variety of packages, including the ultra-small DPW package with a body size of 0.8 × 0.8 mm.

This single 2-input positive-OR gate is designed for 1.65-V to 5.5-V VCC operation.

The SN74LVC1G32 device performs the Boolean function Y = A + B or Y = A\ + B\ in positive logic.

The CMOS device has high output drive while maintaining low static power dissipation over a broad VCC operating range.

The SN74LVC1G32 device is available in a variety of packages, including the ultra-small DPW package with a body size of 0.8 × 0.8 mm.
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Application note CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
Application note LVC Characterization Information 1996年 12月 1日
Application note Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
Application note Live Insertion 1996年 10月 1日
Design guide Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
Application note Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日
Selection guide Logic Guide (Rev. AC) PDF | HTML 1994年 6月 1日

設計與開發

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開發板

5-8-LOGIC-EVM — 適用於 5 針腳至 8 針腳 DCK、DCT、DCU、DRL 和 DBV 封裝的通用邏輯評估模組

靈活的 EVM 旨在支援任何針腳數為 5 至 8 支且採用 DCK、DCT、DCU、DRL 或 DBV 封裝的裝置。
使用指南: PDF
TI.com 無法提供
模擬型號

HSPICE Model for SN74LVC1G32

SCEJ254.ZIP (87 KB) - HSpice Model
下載
模擬型號

SN74LVC1G32 Behavioral SPICE Model

SCEM632.ZIP (7 KB) - PSpice Model
下載
模擬型號

SN74LVC1G32 IBIS Model (Rev. C)

SCEM168C.ZIP (43 KB) - IBIS Model
下載
參考設計

TIDA-010065 — 基於高效、低排放、隔離式 DC/DC 轉換器的類比輸入模組參考設計

此參考設計為一簡化架構，可產生隔離式電源供應，適用於測量隔離電壓與電流的隔離式放大器。具 5-V 輸入之強化隔離操作的完全整合式 DC/DC 轉換器，並具備可設定 5-V 或 5.4-V 輸出 (適用於低壓降穩壓器 (LDO) 的空餘空間) 可產生隔離電源。介接至 ±50-mV 輸入範圍隔離放大器，且配置爲通道隔離輸入的分流，可測量電流。連接至 ±250-mV 或 ±12-V 輸入範圍隔離放大器，且配置爲群組隔離輸入的潛在分頻器，可測量電壓。隔離放大器介面直接輸出至 24 位元 ΔΣ 類比轉數位轉換器 (ADC)，或使用增益放大器擴展至 ±10 V，並連接至 16 位元 SAR ADC (...)
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參考設計

TIDA-00366 — 具有電流、電壓和溫度保護功能的強化型隔離式三相逆變器參考設計

此參考設計提供額定值高達 10kW 的三相逆變器，採用強化型隔離式閘極驅動器 UCC21530、強化型隔離式放大器 AMC1301 和 AMC1311 以及 MCU TMS320F28027 進行設計。使用 AMC1301 測量與 MCU 內部 ADC 介接的馬達電流，以及使用自舉式電源供應器為 IGBT 閘極驅動器供電，即可降低系統成本。此逆變器旨在為過載、短路、接地故障、DC 匯流排欠電壓與過電壓，以及 IGBT 模組過熱提供保護。
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TIDA-010025 — 配備光學模擬輸入閘極驅動器，且適用於 200-480 VAC 驅動器的三相逆變器參考設計

此參考設計採用隔離式 IGBT 閘極驅動器和隔離式電流/電壓感測器，實現強化隔離式三相逆變器子系統。所使用的 UCC23513 閘極驅動器採用 6 針腳寬體封裝和 LED 光學模擬輸入，可做為現有光學隔離式閘極驅動器的針腳對針腳替代品。此設計表明，可利用所有用於驅動光學隔離式閘極驅動器的現有配置來驅動 UCC23513 輸入級。使用 AMC1300B 隔離式放大器和 DC 鏈路電壓實現基於同相分流電阻器的馬達電流感測，使用 AMC1311 隔離式放大器實現 IGBT 模組溫度感測。此設計使用 C2000™ LaunchPad™ 進行逆變器控制。
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封裝 針腳 CAD 符號、佔位空間與 3D 模型
DSBGA (YZP) 5 Ultra Librarian
SOT-23 (DBV) 5 Ultra Librarian
SOT-5X3 (DRL) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
USON (DRY) 6 Ultra Librarian
X2SON (DPW) 5 Ultra Librarian
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適用 TI 的評估品項標準條款與條件。

訂購與品質

內含資訊：
  • RoHS
  • REACH
  • 產品標記
  • 鉛塗層/球物料
  • MSL 等級/回焊峰值
  • MTBF/FIT 估算值
  • 材料內容
  • 認證摘要
  • 進行中持續性的可靠性監測
內含資訊：
  • 晶圓廠位置
  • 組裝地點

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

以英文檢視所有論壇主題

內容係由 TI 和社群貢獻者依「現狀」提供，且不構成 TI 規範。檢視使用條款。

若有關於品質、封裝或訂購 TI 產品的問題，請參閱 TI 支援。​​​​​​​​​​​​​​

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