JAJSVL7A November   2024  – February 2026 TAA3020

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  熱に関する情報
    5. 5.5  電気的特性
    6. 5.6  タイミング要件：I2C インターフェイス
    7. 5.7  スイッチング特性：I2C インターフェイス
    8. 5.8  タイミング要件：TDM、I2S または LJ インターフェイス
    9. 5.9  スイッチング特性：TDM、I2S または LJ インターフェイス
    10. 5.10 タイミング要件：PDM デジタル マイクロフォン インターフェイス
    11. 5.11 スイッチング特性：PDM デジタル マイクロフォン インターフェイス
    12. 5.12 タイミング図
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 機能説明
      1. 6.3.1  シリアル インターフェイス
        1. 6.3.1.1 制御シリアル インターフェイス
        2. 6.3.1.2 オーディオ シリアル インターフェイス
          1. 6.3.1.2.1 時分割多重オーディオ (TDM) インターフェイス
          2. 6.3.1.2.2 I2S (Inter IC Sound) インターフェイス
          3. 6.3.1.2.3 左揃え (LJ) インターフェイス
        3. 6.3.1.3 共有バスで複数のデバイスを使用
      2. 6.3.2  フェーズ ロック ループ (PLL) とクロック生成
      3. 6.3.3  入力チャネルの構成
      4. 6.3.4  基準電圧
      5. 6.3.5  プログラム可能なマイクロフォン バイアス
      6. 6.3.6  シグナル チェーン処理
        1. 6.3.6.1 プログラム可能なチャネル ゲインおよびデジタル ボリューム制御
        2. 6.3.6.2 プログラム可能なチャネル ゲイン較正
        3. 6.3.6.3 プログラム可能なチャネル位相較正
        4. 6.3.6.4 プログラム可能なデジタル ハイパス フィルタ
        5. 6.3.6.5 プログラム可能なデジタル バイクワッド フィルタ
        6. 6.3.6.6 プログラム可能なチャネル サマーおよびデジタル ミキサ
        7. 6.3.6.7 構成可能なデジタル デシメーション フィルタ
          1. 6.3.6.7.1 線形位相フィルタ
            1. 6.3.6.7.1.1 サンプリング レート：7.35kHz ～ 8kHz
            2. 6.3.6.7.1.2 サンプリング レート：14.7kHz ～ 16kHz
            3. 6.3.6.7.1.3 サンプリング レート：22.05kHz ～ 24kHz
            4. 6.3.6.7.1.4 サンプリング レート：29.4kHz ～ 32kHz
            5. 6.3.6.7.1.5 サンプリング レート：44.1kHz ～ 48kHz
            6. 6.3.6.7.1.6 サンプリング レート：88.2kHz ～ 96kHz
            7. 6.3.6.7.1.7 サンプリング レート：176.4kHz ～ 192kHz
            8. 6.3.6.7.1.8 サンプリング レート：352.8kHz ～ 384kHz
            9. 6.3.6.7.1.9 サンプリング レート：705.6kHz ～ 768kHz
          2. 6.3.6.7.2 低レイテンシ フィルタ
            1. 6.3.6.7.2.1 サンプリング レート：14.7kHz ～ 16kHz
            2. 6.3.6.7.2.2 サンプリング レート：22.05kHz ～ 24kHz
            3. 6.3.6.7.2.3 サンプリング レート：29.4kHz ～ 32kHz
            4. 6.3.6.7.2.4 サンプリング レート：44.1kHz ～ 48kHz
            5. 6.3.6.7.2.5 サンプリング レート：88.2kHz ～ 96kHz
            6. 6.3.6.7.2.6 サンプリング レート：176.4kHz ～ 192kHz
          3. 6.3.6.7.3 超低レイテンシ フィルタ
            1. 6.3.6.7.3.1 サンプリング レート：14.7kHz ～ 16kHz
            2. 6.3.6.7.3.2 サンプリング レート：22.05kHz ～ 24kHz
            3. 6.3.6.7.3.3 サンプリング レート：29.4kHz ～ 32kHz
            4. 6.3.6.7.3.4 サンプリング レート：44.1kHz ～ 48kHz
            5. 6.3.6.7.3.5 サンプリング レート：88.2kHz ～ 96kHz
            6. 6.3.6.7.3.6 サンプリング レート：176.4kHz ～ 192kHz
            7. 6.3.6.7.3.7 サンプリング レート：352.8kHz ～ 384kHz
      7. 6.3.7  自動ゲイン コントローラ (AGC)
      8. 6.3.8  音声アクティビティ検出 (VAD)
      9. 6.3.9  デジタル PDM マイクロフォン録音チャネル
      10. 6.3.10 割り込み、ステータス、およびデジタル I/O ピンの多重化
    4. 6.4 デバイスの機能モード
      1. 6.4.1 スリープ モードまたはソフトウェア シャットダウン
      2. 6.4.2 アクティブ モード
      3. 6.4.3 ソフトウェア リセット
    5. 6.5 プログラミング
      1. 6.5.1 制御シリアル インターフェイス
        1. 6.5.1.1 I2C 制御インターフェイス
          1. 6.5.1.1.1 一般的な I2C の動作
            1. 6.5.1.1.1.1 I2C のシングル バイトおよびマルチ バイト転送
              1. 6.5.1.1.1.1.1 I2C のシングル バイト書き込み
              2. 6.5.1.1.1.1.2 I2C のマルチ バイト書き込み
              3. 6.5.1.1.1.1.3 I2C のシングル バイト読み出し
              4. 6.5.1.1.1.1.4 I2C のマルチ バイト読み出し
  8. 7 レジスタ マップ
    1. 7.1 デバイス構成レジスタ
    2. 7.2 Page_0 のレジスタ
    3. 7.3 Page_1 のレジスタ
    4. 7.4 プログラム可能な係数レジスタ
      1. 7.4.1 プログラム可能な係数レジスタ：ページ 2
      2. 7.4.2 プログラム可能な係数レジスタ：ページ 3
      3. 7.4.3 プログラム可能な係数レジスタ：ページ 4
  9. 8 アプリケーションと実装
    1. 8.1 使用上の注意
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 2 チャネルのアナログ マイク録音
        1. 8.2.1.1 設計要件
        2. 8.2.1.2 詳細な設計手順
          1. 8.2.1.2.1 EVM セットアップ用のデバイス レジスタ構成スクリプトの例
      2. 8.2.2 4 チャネルのデジタル PDM マイク録音
        1. 8.2.2.1 設計要件
        2. 8.2.2.2 詳細な設計手順
          1. 8.2.2.2.1 EVM セットアップ用のデバイス レジスタ構成スクリプトの例
    3. 8.3 設計のベスト プラクティス
    4. 8.4 電源に関する推奨事項
    5. 8.5 レイアウト
      1. 8.5.1 レイアウトのガイドライン
      2. 8.5.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

6.1 概要

TAA3020 は高性能、低消費電力、高柔軟性の 2 チャネルのオーディオ A/D コンバータ (ADC) で、豊富な機能を統合しています。デバイスは、音声操作システム、業務用マイク、電話会議、ポータブル コンピューティング、通信、エンターテインメントの各アプリケーションを意図しています。デバイスはダイナミック レンジが広いので、忠実度の高いファー フィールドのオーディオ録音を実現できます。このデバイスには、スペースが制限されたバッテリ駆動の民生用、家庭用、産業用アプリケーションにおけるコスト、基板スペース、電力消費を削減する多数の機能が統合されています。

TAA3020 は以下に示すブロックで構成されています。

  • 2 チャネル、マルチビット、高性能デルタ シグマ (ΔΣ) ADC
  • 構成可能なシングルエンド入力または差動入力
  • 低ノイズのプログラマブル マイク バイアス出力
  • 自動ゲイン コントローラ (AGC)
  • 線形位相フィルタまたは低レイテンシ フィルタを備えたプログラマブル デシメーション フィルタ
  • 各チャネルにプログラム可能なチャネル ゲイン、ボリューム制御、バイクワッド フィルタ
  • 各チャネルごとに、高分解能で位相とゲインの較正をプログラム可能
  • プログラマブル ハイパス フィルタ (HPF) およびデジタル チャネル ミキサ
  • パルス密度変調 (PDM) マイク 4 チャネルインターフェイスと高性能デシメーション フィルタ
  • 多様なシステム クロックをサポートする低ジッタのフェーズ ロック ループ (PLL) を内蔵
  • 単一電源動作をサポートするデジタルおよびアナログ電圧レギュレータを内蔵

制御レジスタを構成するための TAA3020 との通信は、I2C インターフェイスを使用してサポートされています。このデバイスは、柔軟性の高いオーディオ・シリアル・インターフェイス[時分割多重化（TDM）、I2S、左揃え（LJ）]をサポートしており、システムでデバイスの間でオーディオ データをシームレスに送信できます。

TAA3020 は、複数のデバイス間で共通の TDM バスを共有することで、複数のデバイスをサポートできます。さらに、このデバイスにはデイジーチェーン機能も搭載されています。これらの機能により、高いオーディオ データ帯域幅を必要とするアプリケーションで複数のデバイスを動作させる場合、共有 TDM バスのタイミング要件と基板設計の複雑さが緩和されます。

表 6-1 に、このドキュメント全体を通して、デバイスを制御するレジスタに使用される参照用略語を示します。

表 6-1 レジスタ参照の略語
リファレンス 略語 説明 例
ページ y、登録 z、ビット k Py_Rz_Dk シングル データ ビット。レジスタの 1 ビットの値。 ページ 4、レジスタ 36、ビット 0 = P4_R36_D0
ページ y、レジスタ z、ビット k-m Py_Rz_D[k:m] データ ビットの範囲。データ ビットの範囲（含む）。 ページ 4、レジスタ 36、ビット 3-0 = P4_R36_D[3:0]
ページ y、登録 z Py_Rz レジスタ全体に 1 つ。レジスタ内の 8 ビットすべてをユニットとして使用 ページ 4、レジスタ 36 = P4_R36
ページ y、レジスタ z-n Py_Rz-Rn レジスタの範囲。同じページ内のレジスタの範囲。 ページ 4、レジスタ 36、37、38 = P4_R36~R38