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LMK1D1208I

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8-Kanal-Ausgang 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer mit I²C-Schnittstelle

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Datenblatt

LMK1D1208I

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Produktdetails

Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
VQFN (RHA) 40 36 mm² (6 mm × 6 mm)
  • High-performance LVDS clock buffer family with 2 inputs and 8 outputs
  • Output frequency up to 2 GHz
  • Supply voltage: 1.8 V / 2.5 V / 3.3 V ± 5%
  • Device configurability through I 2C programming

    • Individual input and output enable/disable

    • Individual output amplitude select (standard or boosted)

    • Bank input multiplexer

  • Four programmable I 2C addresses through IDX pins
  • Low additive jitter: < 60 fs RMS maximum in 12-kHz to 20-MHz at 156.25 MHz

    • Very low phase noise floor: -164 dBc/Hz (typical)

  • Very low propagation delay: < 575 ps maximum
  • Output skew: 20 ps maximum
  • Universal inputs accept LVDS, LVPECL, LVCMOS, HCSL and CML
  • Fail-safe inputs
  • LVDS reference voltage, V AC_REF, available for capacitive coupled inputs
  • Industrial temperature range: –40°C to 105°C
  • Packages available
    • 6-mm × 6-mm, 40-Pin VQFN (RHA)
  • High-performance LVDS clock buffer family with 2 inputs and 8 outputs
  • Output frequency up to 2 GHz
  • Supply voltage: 1.8 V / 2.5 V / 3.3 V ± 5%
  • Device configurability through I 2C programming

    • Individual input and output enable/disable

    • Individual output amplitude select (standard or boosted)

    • Bank input multiplexer

  • Four programmable I 2C addresses through IDX pins
  • Low additive jitter: < 60 fs RMS maximum in 12-kHz to 20-MHz at 156.25 MHz

    • Very low phase noise floor: -164 dBc/Hz (typical)

  • Very low propagation delay: < 575 ps maximum
  • Output skew: 20 ps maximum
  • Universal inputs accept LVDS, LVPECL, LVCMOS, HCSL and CML
  • Fail-safe inputs
  • LVDS reference voltage, V AC_REF, available for capacitive coupled inputs
  • Industrial temperature range: –40°C to 105°C
  • Packages available
    • 6-mm × 6-mm, 40-Pin VQFN (RHA)

The LMK1D1208I is an I 2C-programmable LVDS clock buffer. The device has two inputs and eight pairs of differential LVDS clock outputs (OUT0 through OUT7) with minimum skew for clock distribution. The inputs can either be LVDS, LVPECL, LVCMOS, HCSL, or CML.

The LMK1D1208I is specifically designed for driving 50-Ω transmission lines. When driving inputs in single-ended mode, apply the appropriate bias voltage to the unused negative input pin.

I 2C programming enables this device to be configured as a single bank buffer (one of the two inputs is distributed to eight output pairs) or as a dual bank buffer (each input is distributed to four outputs pairs). Each output can be configured to have either a standard (350 mV) or boosted (500 mV) swing. This device also incorporates individual output channel enable or disable through I 2C programming. The LMK1D1208I has fail-safe inputs that prevent oscillation at the outputs in the absence of an input signal and allows for input signals before VDD is supplied.

The device operates in a 1.8-V, 2.5-V, or 3.3-V supply environment and is characterized from –40°C to 105°C (ambient temperature).

The LMK1D1208I is an I 2C-programmable LVDS clock buffer. The device has two inputs and eight pairs of differential LVDS clock outputs (OUT0 through OUT7) with minimum skew for clock distribution. The inputs can either be LVDS, LVPECL, LVCMOS, HCSL, or CML.

The LMK1D1208I is specifically designed for driving 50-Ω transmission lines. When driving inputs in single-ended mode, apply the appropriate bias voltage to the unused negative input pin.

I 2C programming enables this device to be configured as a single bank buffer (one of the two inputs is distributed to eight output pairs) or as a dual bank buffer (each input is distributed to four outputs pairs). Each output can be configured to have either a standard (350 mV) or boosted (500 mV) swing. This device also incorporates individual output channel enable or disable through I 2C programming. The LMK1D1208I has fail-safe inputs that prevent oscillation at the outputs in the absence of an input signal and allows for input signals before VDD is supplied.

The device operates in a 1.8-V, 2.5-V, or 3.3-V supply environment and is characterized from –40°C to 105°C (ambient temperature).
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Technische Dokumentation

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* Datenblatt LMK1D1208I I2C-Configurable, Low-Additive Jitter LVDS Buffer datasheet (Rev. A) PDF | HTML 14.06.2023

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

LMK1D1208IEVM — LMK1D1208I-Evaluierungsmodul für 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer mit 8 Kanälen und I²C

Das Evaluierungsmodul (EVM) LMK1D1208I dient dazu, die elektrische Leistung des LMK1D1208I zu demonstrieren. Der LMK1D1208I ist ein I2C-konfigurierbarer hochleistungsfähiger LVDS-Taktpuffer mit geringem additiven Jitter und zwei differenziellen Eingängen sowie acht LVDS-Ausgängen. Das (...)
Benutzerhandbuch: PDF | HTML
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Support-Software

TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices

Texas Instruments Taktgeber und Synthesizer (TICS) Pro Software wird verwendet, um die Evaluierungsmodule (EVMs) für Produktnummern mit folgenden Präfixen zu programmieren: CDC, LMK und LMX. Zu diesen Produkten gehören phasengeregelte Schleifen und spannungsgesteuerte Oszillatoren (PLL+VCO), (...)

Unterstützte Produkte und Hardware
Simulationsmodell

LMK1DX IBIS Model (Rev. B)

SNAM251B.ZIP (67 KB) - IBIS-Modell
Unterstützte Produkte und Hardware
Designtool

PLLATINUMSIM-SW — PLL-Schleifenfilter, Phasenrauschen, Sperrzeit und Spur-Simulationstool

PLLATINUMSIM-SW ist ein Simulationstool, mit dem Benutzer detaillierte Designs und Simulationen unserer integrierten PLLatinum™-Schaltkreisen erstellen können, einschließlich der LMX-Serie von phasenverriegelten Schleifen (PLLs) und Synthesizern.

Unterstützte Produkte und Hardware
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
VQFN (RHA) 40 Ultra Librarian
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