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LMKDB1202

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LP-HCSL-Takt-Multiplexer mit 2 Eingängen, 2 Ausgängen für PCIe Gen 1 bis Gen 7

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LMKDB1202

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Produktdetails

Function Clock buffer, Differential Additive RMS jitter (typ) (fs) 19.2 Output frequency (max) (MHz) 400 Number of outputs 2 Output supply voltage (V) 1.8, 3.3 Core supply voltage (V) 1.8, 3.3 Output skew (ps) 50 Features 2:2 fanout, Individual output enable control, OE# control, SMBus control, Side-Band Interface Operating temperature range (°C) -40 to 105 Rating Catalog Output type LP-HCSL Input type LP-HCSL
Function Clock buffer, Differential Additive RMS jitter (typ) (fs) 19.2 Output frequency (max) (MHz) 400 Number of outputs 2 Output supply voltage (V) 1.8, 3.3 Core supply voltage (V) 1.8, 3.3 Output skew (ps) 50 Features 2:2 fanout, Individual output enable control, OE# control, SMBus control, Side-Band Interface Operating temperature range (°C) -40 to 105 Rating Catalog Output type LP-HCSL Input type LP-HCSL
VQFN (REY) 20 9 mm² 3 x 3
  • LP-HCSL clock MUX that support:
    • PCIe Gen 1 to Gen 7
    • CC (Common Clock) and IR (Independent Reference) PCIe architectures
    • Input clock with or without SSC
  • DB2000QL compliant:
    • All devices meet DB2000QL specifications
  • Extremely low additive jitter:
    • 31fs maximum 12kHz to 20MHz RMS additive jitter at 156.25MHz
    • 13fs maximum additive jitter for PCIe Gen 4
    • 5fs maximum additive jitter for PCIe Gen 5
    • 3fs maximum additive jitter for PCIe Gen 6
    • 2.1fs maximum additive jitter for PCIe Gen 7
  • Fail-safe input
  • Flexible power-up sequence
  • Automatic output disable
  • Individual output enable
  • SBI (Side Band Interface) for high-speed output enable or disable
  • LOS (Loss of Signal) input detection
  • 85Ω or 100Ω output impedance
  • 1.8V / 3.3V ± 10% power supply
  • –40°C to 105°C ambient temperature
  • LP-HCSL clock MUX that support:
    • PCIe Gen 1 to Gen 7
    • CC (Common Clock) and IR (Independent Reference) PCIe architectures
    • Input clock with or without SSC
  • DB2000QL compliant:
    • All devices meet DB2000QL specifications
  • Extremely low additive jitter:
    • 31fs maximum 12kHz to 20MHz RMS additive jitter at 156.25MHz
    • 13fs maximum additive jitter for PCIe Gen 4
    • 5fs maximum additive jitter for PCIe Gen 5
    • 3fs maximum additive jitter for PCIe Gen 6
    • 2.1fs maximum additive jitter for PCIe Gen 7
  • Fail-safe input
  • Flexible power-up sequence
  • Automatic output disable
  • Individual output enable
  • SBI (Side Band Interface) for high-speed output enable or disable
  • LOS (Loss of Signal) input detection
  • 85Ω or 100Ω output impedance
  • 1.8V / 3.3V ± 10% power supply
  • –40°C to 105°C ambient temperature

The LMKDB devices are a family of extremely-low-jitter LP-HCSL clock muxes that support PCIe Gen 1 to Gen 7 and are DB2000QL compliant. The devices provide flexible power-up sequence, fail-safe inputs, individual output enable and disable pins, loss of input signal (LOS) detection and automatic output disable features, as well as excellent power supply noise rejection performance.

Both 1.8V and 3.3V power supply voltages are supported.

The LMKDB devices are a family of extremely-low-jitter LP-HCSL clock muxes that support PCIe Gen 1 to Gen 7 and are DB2000QL compliant. The devices provide flexible power-up sequence, fail-safe inputs, individual output enable and disable pins, loss of input signal (LOS) detection and automatic output disable features, as well as excellent power supply noise rejection performance.

Both 1.8V and 3.3V power supply voltages are supported.

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Technische Dokumentation

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Alle anzeigen 5
Typ Titel Datum
* Data sheet LMKDB12xx PCIe Gen 1 to Gen 7 Ultra Low Jitter 2 Input Clock MUX datasheet PDF | HTML 20 Aug 2025
Application brief Mitigating FLEXIO Use Case Risks as Clock Pins Using LMKDB11xxFS Fail-safe Output Clock Buffers PDF | HTML 26 Sep 2025
User guide RC19XXX, 9QXL2001X vs. LMKDB1XXX, CDCDB2000 Drop-In Replacement Guide. PDF | HTML 18 Jul 2024
Certificate LMKDB1202EVM Declaration of Conformity (DoC) 13 Jun 2024
Application note Clocking for PCIe Applications PDF | HTML 28 Nov 2023

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

LMKDB1202EVM — LMKDB1202 – Evaluierungsmodul

Das LMKDB1202-Evaluierungsmodul (EVM) ist für die schnelle Einrichtung zur Evaluierung des LMKDB1202 LP-HCSL-Puffers ausgelegt, der PCIe Gen 1 bis Gen 6 unterstützt. Die Leiterplatte (PCB) umfasst mehrere Jumper um den LMKDB1202 mit der gewünschten Benutzerprogrammierung und -Einrichtung zu (...)
Benutzerhandbuch: PDF | HTML
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Simulationsmodell

LMKDB1XXX IBIS Model

SNAM297.ZIP (58 KB) - IBIS Model
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Simulationstool

PSPICE-FOR-TI — PSpice® für TI Design-und Simulationstool

PSpice® für TI ist eine Design- und Simulationsumgebung, welche Sie dabei unterstützt, die Funktionalität analoger Schaltungen zu evaluieren. Diese Design- und Simulationssuite mit vollem Funktionsumfang verwendet eine analoge Analyse-Engine von Cadence®. PSpice für TI ist kostenlos erhältlich und (...)
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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
VQFN (REY) 20 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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  • REACH
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