LMK61E07
- 超低ノイズ、高性能
- ジッタ: 90fs RMS (fOUT > 100MHzでの標準値、LMK61E07)
- PSRR: -70dBcの堅牢な電源ノイズ耐性(LMK61E07)
- 柔軟な出力フォーマット(LMK61E07)
- LVPECL: 最大1GHz
- LVDS: 最大900MHz
- HCSL: 最大400MHz
- 合計周波数許容誤差: ±25ppm
- システム・レベルの機能
- グリッチなしの周波数マージン処理: 公称値から最大±1000ppm
- EEPROM内蔵: スタートアップ設定をユーザーが構成可能
- その他の特長
- デバイス制御: 最大1000kHzのファースト・モードI2C
- 動作電圧: 3.3V
- 工業用温度範囲: (-40℃~+85℃)
- 7mm×5mmの8ピン・パッケージ
- デフォルト周波数
- 70.656MHz
LMK61E07ファミリの超低ジッタPLLatinumTMプログラマブル発振器は、fractional-N周波数シンセサイザと内蔵VCOを使用して、一般的に使用されるリファレンス・クロックを生成します。LMK61E07の出力は、LVPECL、LVDS、またはHCSLとして構成できます。このデバイスは、オンチップのEEPROMにより自己起動し、工場でプログラムされたデフォルト出力周波数を生成します。また、デバイスのレジスタとEEPROM設定は、I2Cシリアル・インターフェイス経由でシステム内で完全にプログラム可能です。このデバイスは、I2Cシリアル・インターフェイスにより細かい/粗い周波数マージン処理を実行でき、デジタル制御の発振器(DCXO)となります。
PLL帰還分周値の更新により、スパイクやグリッチなしに出力周波数を調整できます。xDSLの要件との互換のためには12.5MHzのPFD (R分周値 = 4、ダブラー無効)を使用し1ppb未満の刻みで、放送ビデオの要件との互換のためには100MHzのPFD (R分周値 = 1、ダブラー有効)を使用し5.2ppb未満の刻みで調整が可能です。また、周波数マージン処理機能により、標準への準拠やシステムのタイミング・マージン・テストなどのシステム設計検証テスト(DVT)が容易になります。
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技術資料
種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | LMK61E07 EEPROM内蔵、超低ジッタのプログラマブル発振器 データシート (Rev. A 翻訳版) | PDF | HTML | 英語版をダウンロード (Rev.A) | PDF | HTML | 2018年 10月 8日 |
技術記事 | How to select an optimal clocking solution for your FPGA-based design | 2015年 12月 9日 | ||||
EVM ユーザー ガイド (英語) | LMK61FFEVM User's Guide (Rev. A) | 2015年 11月 20日 |
設計および開発
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LMK61E2-156M25EVM — LMK61E2-156M25 超低ジッタ固定周波数オシレータ、評価モジュール
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パッケージ | ピン数 | ダウンロード |
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QFM (SIA) | 6 | オプションの表示 |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL rating / リフローピーク温度
- MTBF/FIT 推定値
- 材料 (内容)
- 認定試験結果
- 継続的な信頼性モニタ試験結果
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。