SN65MLVD205A
- 100Mbps までの信号速度、50MHz までのクロック周波数に対応する 低電圧差動 30Ω～55Ω ライン ドライバおよびレシーバ(1)
- Type-1 レシーバは 25mV のヒステリシス付き (SN65MLVD200A、SN65MLVD202A)
- Type-2 レシーバはオフセット (100mV) スレッショルドによりオープン回路およびアイドル バス状況を検出 (SN65MLVD204A、SN65MLVD205A)
- マルチポイント データ交換について M-LVDS 規格 TIA/EIA-899 に適合またはそれを上回る性能準拠またはこれを上回る
- ドライバ出力電圧の遷移時間制御による信号品質の向上
- -1V～3.4V の同相電圧範囲により、2V のグランド ノイズでデータ転送が可能
- ディセーブル時または VCC ≤ 1.5V 時に バス ピンが高インピーダンス
- 200Mbps のデバイスも利用可能 (SN65MLVD201、SN65MLVD203、SN65MLVD206、SN65MLVD207)
- 8kV を超えるバス ピン ESD 保護
- 利用可能なパッケージ：
- 8 ピン SOIC SN65MLVD200A、SN65MLVD204A
- 14 ピン SOIC SN65MLVD202A、SN65MLVD205A
- SN65MLVD200、SN65MLVD202A、SN65MLVD204A、SN65MLVD205A デバイスに対する改良された代替品
(1)ラインの信号速度とは、1 秒あたりの電圧遷移回数を bps (ビット/秒) で表したものです。
SN65MLVD20xx のデバイスは、最高 100Mbps の信号速度で動作するよう最適化されたマルチポイント低電圧差動 (M-LVDS) ライン ドライバおよびレシーバです。すべての部品がマルチポイント低電圧差動信号伝送 (M-LVDS) 規格 TIA/EIA-899 に準拠しています。
SN65MLVD20xx のデバイスには、従来のデバイスと比較して拡張されている機能があります。改良部分として、ドライバ出力のスルー レート制御により無終端スタブからの反射を最小化し、シグナル インテグリティ (信号品質) を強化する機能が挙げられます。さらに、バス ピンに対する 8kV ESD 保護により堅牢性が向上しています。フットプリントの定義は同じであるため、簡単なドロップイン交換によりシステム性能のアップグレードが可能です。
これらのデバイスは、-40℃～85℃での動作が規定されています。
技術資料
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| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | SN65MLVD20xx マルチポイント LVDS ライン ドライバおよびレシーバ データシート (Rev. E 翻訳版) | PDF | HTML | 英語版 (Rev.E) | PDF | HTML | 2024/08/26 |
設計と開発
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制限：
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入手不可
評価ボード
MLVD20XEVM — M-LVDS 評価モジュール
この評価基板は、M-LVDS トランシーバである SN65MLVD203B と SN65MLVD204B 向けです。
SN65MLVD203B は全二重トランシーバ、SN65MLVD204B は半二重トランシーバです。
SN65MLVD203B は全二重トランシーバ、SN65MLVD204B は半二重トランシーバです。
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| SOIC (D) | 14 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。