CDCDB2000
- 20 LP-HCSL outputs with integrated 85Ω output terminations
- 8 hardware output enable (OE#) controls
- Additive phase jitter after DB2000QL filter: < 0.08ps rms
- Supports PCIe Gen 6 and Gen 7 Common Clock (CC) and Individual Reference (IR) architectures
- Spread spectrum-compatible
- Cycle-to-cycle jitter: < 50ps
- Output-to-output skew: < 50ps
- Input-to-output delay: < 3ns
- 3.3V core and IO supply voltages
- Hardware-controlled low power mode (PD#)
- Side-Band Interface (SBI) for output control in PD# mode
- 9 selectable SMBus addresses
- Power consumption: < 600mW
- 6mm × 6mm, 80-pin TLGA/GQFN package
The CDCDB2000 is a 20-output LP-HCSL, DB2000QL compliant, clock buffer capable of distributing the reference clock for PCIe Gen 1-7, QuickPath Interconnect (QPI), UPI, SAS, and SATA interfaces. The SMBus, SBI, and 8 output enable pins allow the configuration and control of all 20 outputs individually. The CDCDB2000 is a DB2000QL derivative buffer and meets or exceeds the system parameters in the DB2000QL specification. The CDCDB2000 is packaged in a 6mm × 6mm TLGA/GQFN package with 80 leads.
기술 자료
| 상위 문서 | 유형 | 직함 | 형식 옵션 | 최신 영어 버전 다운로드 | 날짜 |
|---|---|---|---|---|---|
| * | 데이터 시트 | CDCDB2000 DB2000QL-Compliant 20-Output Clock Buffer for PCIe Gen 1 to Gen 7 datasheet (Rev. C) | PDF | HTML | 2025. 8. 6 | |
| 사용 설명서 | RC19XXX, 9QXL2001X vs. LMKDB1XXX, CDCDB2000 Drop-In Replacement Guide. | PDF | HTML | 2024. 7. 18 | ||
| 사용 설명서 | CDCDB2000 User's Guide | 2019. 10. 29 |
설계 및 개발
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| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| TLGA (NPP) | 80 | Ultra Librarian |
주문 및 품질
권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.