SN65LVELT23
- Dual 3.3-V Differential LVPECL/LVDS to LVTTL Buffer Translator
- 24-mA LVTTL Ouputs
- Operating Range
- PECL VCC = 3 V to 3.6 V With GND = 0 V
- Support for Clock Frequencies to >180 MHz
- 2-ns Typical Propagation Delay
- Internal Input Pullup and Pulldown Resistors
- Built-in Temperature Compensation
- Drop-In Compatible to MC100LVELT23
- APPLICATIONS
- Data and Clock Transmission Over Backplane
- Signaling Level Conversion for Clock or Data
The SN65LVELT23 is a low-power dual LVPECL/LVDS to LVTTL translator device. The device includes circuitry to maintain inputs at VCC/2 when left open. The SN65LVELT23 is housed in an industry-standard SOIC-8 package and is also available in a TSSOP-8 option.
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技術文件
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| 重要文件 | 類型 | 標題 | 格式選項 | 下載最新的英文版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 資料表 | 3.3V Dual Differential LVPECL/LVDS Buffer to LVTTL Translator datasheet (Rev. A) | 2009/8/3 | |||
| 應用說明 | AC Coupling Between Differential LVPECL, LVDS, HSTL and CML (Rev. C) | 2007/10/17 |
設計與開發
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| 封裝 | 針腳 | CAD 符號、佔位空間與 3D 模型 |
|---|---|---|
| SOIC (D) | 8 | Ultra Librarian |
| VSSOP (DGK) | 8 | Ultra Librarian |
訂購與品質
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