JAJSQF8B September   2024  – August 2025 DLPC8445 , DLPC8455

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 ピン構成および機能
    1.     6
    2. 4.1  初期化、基板レベル テスト、デバッグ
    3. 4.2  V-by-One インターフェイスの入力データおよび制御
    4. 4.3  FPD-Link ポートの入力データおよび制御 (DLPC8445、DLPC8445V、DLPC8455 ではサポートされていません)
    5. 4.4  DSI 入力データおよびクロック (DLPC8445、DLPC8445V、DLPC8455 ではサポートされていません)
    6. 4.5  DMD SubLVDS インターフェイス
    7. 4.6  DMD リセットおよび低速インターフェイス
    8. 4.7  フラッシュ インターフェイス
    9. 4.8  ペリフェラル インターフェイス
    10. 4.9  GPIO ペリフェラル インターフェイス
    11. 4.10 クロックおよび PLL のサポート
    12. 4.11 電源およびグランド
    13. 4.12 I/O タイプのサブスクリプト定義
    14. 4.13 内部プルアップおよびプルダウンの特性
  6. 5 仕様
    1. 5.1  絶対最大定格
    2.     22
    3. 5.2  ESD 定格
    4. 5.3  推奨動作条件
    5. 5.4  熱に関する情報
    6. 5.5  電源の電気的特性
    7. 5.6  ピンの電気的特性
    8. 5.7  DMD SubLVDS インターフェイスの電気的特性
    9.     29
    10. 5.8  DMD 低速インターフェイスの電気的特性
    11.     31
    12. 5.9  V-by-One インターフェイスの電気的特性
    13. 5.10 USB の電気的特性
    14.     34
    15. 5.11 システム発振器のタイミング要件
    16.     36
    17. 5.12 電源およびリセットのタイミング要件
    18.     38
    19. 5.13 V-by-One インターフェイスの一般的なタイミング要件
    20.     40
    21. 5.14 フラッシュ インターフェイスのタイミング要件
    22.     42
    23. 5.15 ソース フレームのタイミング要件
    24.     44
    25. 5.16 同期シリアル ポート インターフェイスのタイミング要件
    26.     46
    27. 5.17 I2C インターフェイス タイミングの要件
    28. 5.18 プログラマブル出力クロックのタイミング要件
    29. 5.19 JTAG バウンダリ スキャン インターフェイスのタイミング要件 (デバッグのみ)
    30.     50
    31. 5.20 DMD 低速インターフェイスのタイミング要件
    32.     52
    33. 5.21 DMD SubLVDS インターフェイスのタイミング要件
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 機能説明
      1. 6.3.1 入力ソース
      2. 6.3.2 V-by-One インターフェイス
      3. 6.3.3 DMD (SubLVDS) インターフェイス
      4. 6.3.4 シリアル フラッシュ インターフェイス
      5. 6.3.5 GPIO のサポート機能
        1.       63
        2.       64
      6. 6.3.6 デバッグ サポート
  8. 7 電源に関する推奨事項
    1. 7.1 システムのパワーアップおよびパワーダウン シーケンス
    2. 7.2 DMD 高速パーク制御 (PARKZ)
    3. 7.3 パワー マネージメント
    4. 7.4 ホットプラグの使用法
    5. 7.5 未使用の入力ソース インターフェイスの電源
    6. 7.6 電源
      1. 7.6.1 電源 DLPA3085 または DLPA3082
  9. 8 レイアウト
    1. 8.1 レイアウトのガイドライン
      1. 8.1.1 DLPC8445、DLPC8445V、または DLPC8455 リファレンスクロックのレイアウトガイドライン
        1. 8.1.1.1 水晶発振器の推奨構成
      2. 8.1.2 V-by-One インターフェイス レイアウトの考慮事項
      3. 8.1.3 DMD 最大ピン間、PCB インターコネクト エッチング長
      4. 8.1.4 電源のレイアウト ガイドライン
    2. 8.2 熱に関する注意事項
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 サード・パーティ製品に関する免責事項
    2. 9.2 ドキュメントのサポート
      1. 9.2.1 関連資料
    3. 9.3 ドキュメントの更新通知を受け取る方法
    4. 9.4 サポート・リソース
    5. 9.5 デバイスの命名規則
      1. 9.5.1 デバイスのマーキング
    6. 9.6 商標
    7. 9.7 静電気放電に関する注意事項
    8. 9.8 用語集
      1. 9.8.1 ビデオ タイミング パラメータの定義
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

1 特長

  • DLPC84x5 コントローラのサポート
    • 60Hz で最大 4K UHD
    • 240Hz (2D) および 120Hz (3D) で最大 1080p
  • DLPC84x5 コントローラは、以下の 4K UHD DMD をサポートしています。
    • DLPC8445 および DLPC8445V は、DLP472TP および DLP391TP DMD をサポートしています
    • DLPC8455 は DLP473TE DMD をサポートしています
  • 1、2、4、または 8 レーンの V-by-One® HS ビデオ入力ポート × 1
    • 最大 600MHz のピクセル クロックと 60Hz で 2160p
    • 最大 3.0Gbps の入力伝送レート
  • サポートされている入力形式
    • RGB および YCbCr
    • 4:4:4 と 4:2:2
  • 内蔵 Arm® プロセッサ
    • 52 本の構成可能な GPIO
    • PWM ジェネレータ
    • キャプチャ タイマおよび遅延タイマ
    • USB 2.0 高速コントローラ
    • SPI および I2C コントローラー
    • UART および割り込みコントローラ
  • ワーピング エンジン
    • 1D および 2D キーストーン補正
    • ビデオ処理用の組み込み部分フレーム メモリ
  • 追加の画像処理
    • オーバーラップ カラー対応 (DLPC8445V および DLPC8455のみ)
    • 可変リフレッシュ レート (VRR) 対応
    • ローリング バッファによるフレーム レイテンシの短縮
    • DynamicBlack
    • フレーム レートの乗算
    • 色座標調整
    • 色温度調整
    • 逆ガンマ補正をプログラム可能
    • 読み出し側の空間分割 / 時分割多重化
    • 3D ディスプレイの統合サポート
  • スプラッシュ スクリーン ディスプレイ
  • マイクロプロセッサおよび PWM シーケンス用のシリアル フラッシュ
  • システム制御
    • DMD 電源およびリセット ドライバ制御
    • DMD 画像の左右 / 上下反転
  • JTAG バウンダリ スキャン テストをサポート
  • LED、RGB レーザー、レーザー蛍光ベースのシステムをサポート