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CDCBT1001

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Taktpuffer und Pegelumsetzer für 1,2 V bis 1,8 V

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Produktdetails

Function Level translator, Single-ended Output frequency (max) (MHz) 24 Number of outputs 1 Output supply voltage (V) 1.8 Core supply voltage (V) 1.2 Features 1.2V to 1.8V Clock Buffer and Level Translator Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
Function Level translator, Single-ended Output frequency (max) (MHz) 24 Number of outputs 1 Output supply voltage (V) 1.8 Core supply voltage (V) 1.2 Features 1.2V to 1.8V Clock Buffer and Level Translator Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
X2SON (DPW) 5 0.64 mm² 0.8 x 0.8
  • Clock frequency range: DC to 24 MHz
  • 1.2-V to 1.8-V LVCMOS clock level translation:
    • VDD_IN = 1.2 V ± 10%
    • VDD_OUT = 1.8 V ± 10%
  • Low additive jitter and phase noise:
    • 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (fout = 24 MHz)
    • –120-dBc/Hz maximum phase noise at 1-kHz offset (fout = 24 MHz)
    • –148-dBc/Hz maximum phase noise floor (fout = 24 MHz, foffset ≥ 1 MHz)
  • 5-ns 20% to 80% rise/fall time
  • 10-ns propagation delay
  • Low current consumption
  • –40°C to 85°C operating temperature range
  • Clock frequency range: DC to 24 MHz
  • 1.2-V to 1.8-V LVCMOS clock level translation:
    • VDD_IN = 1.2 V ± 10%
    • VDD_OUT = 1.8 V ± 10%
  • Low additive jitter and phase noise:
    • 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (fout = 24 MHz)
    • –120-dBc/Hz maximum phase noise at 1-kHz offset (fout = 24 MHz)
    • –148-dBc/Hz maximum phase noise floor (fout = 24 MHz, foffset ≥ 1 MHz)
  • 5-ns 20% to 80% rise/fall time
  • 10-ns propagation delay
  • Low current consumption
  • –40°C to 85°C operating temperature range

The CDCBT1001 is a 1.2-V to 1.8-V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2 V ± 10%. VDD_OUT = 1.8 V ± 10%

The 12-kHz to 5-MHz additive RMS jitter at 24 MHz is less than 0.8 ps.

The CDCBT1001 is a 1.2-V to 1.8-V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2 V ± 10%. VDD_OUT = 1.8 V ± 10%

The 12-kHz to 5-MHz additive RMS jitter at 24 MHz is less than 0.8 ps.
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Technische Dokumentation

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Typ Titel Datum
* Data sheet CDCBT1001 1.2-V to 1.8-V Clock Buffer and Level Translator datasheet PDF | HTML 20 Mai 2022
EVM User's guide CDCBT1001EVM Evaluation Instructions PDF | HTML 16 Mai 2022
Certificate CDCBT1001EVM EU RoHS Declaration of Conformity (DoC) 25 Mär 2022

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Simulationsmodell

CDCBT1001 IBIS model

SCEM796.ZIP (13 KB) - IBIS Model
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PSPICE-FOR-TI — PSpice® für TI Design-und Simulationstool

PSpice® für TI ist eine Design- und Simulationsumgebung, welche Sie dabei unterstützt, die Funktionalität analoger Schaltungen zu evaluieren. Diese voll ausgestattete Design- und Simulationssuite verwendet eine analoge Analyse-Engine von Cadence®. PSpice für TI ist kostenlos erhältlich und (...)
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