ADC34DSO75

プレビュー

製品詳細

Rating Catalog Operating temperature range (°C) to
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FCCSP (ANH) 289 190.44 mm² (13.8 mm × 13.8 mm)
  • 14 ビット、クワッド チャネル、3GSPS ADC:
    • 熱ノイズ:68dBFS
    • 非インターリーブ ADC アーキテクチャ
    • バッファ付きアナログ入力
    • 入力フルスケール:1.4375Vpp
    • フルパワー入力帯域幅 (-3dB):3GHz
    • 消費電力:1.6W / チャネル (3GSPS)
    • プログラマブル FIR フィルタ (チャネルごとに最大 96 タップ)
  • デジタル ストレージ オシロスコープ (DSO) 機能セット:
    • プログラマブルなスレッショルドによる自律型イベント検出
    • チャネル間のクロストリガ
    • 検出イベントへのタイムスタンプ付与
    • 最大 32720 サンプル / チャネルの柔軟なイベント キャプチャ メモリ
    • プログラム可能なプリイベントおよびポストイベント キャプチャ ウィンドウ
    • メモリ格納前のプログラマブル ダウンサンプラ
  • イベント読み取りに使用する OSPI:
    • 25MSPS のクロック レート、200Mbps スループット
    • チップ間で OSPI のデイジーチェーン接続をサポート
  • デバイスの制御と構成に使用できる CSPI
  • 出力電圧レール:0.9V、1.2V、1.8V
  • 14 ビット、クワッド チャネル、3GSPS ADC:
    • 熱ノイズ:68dBFS
    • 非インターリーブ ADC アーキテクチャ
    • バッファ付きアナログ入力
    • 入力フルスケール:1.4375Vpp
    • フルパワー入力帯域幅 (-3dB):3GHz
    • 消費電力:1.6W / チャネル (3GSPS)
    • プログラマブル FIR フィルタ (チャネルごとに最大 96 タップ)
  • デジタル ストレージ オシロスコープ (DSO) 機能セット:
    • プログラマブルなスレッショルドによる自律型イベント検出
    • チャネル間のクロストリガ
    • 検出イベントへのタイムスタンプ付与
    • 最大 32720 サンプル / チャネルの柔軟なイベント キャプチャ メモリ
    • プログラム可能なプリイベントおよびポストイベント キャプチャ ウィンドウ
    • メモリ格納前のプログラマブル ダウンサンプラ
  • イベント読み取りに使用する OSPI:
    • 25MSPS のクロック レート、200Mbps スループット
    • チップ間で OSPI のデイジーチェーン接続をサポート
  • デバイスの制御と構成に使用できる CSPI
  • 出力電圧レール:0.9V、1.2V、1.8V

ADC34DSO75 は、イベント検出エンジンと内部キャプチャ メモリを内蔵した 14 ビット、3GSPS、4 チャネルの A/D コンバータ (ADC) で、統合型のデジタル ストレージ オシロスコープ (DSO) 機能を実現できます。バッファ付きアナログ入力は 100Ω または 200Ω の内部終端インピーダンスを備えており、各 ADC で 3GHz (-3dB) のフルパワー入力帯域幅を実現できます。

各 ADC チャネルには専用のイベント検出エンジンがあり、OSPI 経由でオフロードするためのデータ キャプチャとオンチップ メモリへの保存を制御します。イベント検出モードは多数あり、絶対上限スレッショルド、下限スレッショルド、取得したベースラインから導出した上限 / 下限スレッショルド、スロープ ベースのトリガ、ピン ベースのトリガなどがあります。各 ADC34DSO75 チップには 256KiB メモリが搭載されており、ADC の四つのチャネルにパーティション分割することができます。イベントが検出されると、イベントに対応するサンプルをメモリに書き込むことができます。イベント データとともに、イベント ヘッダ (イベントあたり 96 バイト) がメモリに格納されます。イベント ヘッダには、イベント モード、イベント発生時の電圧、タイムスタンプなど、キャプチャしたイベントに関する情報が含まれます。イベントで保存するサンプル数はチャネルごとにプログラム可能で、プリイベントおよびポスト イベントのウィンドウ サイズによって決まります。各イベントには、フル サンプル クロック レートで動作するイベント検出エンジン内の 64 ビット カウンタによってタイムスタンプが付与されます。このデバイスはチャネルごとにピンを備えており、ピン ベースのイベント トリガに使用できるほか、イベント検出ステータスをピンに出力することもできます。ADC34DSO75 は二つの SYSREF 出力を備えており、シンプルなマルチデバイス同期方式を実現できます。

デバイスの設定は、標準的な SPI バスである CSPI を使用して行います。オンチップ メモリは、オクタル シリアル ペリフェラル インターフェイス (OSPI) 経由で読み出します。複数の ADC チップをデイジーチェーン接続することで、ホストとのインターフェイスを一つの (OSPI) インターフェイスにまとめることができます。

ADC34DSO75 は、イベント検出エンジンと内部キャプチャ メモリを内蔵した 14 ビット、3GSPS、4 チャネルの A/D コンバータ (ADC) で、統合型のデジタル ストレージ オシロスコープ (DSO) 機能を実現できます。バッファ付きアナログ入力は 100Ω または 200Ω の内部終端インピーダンスを備えており、各 ADC で 3GHz (-3dB) のフルパワー入力帯域幅を実現できます。

各 ADC チャネルには専用のイベント検出エンジンがあり、OSPI 経由でオフロードするためのデータ キャプチャとオンチップ メモリへの保存を制御します。イベント検出モードは多数あり、絶対上限スレッショルド、下限スレッショルド、取得したベースラインから導出した上限 / 下限スレッショルド、スロープ ベースのトリガ、ピン ベースのトリガなどがあります。各 ADC34DSO75 チップには 256KiB メモリが搭載されており、ADC の四つのチャネルにパーティション分割することができます。イベントが検出されると、イベントに対応するサンプルをメモリに書き込むことができます。イベント データとともに、イベント ヘッダ (イベントあたり 96 バイト) がメモリに格納されます。イベント ヘッダには、イベント モード、イベント発生時の電圧、タイムスタンプなど、キャプチャしたイベントに関する情報が含まれます。イベントで保存するサンプル数はチャネルごとにプログラム可能で、プリイベントおよびポスト イベントのウィンドウ サイズによって決まります。各イベントには、フル サンプル クロック レートで動作するイベント検出エンジン内の 64 ビット カウンタによってタイムスタンプが付与されます。このデバイスはチャネルごとにピンを備えており、ピン ベースのイベント トリガに使用できるほか、イベント検出ステータスをピンに出力することもできます。ADC34DSO75 は二つの SYSREF 出力を備えており、シンプルなマルチデバイス同期方式を実現できます。

デバイスの設定は、標準的な SPI バスである CSPI を使用して行います。オンチップ メモリは、オクタル シリアル ペリフェラル インターフェイス (OSPI) 経由で読み出します。複数の ADC チップをデイジーチェーン接続することで、ホストとのインターフェイスを一つの (OSPI) インターフェイスにまとめることができます。

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技術資料

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* データシート ADC34DSO75 イベント検出機能と内部キャプチャ メモリ搭載、クワッド チ ャネル、14 ビット 3GSPS ADC PDF | HTML PDF | HTML 2026/10/06
技術記事 AI データ センターが察知できない電力グリッチ PDF | HTML PDF | HTML 2026/10/08

設計と開発

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評価ボード

ADC34RF72EVM — ADC3xRF72 評価基板

ADC3xRF72EVM は、ADC34RF7x ファミリの高速アナログ/デジタル コンバータ (ADC) を評価するために設計された評価モジュール (EVM) です。ADC3xRF72EVM には、ADC3xRF72 が搭載されています。ADC3xRF72 は、JESD インターフェイスを備えた 16 ビット ADC、クアッド チャネル ADC であり、最大 1.5GSPS のサンプル レートで動作できます。ADC3xRF72EVM を使用すると、デバイスの以下の速度グレード (サンプリング レート) とチャネル数を評価できます。
ユーザー ガイド: PDF | HTML
サポート対象の製品とハードウェア
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
FCCSP (ANH) 289 Ultra Librarian

購入と品質

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