データシート
DS90CR218A
- 12 to 85 MHz shift clock support
- 50% duty cycle on receiver output clock
- Low power consumption
- ±1V common-mode range (around +1.2V)
- Narrow bus reduces cable size and cost
- Up to 1.785 Gbps throughput
- Up to 223 Mbytes/sec bandwidth
- 345 mV (typ) swing LVDS devices for low EMI
- PLL requires no external components
- Rising edge data strobe
- Compatible with TIA/EIA-644 LVDS standard
- Low profile 48-lead TSSOP package
The DS90CR218A receiver deserializes three input LVDS data streams into 21 bits of CMOS/TTL output data. When operating at the maximum input clock rate of 85 Mhz, the LVDS data is received at 595 Mbps per data channel for a total data throughput of 1.785 Gbit/sec (233 Mbytes/sec).
The narrow bus and LVDS signalling of the DS90CR218A is an ideal means to solve EMI and cable size problems associated with wide, high-speed TTL interfaces.
技術資料
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7 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | DS90CR218A 3.3VRising Edge Data Strobe LVDS 21Bit Chan Link 12MHz to 85MHz (jp) データシート (Rev. C 翻訳版) | 最新英語版 (Rev.D) | PDF | HTML | 2006年 10月 19日 | |
| アプリケーション・ノート | High-Speed Layout Guidelines for Reducing EMI for LVDS SerDes Designs | 2018年 11月 9日 | ||||
| アプリケーション・ノート | Receiver Skew Margin for Channel Link I and FPD Link I Devices | 2016年 1月 13日 | ||||
| アプリケーション・ノート | AN-1538 Interfacing Nationals DS90CR218A and LM98714 (Rev. C) | 2013年 4月 26日 | ||||
| 設計ガイド | Channel Link I Design Guide | 2007年 3月 29日 | ||||
| アプリケーション・ノート | Multi-Drop Channel-Link Operation | 2004年 10月 4日 | ||||
| アプリケーション・ノート | CHANNEL LINK Moving and Shaping Information In Point-To-Point Applications | 1998年 10月 5日 |
設計と開発
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TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)
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TINA は DesignSoft (...)
| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| TSSOP (DGG) | 48 | オプションの表示 |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点