LMK04828
- JEDEC JESD204B Support
- Ultra-Low RMS Jitter
- 88 fs RMS Jitter (12 kHz to 20 MHz)
- 91 fs RMS Jitter (100 Hz to 20 MHz)
- –162.5 dBc/Hz Noise Floor at 245.76 MHz
- Up to 14 Differential Device Clocks from PLL2
- Up to 7 SYSREF Clocks
- Maximum Clock Output Frequency 3.1 GHz
- LVPECL, LVDS, HSDS, LCPECL Programmable Outputs from PLL2
- Up to 1 Buffered VCXO/Crystal Output from PLL1
- LVPECL, LVDS, 2xLVCMOS Programmable
- Dual Loop PLLatinum™ PLL Architecture
- PLL1
- Up to 3 Redundant Input Clocks
- Automatic and Manual Switch-Over Modes
- Hitless Switching and LOS
- Integrated Low-Noise Crystal Oscillator Circuit
- Holdover Mode When Input Clocks are Lost
- Up to 3 Redundant Input Clocks
- PLL2
- Normalized [1 Hz] PLL Noise Floor of
–227 dBc/Hz - Phase Detector Rate up to 155 MHz
- OSCin Frequency-Doubler
- Two Integrated Low-Noise VCOs
- Normalized [1 Hz] PLL Noise Floor of
- 50% Duty Cycle Output Divides, 1 to 32
(even and odd) - Precision Digital Delay, Dynamically Adjustable
- 25-ps Step Analog Delay
- Multi-Mode: Dual PLL, Single PLL, and Clock Distribution
- Industrial Temperature Range: –40 to 85°C
- Supports 105°C PCB Temperature (Measured at Thermal Pad)
- 3.15-V to 3.45-V Operation
- Package: 64-Pin QFN (9.0 mm × 9.0 mm × 0.8 mm)
The LMK0482x family is the industry’s highest performance clock conditioner with JEDEC JESD204B support.
The 14 clock outputs from PLL2 can be configured to drive seven JESD204B converters or other logic devices, using device and SYSREF clocks. SYSREF can be provided using both DC and AC coupling. Not limited to JESD204B applications, each of the 14 outputs can be individually configured as high-performance outputs for traditional clocking systems.
The high performance, combined with features such as the ability to trade off between power or performance, dual VCOs, dynamic digital delay, holdover, and glitchless analog delay, make the LMK0482x family ideal for providing flexible high-performance clocking trees.
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技術資料
設計および開発
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評価のステップ：
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The (...)
TSW54J60EVM — TSW54J60 評価モジュール
The TSW54J60EVM is an evaluation module (EVM) that allows for the evaluation of Texas Instruments’ ADS54J60, LMH3401, LMH6401 and LMK04828 devices. The ADS54J60 is a low power, 16-bit, 1-GSPS analog to digital converter (ADC) with a buffered analog input and outputs featuring a JESD204B (...)
DEV-ADC34J22 — DEV-ADC34J22 評価モジュール
DEV-ADC34J22 は、Altera の HSMC 規格との統合向けの設計を採用した、4 チャネル、50MSPS の ADC モジュールです。DEV-ADC34J22 は、JESD204B に準拠する TI の新製品 ADC34J22 A/D コンバータ (ADC) を採用したほか、TI の LMK04828 ジッタ・クリーナを使用してクロックのコンディショニングも実施しています。TI の THS4541 850MHz BW 完全差動アンプを経由し、4 チャネルのうち 2 チャネルでシングルエンド DC 結合入力を受け入れます。
このモジュールは、1 個の EXT トリガ、1 個の (...)
CLOCKDESIGNTOOL — クロック設計ツール - ループ・フィルタおよびデバイス構成＋シミュレーション
PLLATINUMSIM-SW — PLLatinum™ シミュレーション・ツール
TICSPRO-SW — TICS (テキサス・インスツルメンツのクロックとシンセサイザ) Pro ソフトウェア
PSPICE-FOR-TI TI Design / シミュレーション・ツール向け PSpice®
設計とシミュレーション向けの環境である PSpice for TI (...)
CLOCK-TREE-ARCHITECT Clock tree architect プログラミング・ソフトウェア
TI のリファレンス・デザイン・セレクション・ツールを使用すると、開発中のアプリケーションやパラメータとの適合度が最も高いデザインの確認と特定を進めることができます。
| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| WQFN (NKD) | 64 | オプションの表示 |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL rating / リフローピーク温度
- MTBF/FIT 推定値
- 原材料組成
- 認定試験結果
- 継続的な信頼性モニタ試験結果
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。