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AFE5932-DESIGN — AFE5932 design resources
The full data sheet and other design resources for this device are available here
AFE5932
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- AFE5932 supports:
- 32-channels attenuator, PGA+LPF, 12-bit ADC, digital features with a decimation block
- Input Attenuator (ATTEN) with DTGC
- 24dB to 0dB attenuation range with 0.125dB step. Using in-built DTGC engine attenuation can be changed in real time.
- Post-gain Amplifier (PGA) and low-pass filter LPF
- Programmable gain of 12, 15 & 18 dB
- Maximum output swing support 1.6 Vpp
- LPF supported corners: First order filter with corner 10, 15 & 20 MHz
- Analog to digital convertor
- Maximum input swing support: 1.6 Vpp
- Resolution: 12bit
- Maximum ADC clock frequency (fADC_CLK): 50MHz
- Full scale SNR: 62 dBFS
- Decimation: Optional decimation block after ADC to decimate data by 2 or 4.
- Compression block to combine data in fewer LVDS lanes as per the decimation factor
- Total Power: 17 mW/ch at ADC Clock of 50MHz
- Low speed CMOS serial programming interface to program front end and ADC upto 40MHz speed
- Supply: 1.8V and 1.15V
- Small package: FC-BGA-100 (10mm × 10mm) with 0.8mm pitch
The AFE5932 is a highly integrated, low power receiver device designed for portable ultrasound imaging systems. The device boasts a total of 32 receiver channels, each featuring an attenuator, PGA and low-pass filter, and ADC.
技術文件
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檢視所有 1 | 重要文件 | 類型 | 標題 | 格式選項 | 日期 |
|---|---|---|---|---|
| * | Data sheet | AFE5932, 32-Channel Ultrasound AFE With 17-mW/Channel Power, 2-nV/√Hz Noise, 12-Bit, 50-MSPS Output datasheet | PDF | HTML | 2026年 3月 13日 |
設計與開發
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開發板
AFE5932EVM — AFE5932 評估模組
AFE5932EVM 用於評估在不同裝置模式下的 AFE5932 裝置。EVM 採用 2:1 多工器配置，整合兩個 AFE5932 裝置和兩個 TX73L64 裝置，以實現 128 通道發射和 64 通道接收。
模擬工具
PSPICE-FOR-TI — PSpice® for TI 設計與模擬工具
PSpice® for TI 是有助於評估類比電路功能的設計和模擬環境。這款全功能設計和模擬套件使用 Cadence® 的類比分析引擎。PSpice for TI 包括業界最大的模型庫之一，涵蓋我們的類比和電源產品組合，以及特定類比行為模型，且使用無需支付費用。
PSpice for TI 設計和模擬環境可讓您使用其內建函式庫來模擬複雜的混合訊號設計。在進行佈局和製造之前，建立完整的終端設備設計和解決方案原型，進而縮短上市時間並降低開發成本。
在 PSpice for TI 設計與模擬工具中，您可以搜尋 TI (...)
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