JAJSXD2 October   2025 F28377D-SEP

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
    1. 3.1 機能ブロック図
  5. 4 デバイスの比較
    1. 4.1 関連製品
  6. 5 ピン構成および機能
    1. 5.1 ピン配置図
    2. 5.2 信号の説明
      1. 5.2.1 信号の説明
    3. 5.3 内部プルアップおよびプルダウン付きのピン
    4. 5.4 ピン多重化
      1. 5.4.1 GPIO 多重化ピン
      2. 5.4.2 入力クロスバー
      3. 5.4.3 出力クロスバーおよび ePWM クロスバー
      4. 5.4.4 USB ピン多重化
      5. 5.4.5 高速 SPI ピン多重化
    5. 5.5 未使用ピンの接続
  7. 6 仕様
    1. 6.1  絶対最大定格
    2. 6.2  ESD 定格
    3. 6.3  推奨動作条件
    4. 6.4  消費電力の概略
      1. 6.4.1 200MHz SYSCLK でのデバイス消費電流
      2. 6.4.2 消費電流のグラフ
      3. 6.4.3 消費電流の低減
    5. 6.5  電気的特性
    6. 6.6  熱抵抗特性
      1. 6.6.1 PTP パッケージ
    7. 6.7  熱設計の検討事項
    8. 6.8  システム
      1. 6.8.1  電源シーケンス
        1. 6.8.1.1 信号ピンの要件
        2. 6.8.1.2 VDDIO、VDDA、VDD3VFL、VDDOSC の要件
        3. 6.8.1.3 VDD 要件
        4. 6.8.1.4 電源ランプ・レート
          1. 6.8.1.4.1 電源ランプ・レート
        5. 6.8.1.5 電源監視
      2. 6.8.2  リセット・タイミング
        1. 6.8.2.1 リセット ソース
        2. 6.8.2.2 リセットの電気的データおよびタイミング
          1. 6.8.2.2.1 リセット (XRS) のタイミング要件
          2. 6.8.2.2.2 リセット (XRS) のスイッチング特性
      3. 6.8.3  クロック仕様
        1. 6.8.3.1 クロック・ソース
        2. 6.8.3.2 クロック周波数、要件、および特性
          1. 6.8.3.2.1 入力クロック周波数およびタイミング要件、PLL ロック時間
            1. 6.8.3.2.1.1 入力クロック周波数
            2. 6.8.3.2.1.2 外部クロック・ソース (水晶振動子ではない) 使用時の X1 入力レベルの特性
            3. 6.8.3.2.1.3 XTAL 発振器の特性
            4. 6.8.3.2.1.4 X1 のタイミング要件 –
            5. 6.8.3.2.1.5 AUXCLKIN のタイミング要件
            6. 6.8.3.2.1.6 PLL ロック時間
          2. 6.8.3.2.2 内部クロック周波数
            1. 6.8.3.2.2.1 内部クロック周波数
          3. 6.8.3.2.3 出力クロックの周波数およびスイッチング特性
            1. 6.8.3.2.3.1 出力クロックの周波数
            2. 6.8.3.2.3.2 XCLKOUT のスイッチング特性 (PLL バイパスまたはイネーブル)
        3. 6.8.3.3 入力クロックおよび PLL
        4. 6.8.3.4 XTAL 発振器
          1. 6.8.3.4.1 はじめに
          2. 6.8.3.4.2 概要
            1. 6.8.3.4.2.1 電気発振回路
              1. 6.8.3.4.2.1.1 動作モード
                1. 6.8.3.4.2.1.1.1 水晶動作モード
                2. 6.8.3.4.2.1.1.2 シングルエンド動作モード
              2. 6.8.3.4.2.1.2 XCLKOUT での XTAL 出力
            2. 6.8.3.4.2.2 水晶振動子
          3. 6.8.3.4.3 機能動作
            1. 6.8.3.4.3.1 ESR – 等価直列抵抗
            2. 6.8.3.4.3.2 Rneg – 負性抵抗
            3. 6.8.3.4.3.3 起動時間
            4. 6.8.3.4.3.4 DL – 励振レベル
          4. 6.8.3.4.4 水晶振動子の選択方法
          5. 6.8.3.4.5 テスト
          6. 6.8.3.4.6 一般的な問題とデバッグのヒント
          7. 6.8.3.4.7 水晶発振回路の仕様
            1. 6.8.3.4.7.1 水晶発振器の電気的特性
            2. 6.8.3.4.7.2 水晶振動子の等価直列抵抗 (ESR) 要件
        5. 6.8.3.5 内部発振器
          1. 6.8.3.5.1 内部発振器の電気的特性
      4. 6.8.4  フラッシュ パラメータ
        1. 6.8.4.1 フラッシュ パラメータ
      5. 6.8.5  RAM の仕様
      6. 6.8.6  ROM の仕様
      7. 6.8.7  エミュレーション / JTAG
        1. 6.8.7.1 JTAG の電気的データおよびタイミング
          1. 6.8.7.1.1 JTAG のタイミング要件
          2. 6.8.7.1.2 JTAG のスイッチング特性
      8. 6.8.8  GPIO の電気的データおよびタイミング
        1. 6.8.8.1 GPIO - 出力タイミング
          1. 6.8.8.1.1 汎用出力のスイッチング特性
        2. 6.8.8.2 GPIO - 入力タイミング
          1. 6.8.8.2.1 汎用入力のタイミング要件
        3. 6.8.8.3 入力信号のサンプリング・ウィンドウ幅
      9. 6.8.9  割り込み
        1. 6.8.9.1 外部割り込み (XINT) の電気的データおよびタイミング
          1. 6.8.9.1.1 外部割り込みのタイミング要件
          2. 6.8.9.1.2 外部割り込みのスイッチング特性
      10. 6.8.10 低消費電力モード
        1. 6.8.10.1 クロック ゲーティング低消費電力モード
        2. 6.8.10.2 電源をゲーティングする低消費電力モード
        3. 6.8.10.3 低消費電力モードのウェークアップ・タイミング
          1. 6.8.10.3.1 アイドル・モードのタイミング要件
          2. 6.8.10.3.2 アイドル モードのスイッチング特性
          3. 6.8.10.3.3 スタンバイ・モードのタイミング要件
          4. 6.8.10.3.4 スタンバイ モードのスイッチング特性
          5. 6.8.10.3.5 ホールト モードのタイミング要件
          6. 6.8.10.3.6 ホールト モードのスイッチング特性
          7. 6.8.10.3.7 ハイバネーション・モードのタイミング要件
          8. 6.8.10.3.8 ハイバネーション モードのスイッチング特性
      11. 6.8.11 外部メモリ・インターフェイス (EMIF)
        1. 6.8.11.1 非同期メモリのサポート
        2. 6.8.11.2 同期 DRAM のサポート
        3. 6.8.11.3 EMIF の電気的データおよびタイミング
          1. 6.8.11.3.1 非同期 RAM
            1. 6.8.11.3.1.1 EMIF 非同期メモリのタイミング要件
            2. 6.8.11.3.1.2 EMIF 非同期メモリのスイッチング特性
          2. 6.8.11.3.2 同期 RAM
            1. 6.8.11.3.2.1 EMIF 同期メモリのタイミング要件
            2. 6.8.11.3.2.2 EMIF 同期メモリのスイッチング特性
    9. 6.9  アナログ ペリフェラル
      1. 6.9.1 A/D コンバータ (ADC)
        1. 6.9.1.1 ADC の構成可能性
          1. 6.9.1.1.1 信号モード
        2. 6.9.1.2 ADC の電気的データおよびタイミング
          1. 6.9.1.2.1 ADC の動作条件 (16 ビット差動モード)
          2. 6.9.1.2.2 ADC の特性 (16 ビット差動モード)
          3. 6.9.1.2.3 ADC の動作条件 (12ビット シングルエンド モード)
          4. 6.9.1.2.4 ADC の特性 (12 ビット シングルエンド モード)
          5. 6.9.1.2.5 ADCEXTSOC のタイミング要件
          6. 6.9.1.2.6 ADC 入力モデル
            1. 6.9.1.2.6.1 差動入力モデル パラメータ
            2. 6.9.1.2.6.2 シングルエンド入力モデルのパラメータ
          7. 6.9.1.2.7 ADC のタイミング図
            1. 6.9.1.2.7.1 12 ビット モードでの ADC タイミング (SYSCLK サイクル)
            2. 6.9.1.2.7.2 16 ビット モードでの ADC タイミング
        3. 6.9.1.3 温度センサの電気的データおよびタイミング
          1. 6.9.1.3.1 温度センサの電気的特性
      2. 6.9.2 コンパレータ・サブシステム (CMPSS)
        1. 6.9.2.1 CMPSS の電気的データおよびタイミング
          1. 6.9.2.1.1 コンパレータ電気的特性
          2. 6.9.2.1.2 CMPSS DAC の静的電気特性
      3. 6.9.3 バッファ付き D/A コンバータ (DAC)
        1. 6.9.3.1 バッファ付き DAC の電気的データおよびタイミング
          1. 6.9.3.1.1 バッファ付き DAC の電気的特性
        2. 6.9.3.2 CMPSS DAC の動的誤差
    10. 6.10 制御ペリフェラル
      1. 6.10.1 拡張キャプチャ (eCAP)
        1. 6.10.1.1 eCAP の電気的データおよびタイミング
          1. 6.10.1.1.1 eCAP のタイミング要件
          2. 6.10.1.1.2 eCAP のスイッチング特性
      2. 6.10.2 拡張パルス幅変調器 (ePWM)
        1. 6.10.2.1 制御ペリフェラルの同期
        2. 6.10.2.2 ePWM の電気的データおよびタイミング
          1. 6.10.2.2.1 ePWM のタイミング要件
          2. 6.10.2.2.2 ePWM のスイッチング特性
          3. 6.10.2.2.3 トリップ・ゾーン入力のタイミング
            1. 6.10.2.2.3.1 トリップ・ゾーン入力のタイミング要件
        3. 6.10.2.3 外部 ADC 変換開始の電気的データおよびタイミング
          1. 6.10.2.3.1 外部 ADC 変換開始のスイッチング特性
      3. 6.10.3 拡張直交エンコーダ・パルス (eQEP)
        1. 6.10.3.1 eQEP の電気的データおよびタイミング
          1. 6.10.3.1.1 eQEP のタイミング要件
          2. 6.10.3.1.2 eQEP のスイッチング特性
      4. 6.10.4 高分解能パルス幅変調器 (HRPWM)
        1. 6.10.4.1 GPIO の電気的データおよびタイミング
          1. 6.10.4.1.1 高分解能 PWM のタイミング要件
          2. 6.10.4.1.2 高分解能 PWM の特性
      5. 6.10.5 シグマ-デルタ・フィルタ・モジュール (SDFM)
        1. 6.10.5.1 SDFM の電気的データおよびタイミング (ASYNC を使用)
          1. 6.10.5.1.1 非同期 GPIO (ASYNC) オプション使用時の SDFM のタイミング要件
        2. 6.10.5.2 SDFM の電気的データおよびタイミング (3 サンプル GPIO 入力フィルタを使用)
          1. 6.10.5.2.1 GPIO 入力 フィルタ (3 サンプル ウィンドウ) オプションを使用した場合の SDFM タイミング要件
    11. 6.11 通信ペリフェラル
      1. 6.11.1 CAN (Controller Area Network)
      2. 6.11.2 I2C (Inter-Integrated Circuit)
        1. 6.11.2.1 I2C の電気的データおよびタイミング
          1. 6.11.2.1.1 I2C のタイミング要件
          2. 6.11.2.1.2 I2C のスイッチング特性
          3. 6.11.2.1.3 I2C タイミング図
      3. 6.11.3 マルチチャネル バッファ付きシリアル ポート (McBSP)
        1. 6.11.3.1 McBSP の電気的データおよびタイミング
          1. 6.11.3.1.1 McBSP の送信および受信タイミング
            1. 6.11.3.1.1.1 McBSP のタイミング要件
            2. 6.11.3.1.1.2 McBSP のスイッチング特性
          2. 6.11.3.1.2 SPI マスタまたはスレーブとしての McBSP タイミング
            1. 6.11.3.1.2.1 SPI マスタとしての McBSP タイミング要件
            2. 6.11.3.1.2.2 SPI マスタとしての McBSP スイッチング特性
            3. 6.11.3.1.2.3 SPI スレーブとしての McBSP タイミング要件
            4. 6.11.3.1.2.4 SPI スレーブとしての McBSP スイッチング特性
      4. 6.11.4 シリアル通信インターフェイス (SCI)
      5. 6.11.5 シリアル・ペリフェラル・インターフェイス (SPI)
        1. 6.11.5.1 SPI の電気的データおよびタイミング
          1. 6.11.5.1.1 SPI マスタ・モードのタイミング
            1. 6.11.5.1.1.1 SPI マスタ・モードのタイミング要件
            2. 6.11.5.1.1.2 SPI マスタ モードのスイッチング特性 (クロック位相=0)
            3. 6.11.5.1.1.3 SPI マスタ モードのスイッチング特性 (クロック位相=1)
          2. 6.11.5.1.2 SPI スレーブ・モードのタイミング
            1. 6.11.5.1.2.1 SPI スレーブ・モードのタイミング要件
            2. 6.11.5.1.2.2 SPI スレーブ・モードのスイッチング特性
      6. 6.11.6 ユニバーサル・シリアル・バス (USB) コントローラ
        1. 6.11.6.1 USB の電気的データおよびタイミング
          1. 6.11.6.1.1 USB入力ポート DP および DM のタイミング要件
          2. 6.11.6.1.2 USB出力ポート DP および DM スイッチング特性
      7. 6.11.7 ユニバーサル・パラレル・ポート (uPP) インターフェイス
        1. 6.11.7.1 uPP の電気的データおよびタイミング
          1. 6.11.7.1.1 uPP のタイミング要件
          2. 6.11.7.1.2 uPP のスイッチング特性
  8. 7 詳細説明
    1. 7.1  概要
    2. 7.2  機能ブロック図
    3. 7.3  メモリ
      1. 7.3.1 C28x メモリ マップ
      2. 7.3.2 フラッシュ メモリ マップ
      3. 7.3.3 EMIF チップ セレクト メモリ マップ
      4. 7.3.4 ペリフェラル・レジスタのメモリ・マップ
      5. 7.3.5 メモリ タイプ
        1. 7.3.5.1 専用RAM (Mx および Dx RAM)
        2. 7.3.5.2 ローカル共有 RAM (LSx RAM)
        3. 7.3.5.3 グローバル共有 RAM (GSx RAM)
        4. 7.3.5.4 CPU メッセージ RAM (CPU MSGRAM)
        5. 7.3.5.5 CLA メッセージ RAM (CLA MSGRAM)
    4. 7.4  識別
    5. 7.5  バス アーキテクチャ – ペリフェラル コネクティビティ
    6. 7.6  C28x プロセッサ
      1. 7.6.1 浮動小数点ユニット
      2. 7.6.2 三角関数演算ユニット (TMU)
      3. 7.6.3 ビタビ、複素演算、CRC ユニット II (VCU-II)
    7. 7.7  制御補償器アクセラレータ (CLA)
    8. 7.8  ダイレクト メモリ アクセス
    9. 7.9  プロセッサ間通信モジュール
    10. 7.10 ブート ROM およびペリフェラル ブート
      1. 7.10.1 EMU ブートまたはエミュレーション・ブート
      2. 7.10.2 ウェイト・ブート・モード
      3. 7.10.3 ゲット モード
      4. 7.10.4 ブートローダが使用するペリフェラル ピン
    11. 7.11 デュアル・コード・セキュリティ・モジュール
    12. 7.12 タイマ
    13. 7.13 ウォッチドッグ タイマ付きノンマスカブル割り込み (NMIWD)
    14. 7.14 ウォッチドッグ
  9. 8 アプリケーション、実装、およびレイアウト
    1. 8.1 アプリケーションと実装
    2. 8.2 デバイスの主な特長
    3. 8.3 アプリケーション情報
      1. 8.3.1 代表的なアプリケーション
        1. 8.3.1.1 ソーラー・マイクロ・インバータ
          1. 8.3.1.1.1 システム・ブロック図
          2. 8.3.1.1.2 ソーラー マイクロ インバータのリソース
        2. 8.3.1.2 オンボード充電器 (OBC)
          1. 8.3.1.2.1 システム ブロック図
          2. 8.3.1.2.2 OBC のリソース
        3. 8.3.1.3 EV 充電ステーション向けパワー・モジュール
          1. 8.3.1.3.1 システム ブロック図
          2. 8.3.1.3.2 EV 充電ステーション向けパワー モジュール資料
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 デバイスおよび開発ツールの命名規則
    2. 9.2 マーキング
    3. 9.3 ツールとソフトウェア
    4. 9.4 ドキュメントのサポート
    5. 9.5 サポート・リソース
    6. 9.6 商標
    7. 9.7 静電気放電に関する注意事項
    8. 9.8 輸出管理に関する注意事項
    9. 9.9 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報
    1. 11.1 パッケージ情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PTP|176
サーマルパッド・メカニカル・データ
発注情報

5.4.1 GPIO 多重化ピン

表 5-3 に、GPIO 多重化ピンを示します。各ピンのデフォルトは、GPIO 機能です。GPyGMUXn.GPIOz および GPyMUXn.GPIOz の両方のレジスタ ビットを設定することにより、2 次機能を選択できます。多重化選択の切り替わりによる GPIO の過渡パルスを回避するために、GPyMUXn よりも先に GPyGMUXn レジスタを構成する必要があります。表示されていない列および空白のセルは、予約済みの GPIO 多重化設定です。

表 5-3 GPIO 多重化ピン
GPIO 多重化の選択(1)(2)
GPIO インデックス 0、4、8、12 1 2 3 5 6 7 15
GPyGMUXn。
GPIOz =		 00b、01b、10b、11b 00b 01b 11b
GPyMUXn。
GPIOz =		 00b 01b 10b 11b 01b 10b 11b 11b
GPIO0 EPWM1A (O) SDAA (I/OD)
GPIO1 EPWM1B (O) MFSRB (I/O) SCLA (I/OD)
GPIO2 EPWM2A (O) OUTPUTXBAR1 (O) SDAB (I/OD)
GPIO3 EPWM2B (O) OUTPUTXBAR2 (O) MCLKRB (I/O) OUTPUTXBAR2 (O) SCLB (I/OD)
GPIO4 EPWM3A (O) OUTPUTXBAR3 (O) CANTXA (O)
GPIO5 EPWM3B (O) MFSRA (I/O) OUTPUTXBAR3 (O) CANRXA (I)
GPIO6 EPWM4A (O) OUTPUTXBAR4 (O) EXTSYNCOUT (O) EQEP3A (I) CANTXB (O)
GPIO7 EPWM4B (O) MCLKRA (I/O) OUTPUTXBAR5 (O) EQEP3B (I) CANRXB (I)
GPIO8 EPWM5A (O) CANTXB (O) ADCSOCAO (O) EQEP3S (I/O) SCITXDA (O)
GPIO9 EPWM5B (O) SCITXDB (O) OUTPUTXBAR6 (O) EQEP3I (I/O) SCIRXDA (I)
GPIO10 EPWM6A (O) CANRXB (I) ADCSOCBO (O) EQEP1A (I) SCITXDB (O) UPP-WAIT (I/O)
GPIO11 EPWM6B (O) SCIRXDB (I) OUTPUTXBAR7 (O) EQEP1B (I) SCIRXDB (I) UPP-START (I/O)
GPIO12 EPWM7A (O) CANTXB (O) MDXB (O) EQEP1S (I/O) SCITXDC (O) UPP-ENA (I/O)
GPIO13 EPWM7B (O) CANRXB (I) MDRB (I) EQEP1I (I/O) SCIRXDC (I) UPP-D7 (I/O)
GPIO14 EPWM8A (O) SCITXDB (O) MCLKXB (I/O) OUTPUTXBAR3 (O) UPP-D6 (I/O)
GPIO15 EPWM8B (O) SCIRXDB (I) MFSXB (I/O) OUTPUTXBAR4 (O) UPP-D5 (I/O)
GPIO16 SPISIMOA (I/O) CANTXB (O) OUTPUTXBAR7 (O) EPWM9A (O) SD1_D1 (I) UPP-D4 (I/O)
GPIO17 SPISOMIA (I/O) CANRXB (I) OUTPUTXBAR8 (O) EPWM9B (O) SD1_C1 (I) UPP-D3 (I/O)
GPIO18 SPICLKA (I/O) SCITXDB (O) CANRXA (I) EPWM10A (O) SD1_D2 (I) UPP-D2 (I/O)
GPIO19 SPISTEA (I/O) SCIRXDB (I) CANTXA (O) EPWM10B (O) SD1_C2 (I) UPP-D1 (I/O)
GPIO20 EQEP1A (I) MDXA (O) CANTXB (O) EPWM11A (O) SD1_D3 (I) UPP-D0 (I/O)
GPIO21 EQEP1B (I) MDRA (I) CANRXB (I) EPWM11B (O) SD1_C3 (I) UPP-CLK (I/O)
GPIO22 EQEP1S (I/O) MCLKXA (I/O) SCITXDB (O) EPWM12A (O) SPICLKB (I/O) SD1_D4 (I)
GPIO23 EQEP1I (I/O) MFSXA (I/O) SCIRXDB (I) EPWM12B (O) SPISTEB (I/O) SD1_C4 (I)
GPIO24 OUTPUTXBAR1 (O) EQEP2A (I) MDXB (O) SPISIMOB (I/O) SD2_D1 (I)
GPIO25 OUTPUTXBAR2 (O) EQEP2B (I) MDRB (I) SPISOMIB (I/O) SD2_C1 (I)
GPIO26 OUTPUTXBAR3 (O) EQEP2I (I/O) MCLKXB (I/O) OUTPUTXBAR3 (O) SPICLKB (I/O) SD2_D2 (I)
GPIO27 OUTPUTXBAR4 (O) EQEP2S (I/O) MFSXB (I/O) OUTPUTXBAR4 (O) SPISTEB (I/O) SD2_C2 (I)
GPIO28 SCIRXDA (I) EM1CS4 (O) OUTPUTXBAR5 (O) EQEP3A (I) SD2_D3 (I)
GPIO29 SCITXDA (O) EM1SDCKE (O) OUTPUTXBAR6 (O) EQEP3B (I) SD2_C3 (I)
GPIO30 CANRXA (I) EM1CLK (O) OUTPUTXBAR7 (O) EQEP3S (I/O) SD2_D4 (I)
GPIO31 CANTXA (O) EM1WE (O) OUTPUTXBAR8 (O) EQEP3I (I/O) SD2_C4 (I)
GPIO32 SDAA (I/OD) EM1CS0 (O)
GPIO33 SCLA (I/OD) EM1RNW (O)
GPIO34 OUTPUTXBAR1 (O) EM1CS2 (O) SDAB (I/OD)
GPIO35 SCIRXDA (I) EM1CS3 (O) SCLB (I/OD)
GPIO36 SCITXDA (O) EM1WAIT (I) CANRXA (I)
GPIO37 OUTPUTXBAR2 (O) EM1OE (O) CANTXA (O)
GPIO38 EM1A0 (O) SCITXDC (O) CANTXB (O)
GPIO39 EM1A1 (O) SCIRXDC (I) CANRXB (I)
GPIO40 EM1A2 (O) SDAB (I/OD)
GPIO41 EM1A3 (O) SCLB (I/OD)
GPIO42 SDAA (I/OD) SCITXDA (O)
GPIO43 SCLA (I/OD) SCIRXDA (I)
GPIO44 EM1A4 (O)
GPIO45 EM1A5 (O)
GPIO46 EM1A6 (O) SCIRXDD (I)
GPIO47 EM1A7 (O) SCITXDD (O)
GPIO48 OUTPUTXBAR3 (O) EM1A8 (O) SCITXDA (O) SD1_D1 (I)
GPIO49 OUTPUTXBAR4 (O) EM1A9 (O) SCIRXDA (I) SD1_C1 (I)
GPIO50 EQEP1A (I) EM1A10 (O) SPISIMOC (I/O) SD1_D2 (I)
GPIO51 EQEP1B (I) EM1A11 (O) SPISOMIC (I/O) SD1_C2 (I)
GPIO52 EQEP1S (I/O) EM1A12 (O) SPICLKC (I/O) SD1_D3 (I)
GPIO53 EQEP1I (I/O) EM1D31 (I/O) EM2D15 (I/O) SPISTEC (I/O) SD1_C3 (I)
GPIO54 SPISIMOA (I/O) EM1D30 (I/O) EM2D14 (I/O) EQEP2A (I) SCITXDB (O) SD1_D4 (I)
GPIO55 SPISOMIA (I/O) EM1D29 (I/O) EM2D13 (I/O) EQEP2B (I) SCIRXDB (I) SD1_C4 (I)
GPIO56 SPICLKA (I/O) EM1D28 (I/O) EM2D12 (I/O) EQEP2S (I/O) SCITXDC (O) SD2_D1 (I)
GPIO57 SPISTEA (I/O) EM1D27 (I/O) EM2D11 (I/O) EQEP2I (I/O) SCIRXDC (I) SD2_C1 (I)
GPIO58 MCLKRA (I/O) EM1D26 (I/O) EM2D10 (I/O) OUTPUTXBAR1 (O) SPICLKB (I/O) SD2_D2 (I) SPISIMOA(3) (I/O)
GPIO59 MFSRA (I/O) EM1D25 (I/O) EM2D9 (I/O) OUTPUTXBAR2 (O) SPISTEB (I/O) SD2_C2 (I) SPISOMIA(3) (I/O)
GPIO60 MCLKRB (I/O) EM1D24 (I/O) EM2D8 (I/O) OUTPUTXBAR3 (O) SPISIMOB (I/O) SD2_D3 (I) SPICLKA(3) (I/O)
GPIO61 MFSRB (I/O) EM1D23 (I/O) EM2D7 (I/O) OUTPUTXBAR4 (O) SPISOMIB (I/O) SD2_C3 (I) SPISTEA(3) (I/O)
GPIO62 SCIRXDC (I) EM1D22 (I/O) EM2D6 (I/O) EQEP3A (I) CANRXA (I) SD2_D4 (I)
GPIO63 SCITXDC (O) EM1D21 (I/O) EM2D5 (I/O) EQEP3B (I) CANTXA (O) SD2_C4 (I) SPISIMOB(3) (I/O)
GPIO64 EM1D20 (I/O) EM2D4 (I/O) EQEP3S (I/O) SCIRXDA (I) SPISOMIB(3) (I/O)
GPIO65 EM1D19 (I/O) EM2D3 (I/O) EQEP3I (I/O) SCITXDA (O) SPICLKB(3) (I/O)
GPIO66 EM1D18 (I/O) EM2D2 (I/O) SDAB (I/OD) SPISTEB(3) (I/O)
GPIO67 EM1D17 (I/O) EM2D1 (I/O)
GPIO68 EM1D16 (I/O) EM2D0 (I/O)
GPIO69 EM1D15 (I/O) SCLB (I/OD) SPISIMOC(3) (I/O)
GPIO70 EM1D14 (I/O) CANRXA (I) SCITXDB (O) SPISOMIC(3) (I/O)
GPIO71 EM1D13 (I/O) CANTXA (O) SCIRXDB (I) SPICLKC(3) (I/O)
GPIO72 EM1D12 (I/O) CANTXB (O) SCITXDC (O) SPISTEC(3) (I/O)
GPIO73 EM1D11 (I/O) XCLKOUT (O) CANRXB (I) SCIRXDC (I)
GPIO74 EM1D10 (I/O)
GPIO75 EM1D9 (I/O)
GPIO76 EM1D8 (I/O) SCITXDD (O)
GPIO77 EM1D7 (I/O) SCIRXDD (I)
GPIO78 EM1D6 (I/O) EQEP2A (I)
GPIO79 EM1D5 (I/O) EQEP2B (I)
GPIO80 EM1D4 (I/O) EQEP2S (I/O)
GPIO81 EM1D3 (I/O) EQEP2I (I/O)
GPIO82 EM1D2 (I/O)
GPIO83 EM1D1 (I/O)
GPIO84 SCITXDA (O) MDXB (O) MDXA (O)
GPIO85 EM1D0 (I/O) SCIRXDA (I) MDRB (I) MDRA (I)
GPIO86 EM1A13 (O) EM1CAS (O) SCITXDB (O) MCLKXB (I/O) MCLKXA (I/O)
GPIO87 EM1A14 (O) EM1RAS (O) SCIRXDB (I) MFSXB (I/O) MFSXA (I/O)
GPIO88 EM1A15 (O) EM1DQM0 (O)
GPIO89 EM1A16 (O) EM1DQM1 (O) SCITXDC (O)
GPIO90 EM1A17 (O) EM1DQM2 (O) SCIRXDC (I)
GPIO91 EM1A18 (O) EM1DQM3 (O) SDAA (I/OD)
GPIO92 EM1A19 (O) EM1BA1 (O) SCLA (I/OD)
GPIO93 EM1BA0 (O) SCITXDD (O)
GPIO94 SCIRXDD (I)
GPIO95
GPIO96 EM2DQM1 (O) EQEP1A (I)
GPIO97 EM2DQM0 (O) EQEP1B (I)
GPIO98 EM2A0 (O) EQEP1S (I/O)
GPIO99 EM2A1 (O) EQEP1I (I/O)
GPIO100 EM2A2 (O) EQEP2A (I) SPISIMOC (I/O)
GPIO101 EM2A3 (O) EQEP2B (I) SPISOMIC (I/O)
GPIO102 EM2A4 (O) EQEP2S (I/O) SPICLKC (I/O)
GPIO103 EM2A5 (O) EQEP2I (I/O) SPISTEC (I/O)
GPIO104 SDAA (I/OD) EM2A6 (O) EQEP3A (I) SCITXDD (O)
GPIO105 SCLA (I/OD) EM2A7 (O) EQEP3B (I) SCIRXDD (I)
GPIO106 EM2A8 (O) EQEP3S (I/O) SCITXDC (O)
GPIO107 EM2A9 (O) EQEP3I (I/O) SCIRXDC (I)
GPIO108 EM2A10 (O)
GPIO109 EM2A11 (O)
GPIO110 EM2WAIT (I)
GPIO111 EM2BA0 (O)
GPIO112 EM2BA1 (O)
GPIO113 EM2CAS (O)
GPIO114 EM2RAS (O)
GPIO115 EM2CS0 (O)
GPIO116 EM2CS2 (O)
GPIO117 EM2SDCKE (O)
GPIO118 EM2CLK (O)
GPIO119 EM2RNW (O)
GPIO120 EM2WE (O) USB0PFLT
GPIO121 EM2OE (O) USB0EPEN
GPIO122 SPISIMOC (I/O) SD1_D1 (I)
GPIO123 SPISOMIC (I/O) SD1_C1 (I)
GPIO124 SPICLKC (I/O) SD1_D2 (I)
GPIO125 SPISTEC (I/O) SD1_C2 (I)
GPIO126 SD1_D3 (I)
GPIO127 SD1_C3 (I)
GPIO128 SD1_D4 (I)
GPIO129 SD1_C4 (I)
GPIO130 SD2_D1 (I)
GPIO131 SD2_C1 (I)
GPIO132 SD2_D2 (I)
GPIO133/
AUXCLKIN		 SD2_C2 (I)
GPIO134 SD2_D3 (I)
GPIO135 SCITXDA (O) SD2_C3 (I)
GPIO136 SCIRXDA (I) SD2_D4 (I)
GPIO137 SCITXDB (O) SD2_C4 (I)
GPIO138 SCIRXDB (I)
GPIO139 SCIRXDC (I)
GPIO140 SCITXDC (O)
GPIO141 SCIRXDD (I)
GPIO142 SCITXDD (O)
GPIO143
GPIO144
GPIO145 EPWM1A (O)
GPIO146 EPWM1B (O)
GPIO147 EPWM2A (O)
GPIO148 EPWM2B (O)
GPIO149 EPWM3A (O)
GPIO150 EPWM3B (O)
GPIO151 EPWM4A (O)
GPIO152 EPWM4B (O)
GPIO153 EPWM5A (O)
GPIO154 EPWM5B (O)
GPIO155 EPWM6A (O)
GPIO156 EPWM6B (O)
GPIO157 EPWM7A (O)
GPIO158 EPWM7B (O)
GPIO159 EPWM8A (O)
GPIO160 EPWM8B (O)
GPIO161 EPWM9A (O)
GPIO162 EPWM9B (O)
GPIO163 EPWM10A (O)
GPIO164 EPWM10B (O)
GPIO165 EPWM11A (O)
GPIO166 EPWM11B (O)
GPIO167 EPWM12A (O)
GPIO168 EPWM12B (O)
(1) I = 入力、O = 出力、OD = オープン ドレイン
(2) GPIO インデックスの 9、10、11、13、14 の設定は、予約済みです。
(3) 高速 SPI 対応 GPIO 多重化オプション。このピン多重化オプションは、SPI を高速モードで使用する場合 (SPICCR の HS_MODE = 1) に必要です。この多重化オプションは、SPI を高速モードで使用しない場合 (SPICCR の HS_MODE = 0) でも使用できます。