JAJSW60A March   2025  – August 2025 DRV8263-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 デバイスの比較
  6. 5 ピン構成および機能
    1. 5.1 HW バリアント
    2. 5.2 SPI バリアント
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 電気的特性
    5. 6.5 タイミング要件
    6. 6.6 タイミング図
    7. 6.7 熱に関する情報
      1. 6.7.1 過渡熱インピーダンスと電流能力
    8. 6.8 スイッチング波形
      1. 6.8.1 出力スイッチング遷移
        1. 6.8.1.1 ハイサイド還流
      2. 6.8.2 ウェークアップ遷移
        1. 6.8.2.1 HW バリアント
        2. 6.8.2.2 SPI バリアント
      3. 6.8.3 フォルト応答の遷移
        1. 6.8.3.1 再試行設定
        2. 6.8.3.2 ラッチ設定
    9. 6.9 代表的特性
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 外付け部品
        1. 7.3.1.1 HW バリアント
        2. 7.3.1.2 SPI バリアント
      2. 7.3.2 ブリッジ制御
        1. 7.3.2.1 PH/EN モード
        2. 7.3.2.2 PWM モード
        3. 7.3.2.3 独立モード
        4. 7.3.2.4 レジスタ - ピン制御 - SPI バリアントのみ
      3. 7.3.3 デバイス設定
        1. 7.3.3.1 スルーレート (SR)
        2. 7.3.3.2 IPROPI
        3. 7.3.3.3 ITRIP レギュレーション
        4. 7.3.3.4 DIAG
          1. 7.3.3.4.1 HW バリアント
          2. 7.3.3.4.2 SPI バリアント
      4. 7.3.4 保護および診断機能
        1. 7.3.4.1  過電流保護 (OCP)
        2. 7.3.4.2  過熱警告 (OTW) - SPI バリアントのみ
        3. 7.3.4.3  過熱保護 (TSD)
        4. 7.3.4.4  オフ状態診断 (OLP)
        5. 7.3.4.5  オン状態診断 (OLA) - SPI バリアントのみ
        6. 7.3.4.6  VM 過電圧監視- SPI バリアントのみ
        7. 7.3.4.7  VM 低電圧監視
        8. 7.3.4.8  パワー オン リセット (POR)
        9. 7.3.4.9  パワー オフ ブレーキ（POB）
        10. 7.3.4.10 イベントの優先順位
      5. 7.3.5 デバイスの機能モード
        1. 7.3.5.1 SLEEP 状態
        2. 7.3.5.2 スタンバイ状態
        3. 7.3.5.3 スタンバイ状態へのウェークアップ
        4. 7.3.5.4 アクティブ状態
        5. 7.3.5.5 nSLEEP リセット パルス (HW バリアント、ラッチ設定のみ)
      6. 7.3.6 プログラミング - SPI バリアントのみ
        1. 7.3.6.1 シリアル・ペリフェラル・インターフェイス (SPI)
        2. 7.3.6.2 標準フレーム
        3. 7.3.6.3 複数ペリフェラルに対するSPI
          1. 7.3.6.3.1 複数のペリフェラルに対するデイジー チェーン フレーム
      7. 7.3.7 レジスタ マップ - SPI バリアントのみ
        1. 7.3.7.1 ユーザー レジスタ
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
      1. 8.1.1 負荷の概要
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 HW バリアント
      2. 8.2.2 SPI バリアント
    3. 8.3 電源に関する推奨事項
      1. 8.3.1 バルク容量の決定
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 デバイス サポート
    2. 9.2 ドキュメントのサポート
      1. 9.2.1 関連資料
    3. 9.3 ドキュメントの更新通知を受け取る方法
    4. 9.4 サポート・リソース
    5. 9.5 商標
    6. 9.6 静電気放電に関する注意事項
    7. 9.7 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報
7.3.3.4.1 HW バリアント

HW バリアントでは、DIAG ピンは 6 レベルの設定です。モードに応じて、その構成を以下の表にまとめます。

表 7-12 DIAG 表 (HW バリアント、PH/EN または PWM モード)
DIAG ピン オフ状態診断 nSLEEP ウェークアップ パルス POB フォルト応答
RLVL1 ディセーブル 必須ではない ディセーブル 再試行
RLVL2 ディセーブル 必須ではない

ディセーブル

 ラッチ
RLVL3 ディセーブル 必須ではない

イネーブル

 ラッチ
RLVL4 イネーブル 必須ではない

ディセーブル

 ラッチ
RLVL5 ディセーブル 必須 ディセーブル ラッチ
RLVL6 イネーブル 必須ではない イネーブル（スリープ モード時のみ） ラッチ
表 7-13 DIAG 表 (HW バリアント、独立モード）
DIAG ピン スタンバイ状態 アクティブ状態
オフ状態診断 nSLEEP ウェーク パルス 負荷の構成 フォルト応答 IPROPI / ITRIP
RLVL1ディセーブル

必須ではない

ローサイド負荷再試行使用可能
RLVL2イネーブル

必須

ローサイド負荷ラッチ使用可能
RLVL3イネーブル

必須

ハイサイド負荷ラッチディセーブル
RLVL4イネーブル必須ではないハイサイド負荷再試行ディセーブル
RLVL5ディセーブル

必須

ローサイド負荷ラッチ使用可能
RLVL6イネーブル必須ではないローサイド負荷再試行使用可能
(1) 組み合わせの詳細については、「オフ状態診断 (OLP)」セクションの表を参照してください
注: HW バリアントのみ - 独立モード：ハイサイド負荷の使用事例で、オフ状態診断をディセーブルにするオプションは、サポートされていません。この場合、オフ状態診断をディセーブルにする唯一の方法は、DRVOFF ピンを High に設定し、IN ピンを Low に設定することです。

HW バリアントでは、電源オンまたはスリープからのウェークアップ後のデバイス初期化時に、DIAG ピンがラッチされます。動作中の更新はブロックされます。