ENA 入力ピンと 1 次側のパワーグッド出力ピンは、5V または 3.3V ドメインの TTL と CMOS の両方のロジック レベルをサポートしています。アクティブ high イネーブル入力 (ENA) ピンを使用して、絶縁 DC/DC コンバータをオンにできます。3.3V または 5V のロジック レールを使用できます。ENA ピンの推奨最大電圧は 5.5V です。ENA ピンの電圧がイネーブル スレッショルド V_{ENA_R} を上回ると、パワー モジュールはスイッチングを開始し、ソフト スタート プロセスを実施して、2 次側に電力を供給します。ENA ピンの電圧がディセーブル スレッショルド V_{ENA_F} を下回ると 、UCC35131-Q1 がディセーブルされ、内部電力段はスイッチングを停止します。

ラッチオフ デバイスでは、ENA ピンを使用して、保護セーフ状態モードに移行した後でデバイスをリセットすることもできます。障害が検出された後、保護ロジックがラッチオフし、デバイスを安全状態に移行します。本デバイスをリセットするには、フォルト後に t_{EN_LO_DLY} の間待機し、次に V_{ENA_F} を下回る ENA ピンの電圧を t _{EN_LO_RST} より長い時間トグルしてから、3.3V または 5V に戻す必要があります。その後デバイスはラッチオフ モードを終了し、ソフトスタート シーケンスが再開されます。

ENA ピンを使用して、VIN ピンと ENA ピンの間に外付け分圧抵抗を使用することで、プログラム可能な入力 UVLO を実装することもできます。入力 UVLO が比較的小さく V_IN が比較的高いデバイスやアプリケーションでは、スタートアップ時の V_IN のランプが遅いと、トランスの巻線比が比較的低く、出力コンデンサを充電するのに十分な電力を生成できないため、スタートアップが失敗します。この問題は、VIN、ENA、および GNDP ピンの間に抵抗分圧器を追加して ENA 信号時間をプログラムし、内部入力 UVLO をオーバーライドすることで解決できます。V_{ENA_R} の立ち上がりスレッショルドは 1.5V に設定され、V_{ENA_F} の立ち下がりスレッショルドは 1.35V に設定されます。プログラマブル入力 UVLO 機能を使用すると、ENA ピンと GNDP ピンの間に遅延コンデンサを追加して、各パワーモジュール間の遅延時間をプログラムすることで、複数の内蔵 DC/DC モジュールをシーケンシャルに起動することもできます。具体的には、ENA1 信号を使って 1 つのモジュールまたは 1 つのグループ化されたモジュールを有効化でき、ENA1 からの遅延 ENA2 信号は、別のモジュールまたは別のグループ化されたモジュールを順に有効化できます。ENA1 と ENA2 が R_ENA2 配線に対して距離が近すぎるアプリケーションでは、ENA1 用の RC 回路を各モジュールの ENA ピンに複製して、シーケンシャルなスタートアップを実現できます。順次電源投入が必要ない場合は、複数のモジュールが同じ分圧抵抗を共有し、入力 UVLO スレッショルドをプログラムできます。実装を容易にするため、推奨される抵抗およびコンデンサの値は計算ツールで、このデータシート以外の設計をサポートする資料として利用できます。

分圧抵抗で 1 つのフォルト イベント (単一下側抵抗のオープン状態など) を考慮する必要がある場合、ENA ピンの絶対最大値 7V を超えるリスクをアプリケーション レベルで低減する必要があります。2 つの方法を適用できます。1 つの方法は、ENA ピンに外付けのツェナー ダイオードを追加することです。もう 1 つの方法は、下側の抵抗を 2 つの抵抗部品に分割することです。

パワーグッドは、モジュールに障害がなく、出力電圧が出力電圧レギュレーション設定ポイントの ±10% 以内であるときに、アクティブ状態を示すオープン ドレイン出力です。内部プルダウン MOSFET < 5mA の最大電流シンク能力を考慮するため、パワーグッド ピンから 5V または 3.3V のロジック レールへのプルアップ抵抗 (> 1kΩ) を推奨します。抵抗が大きいと、パワーグッド ピンの通常のロジック状態での静止電流が減少します。パワーグッド ピンの電圧は、推奨動作電圧を超えないように 5.5V 未満に維持することが重要です。

アクティブ Low のパワーグッド極性の場合、スタートアップ時に PG 信号には、隣接する VIN ピンと PG ピンとの間の寄生容量に起因する電圧降下があります。この容量性結合により、PG ピンにプルアップ電流が発生するため、プルアップ抵抗の両端で電圧降下が発生し、スタートアップ時に PG 信号に電圧降下が発生します。スタートアップ時の電圧降下を低減するため、4.99kΩ プルアップ抵抗と PG ピンとグランドを接続する 1μF のデカップリング コンデンサを推奨します。

アクティブ High のパワーグッド極性の場合、スタートアップ時は PG が接地されるため、10 プルアップ抵抗付き 0.1μF ～ 1μF 範囲の小さなデカップリング コンデンサを選択できます。アクティブ High 設定を使用すると、複数の DC/DC モジュールからの PG ピン信号を直接接続することで、グループの異常検出出力を簡単にできます。これは、いずれかの 1 つ (または複数) のモジュールのパワーバッド状態がプルダウン FET をオンにする場合でも、合成された PG 信号が Low のままになるためです。一方、パワーグッド状態中は、すべての DC/DC モジュールのプルダウン FET がオフの状態に維持されるため、合成された PG 信号は High のままになります。