CD74HCT74

Name: CD74HCT74
Brand: TI
SKU: CD74HCT74
Price: 0.174 USD

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Highspeed-CMOS-Logik Dual-D-Flipflops mit positiver Flankenauslösung und Set und Reset

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document-pdfAcrobat CD54HCT74, CD74HCT74 Dual D Flip-Flop with Set and Reset Positive-Edge Trigger datasheet (Englisch)

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Produktdetails

Number of channels

Technology family

HCT

Supply voltage (min) (V)

4.5

Supply voltage (max) (V)

5.5

Input type

TTL-Compatible CMOS

Output type

Push-Pull

Clock frequency (max) (MHz)

IOL (max) (mA)

IOH (max) (mA)

-4

Supply current (max) (µA)

Features

Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode

Operating temperature range (°C)

-55 to 125

Rating

Catalog

Number of channels

Technology family

HCT

Supply voltage (min) (V)

4.5

Supply voltage (max) (V)

5.5

Input type

TTL-Compatible CMOS

Output type

Push-Pull

Clock frequency (max) (MHz)

IOL (max) (mA)

IOH (max) (mA)

-4

Supply current (max) (µA)

Features

Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode

Operating temperature range (°C)

-55 to 125

Rating

Catalog

PDIP (N)

181.42 mm² 19.3 x 9.4

SOIC (D)

51.9 mm² 8.65 x 6

LSTTL input logic compatible
- V_IL(max) = 0.8 V, V_IH(min) = 2 V
CMOS input logic compatible
- I_I ≤ 1 µA at V_OL, V_OH
Buffered inputs
4.5 V to 5.5 V operation
Wide operating temperature range: -55°C to +125°C
Supports fanout up to 10 LSTTL loads
Significant power reduction compared to LSTTL logic ICs

LSTTL input logic compatible
- V_IL(max) = 0.8 V, V_IH(min) = 2 V
CMOS input logic compatible
- I_I ≤ 1 µA at V_OL, V_OH
Buffered inputs
4.5 V to 5.5 V operation
Wide operating temperature range: -55°C to +125°C
Supports fanout up to 10 LSTTL loads
Significant power reduction compared to LSTTL logic ICs

The CDx4HCT74-Q1 devices contain two independent D-type positive-edge-triggered flip-flops with asynchronous preset and clear pins for each.

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Technische Dokumentation

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	Typ	Titel		Datum
*	Data sheet	CD54HCT74, CD74HCT74 Dual D Flip-Flop with Set and Reset Positive-Edge Trigger datasheet		30 Aug 2019
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	Application note	CMOS Power Consumption and CPD Calculation (Rev. B)		01 Jun 1997
	Application note	Designing With Logic (Rev. C)		01 Jun 1997
	Application note	SN54/74HCT CMOS Logic Family Applications and Restrictions		01 Mai 1996
	Application note	Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc		01 Apr 1996

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML