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SN74AVC2T45

ACTIVO

Transceptor de bus de alimentación doble de 2 bits con conversión de tensión configurable y salid

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SN74AXC2T45 ACTIVO Transceptor de bus de alimentación doble de 2 bits con traducción de tensión configurable Pin-to-pin upgrade with a wider voltage range and improved performance

SN74AVC2T45

ACTIVO
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Detalles del producto

Bits (#) 2 Data rate (max) (Mbps) 500 Topology Push-Pull Direction control (typ) Direction-controlled Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 1.2 Vout (max) (V) 3.6 Applications I2S Features Overvoltage tolerant inputs, Partial power down (Ioff) Technology family AVC Supply current (max) (mA) 0.02 Rating Catalog Operating temperature range (°C) -40 to 125
Bits (#) 2 Data rate (max) (Mbps) 500 Topology Push-Pull Direction control (typ) Direction-controlled Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 1.2 Vout (max) (V) 3.6 Applications I2S Features Overvoltage tolerant inputs, Partial power down (Ioff) Technology family AVC Supply current (max) (mA) 0.02 Rating Catalog Operating temperature range (°C) -40 to 125
SOT-23-THN (DDF) 8 8.12 mm² (2.9 mm × 2.8 mm) DSBGA (YZP) 8 2.8125 mm² (— mm × — mm) SSOP (DCT) 8 11.8 mm² (2.95 mm × 4 mm) VSSOP (DCU) 8 6.2 mm² (2 mm × 3.1 mm)
  • Available in the Texas Instruments NanoFree™ Package
  • VCC Isolation Feature: If Either VCC Input Is at GND, Both Ports Are in the High-Impedance State
  • Dual Supply Rail Design
  • I/Os Are 4.6V Over Voltage Tolerant
  • Ioff Supports Partial-Power-Down Mode Operation
  • Max Data Rates
    • 500Mbps (1.8V to 3.3V)
    • 320Mbps (<1.8V to 3.3V )
    • 320Mbps (Level-Shifting to 2.5V or 1.8V)
    • 280Mbps (Level-Shifting to 1.5V)
    • 240Mbps (Level-Shifting to 1.2V)
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Protection Exceeds JESD 22
  • Available in the Texas Instruments NanoFree™ Package
  • VCC Isolation Feature: If Either VCC Input Is at GND, Both Ports Are in the High-Impedance State
  • Dual Supply Rail Design
  • I/Os Are 4.6V Over Voltage Tolerant
  • Ioff Supports Partial-Power-Down Mode Operation
  • Max Data Rates
    • 500Mbps (1.8V to 3.3V)
    • 320Mbps (<1.8V to 3.3V )
    • 320Mbps (Level-Shifting to 2.5V or 1.8V)
    • 280Mbps (Level-Shifting to 1.5V)
    • 240Mbps (Level-Shifting to 1.2V)
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Protection Exceeds JESD 22

This 2-bit non-inverting bus transceiver uses two separate configurable power-supply rails. The A ports are designed to track VCCA and accepts any supply voltage from 1.2V to 3.6V. The B ports are designed to track VCCB and accepts any supply voltage from 1.2V to 3.6V. This allows for universal low-voltage bidirectional translation and level-shifting between any of the 1.2V, 1.5V, 1.8V, 2.5V, and 3.3V voltage nodes.

The SN74AVC2T45 is designed for asynchronous communication between two data buses. The logic levels of the direction-control (DIR pin) input activate either the B-port outputs or the A-port outputs. The device transmits data from the A bus to the B bus when the B-port outputs are activated and from the B bus to the A bus when the A-port outputs are activated. The input circuitry on both A and B ports always is active and must have a logic HIGH or LOW level applied to prevent excess leakage current on the internal CMOS structure.

This 2-bit non-inverting bus transceiver uses two separate configurable power-supply rails. The A ports are designed to track VCCA and accepts any supply voltage from 1.2V to 3.6V. The B ports are designed to track VCCB and accepts any supply voltage from 1.2V to 3.6V. This allows for universal low-voltage bidirectional translation and level-shifting between any of the 1.2V, 1.5V, 1.8V, 2.5V, and 3.3V voltage nodes.

The SN74AVC2T45 is designed for asynchronous communication between two data buses. The logic levels of the direction-control (DIR pin) input activate either the B-port outputs or the A-port outputs. The device transmits data from the A bus to the B bus when the B-port outputs are activated and from the B bus to the A bus when the A-port outputs are activated. The input circuitry on both A and B ports always is active and must have a logic HIGH or LOW level applied to prevent excess leakage current on the internal CMOS structure.
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Documentación técnica

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* Hoja de datos SN74AVC2T45 Dual-Bit Dual-Supply Bus Transceiver datasheet (Rev. N) PDF | HTML 7/02/2025
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Diseño y desarrollo

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Placa de evaluación

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EVM flexible diseñado para admitir cualquier dispositivo que tenga un encapsulado DCK, DCT, DCU, DRL o DBV y entre 5 y 8 pines.
Guía del usuario: PDF
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??asset.out-of-stock-ti_es_MX??
No disponible
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5-8-NL-LOGIC-EVM — EVM genérico de lógica y traducción compatible con paquetes DPW, DQE, DRY, DSF, DTM, DTQ y DTT de 5

EVM genérico diseñado para admitir cualquier dispositivo lógico o de conversión que tenga un encapsulado DTT, DRY, DPW, DTM, DQE, DQM, DSF o DTQ. El diseño del tablero permite una evaluación flexible.

Guía del usuario: PDF | HTML
Productos y hardware compatibles
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??asset.out-of-stock-ti_es_MX??
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El módulo de evaluación genérico está diseñado para admitir dispositivos de conversión controlados por dirección de semiconductor de óxido metálico complementario de baja tensión y AVC de uno, dos, cuatro y ocho canales. También es compatible con la retención de bus y los dispositivos de automoción (...)

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En inventario
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??asset.out-of-stock-ti_es_MX??
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??asset.out-of-stock-ti_es_MX??
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lock = Requiere aprobación de exportación (1 minuto)
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SN74AVC2T45 IBIS Model (Rev. B)

SCEM431 (344 KB) - Modelo IBIS
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SOT-23-THN (DDF) 8 Ultra Librarian
DSBGA (YZP) 8 Ultra Librarian
SSOP (DCT) 8 Ultra Librarian
VSSOP (DCU) 8 Ultra Librarian
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