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TLV2365

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50MHz 단일 공급 레일 투 레일 연산 증폭기

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TLV2365

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제품 상세 정보

Architecture FET / CMOS Input, Voltage FB Number of channels 2 Total supply voltage (+5 V = 5, ±5 V = 10) (min) (V) 2.2 Total supply voltage (+5 V = 5, ±5 V = 10) (max) (V) 5.5 GBW (typ) (MHz) 50 BW at Acl (MHz) 80 Acl, min spec gain (V/V) 1 Slew rate (typ) (V/µs) 27 Vn at flatband (typ) (nV√Hz) 4.5 Vn at 1 kHz (typ) (nV√Hz) 4.5 Iq per channel (typ) (mA) 4.6 Vos (offset voltage at 25°C) (max) (mV) 1.9 Rail-to-rail In, Out Features Zero Crossover Rating Catalog Operating temperature range (°C) -40 to 125 CMRR (typ) (dB) 115 Input bias current (max) (pA) 20 Offset drift (typ) (µV/°C) 0.4 Iout (typ) (mA) 85
Architecture FET / CMOS Input, Voltage FB Number of channels 2 Total supply voltage (+5 V = 5, ±5 V = 10) (min) (V) 2.2 Total supply voltage (+5 V = 5, ±5 V = 10) (max) (V) 5.5 GBW (typ) (MHz) 50 BW at Acl (MHz) 80 Acl, min spec gain (V/V) 1 Slew rate (typ) (V/µs) 27 Vn at flatband (typ) (nV√Hz) 4.5 Vn at 1 kHz (typ) (nV√Hz) 4.5 Iq per channel (typ) (mA) 4.6 Vos (offset voltage at 25°C) (max) (mV) 1.9 Rail-to-rail In, Out Features Zero Crossover Rating Catalog Operating temperature range (°C) -40 to 125 CMRR (typ) (dB) 115 Input bias current (max) (pA) 20 Offset drift (typ) (µV/°C) 0.4 Iout (typ) (mA) 85
SOIC (D) 8 29.4 mm² 4.9 x 6 VSSOP (DGK) 8 14.7 mm² 3 x 4.9
  • Gain bandwidth: 50MHz
  • Zero-crossover distortion topology:
    • CMRR: 115dB (typical)
    • Rail-to-rail input and output
      • Input 100mV beyond supply rail
  • Noise: 4.5nV/√Hz
  • Slew rate: 27V/µs
  • Fast settling: 0.2µs to 0.01%
  • Precision:
    • Offset drift: 2µV/°C (maximum)
    • Input bias current: 20pA (maximum)
  • Operating voltage: 2.2V to 5.5V
  • Gain bandwidth: 50MHz
  • Zero-crossover distortion topology:
    • CMRR: 115dB (typical)
    • Rail-to-rail input and output
      • Input 100mV beyond supply rail
  • Noise: 4.5nV/√Hz
  • Slew rate: 27V/µs
  • Fast settling: 0.2µs to 0.01%
  • Precision:
    • Offset drift: 2µV/°C (maximum)
    • Input bias current: 20pA (maximum)
  • Operating voltage: 2.2V to 5.5V

The TLV365 and TLV2365 devices (TLVx365) are a family of zero-crossover, rail-to-rail input and output, CMOS operational amplifiers, optimized for low voltage and cost-sensitive applications. Low-noise (4.5nV/√Hz) and high-speed operation (50MHz gain bandwidth) make these devices an excellent choice for driving sampling analog-to-digital converters (ADCs) in applications such as low-side current sensing, audio, signal conditioning, and sensor amplification.

Special features include an excellent common-mode rejection ratio (CMRR), no input stage crossover distortion, high input impedance, and rail-to-rail input and output swing. The input common-mode range includes both the negative and positive supplies. The output voltage swings to within 10mV of the rails.

The TLVx365 are specified for operation from −40°C to +125°C.

The TLV365 and TLV2365 devices (TLVx365) are a family of zero-crossover, rail-to-rail input and output, CMOS operational amplifiers, optimized for low voltage and cost-sensitive applications. Low-noise (4.5nV/√Hz) and high-speed operation (50MHz gain bandwidth) make these devices an excellent choice for driving sampling analog-to-digital converters (ADCs) in applications such as low-side current sensing, audio, signal conditioning, and sensor amplification.

Special features include an excellent common-mode rejection ratio (CMRR), no input stage crossover distortion, high input impedance, and rail-to-rail input and output swing. The input common-mode range includes both the negative and positive supplies. The output voltage swings to within 10mV of the rails.

The TLVx365 are specified for operation from −40°C to +125°C.
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* Data sheet TLVx365 50MHz, Zero-Crossover, High-CMRR, RRIO Operational Amplifiers datasheet (Rev. C) PDF | HTML 2024/08/26

설계 및 개발

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평가 보드

DEM-OPA-SO-2A — SO-8 패키지용 듀얼 연산 증폭기 평가 모듈

The DEM-OPA-SO-2A demonstration evaluation module helps designers evaluate the operation and performance of TI dual-channel, high-speed, wideband operational amplifiers. This unpopulated printed-circuit board (PCB) is compatible with products offered in the 8-lead SOIC (D) package.

For more (...)

사용 설명서: PDF
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시뮬레이션 모델

TLV365 TINA-TI Reference Circuit (Rev. A)

SBOMCB9A.TSC (2510 KB) - TINA-TI Reference Design
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계산 툴

ANALOG-ENGINEER-CALC — 아날로그 엔지니어의 계산기

아날로그 엔지니어의 계산기는 아날로그 회로 설계 엔지니어가 정기적으로 사용하는 많은 반복 계산의 속도를 높이도록 설계되었습니다. 이 PC 기반 툴은 피드백 저항을 사용한 연산 증폭기 게인 설정부터 아날로그-디지털 컨버터(ADC) 드라이브 버퍼 회로 안정화를 위한 적절한 회로 설계 요소 선택에 이르기까지 다양한 일반적인 계산 목록이 포함된 그래픽 인터페이스를 제공합니다.

이 계산기는 독립 실행형 툴로 유용할 뿐만 아니라 아날로그 엔지니어의 포켓 레퍼런스에 설명된 개념과도 잘 어울립니다.

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계산 툴

VOLT-DIVIDER-CALC — Voltage divider calculation tool

The voltage divider calculation tool (VOLT-DIVIDER-CALC) quickly determines a set of resistors for a voltage divider. This KnowledgeBase JavaScript utility can be used to find a set of resistors for a voltage divider to achieve the desired output voltage. VOLT-DIVIDER-CALC can also be used to (...)
지금 설계하기
시뮬레이션 툴

PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®

TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.

TI 설계 및 시뮬레이션 환경용 PSpice는 기본 제공 라이브러리를 이용해 복잡한 혼합 신호 설계를 시뮬레이션할 수 있습니다. 레이아웃 및 제작에 착수하기 (...)
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시뮬레이션 툴

TINA-TI — SPICE 기반 아날로그 시뮬레이션 프로그램

TINA-TI provides all the conventional DC, transient and frequency domain analysis of SPICE and much more. TINA has extensive post-processing capability that allows you to format results the way you want them. Virtual instruments allow you to select input waveforms and probe circuit nodes voltages (...)
사용 설명서: PDF
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레퍼런스 디자인

PMP23537 — 3.6kW CCM-TCM 다중 모드 제어 토템 폴 브리지리스 PFC 레퍼런스 설계

이 레퍼런스 설계는 M-CRPS(모듈식 하드웨어 시스템 공통 이중 전원 공급 장치) 서버를 대상으로 하는 3.6kW 단상 토템 폴 브리지리스 PFC(역률 보정) 컨버터입니다. PFC는 인덕터 전류가 높은 AC 피크에서는 CCM(연속 전도 모드)으로 작동하고, 인덕터 전류가 낮은 AC 저영역에서는 ZVS(제로 전압 스위칭)을 갖춘 TCM(삼각 전도 모드)으로 작동하여 높은 효율과 높은 전력 밀도를 모두 달성합니다. 전력 단계 다음에는 베이비 부스트 컨버터가 있으며, 이를 이용해 벌크 커패시터의 크기를 줄일 수 있습니다. 또한 이 (...)
Test report: PDF
패키지 핀 CAD 기호, 풋프린트 및 3D 모델
SOIC (D) 8 Ultra Librarian
VSSOP (DGK) 8 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

포럼 주제 모두 보기(영문)

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