SN74GTL2006
- Operates as GTL-/GTL/GTL+ to LVTTL or LVTTL to GTL-/GTL/GTL+ Translator
- Series Termination on TTL Outputs of 30
- Latch-Up Testing to JEDEC Standard JESD 78 Exceeds 500 mA
- ESD Performance Tested Per JESD 22
- 2000-V Human-Body Model (A114-B, Class II)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)
All trademarks are the property of their respective owners.
The SN74GTL2006 is a 13-bit translator to interface between the 3.3-V LVTTL chipset I/O and the Xeon processor GTL-/GTL/GTL+ I/O. The device is designed for platform health management in dual-processor applications.
技術文件
找不到結果。請清除您的搜尋條件,然後再試一次。
檢視所有 12 類型 | 標題 | 日期 | ||
---|---|---|---|---|
* | Data sheet | SN74GTL2006 datasheet | 2004年 12月 17日 | |
Application note | Implications of Slow or Floating CMOS Inputs (Rev. E) | 2021年 7月 26日 | ||
Selection guide | Logic Guide (Rev. AB) | 2017年 6月 12日 | ||
Application note | Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) | 2015年 12月 2日 | ||
User guide | LOGIC Pocket Data Book (Rev. B) | 2007年 1月 16日 | ||
Application note | Semiconductor Packing Material Electrostatic Discharge (ESD) Protection | 2004年 7月 8日 | ||
Application note | TI IBIS File Creation, Validation, and Distribution Processes | 2002年 8月 29日 | ||
Application note | Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices | 2002年 5月 10日 | ||
User guide | GTLP/GTL Logic High-Performance Backplane Drivers Data Book (Rev. A) | 2001年 9月 15日 | ||
Selection guide | Advanced Bus Interface Logic Selection Guide | 2001年 1月 9日 | ||
Application note | GTL/BTL: A Low-Swing Solution for High-Speed Digital Logic (Rev. A) | 1997年 3月 1日 | ||
Application note | Understanding Advanced Bus-Interface Products Design Guide | 1996年 5月 1日 |
設計與開發
如需其他條款或必要資源,請按一下下方的任何標題以檢視詳細頁面 (如有)。
封裝 | 引腳 | 下載 |
---|---|---|
TSSOP (PW) | 28 | 檢視選項 |
訂購與品質
內含資訊:
- RoHS
- REACH
- 產品標記
- 鉛塗層/球物料
- MSL 等級/回焊峰值
- MTBF/FIT 估算值
- 材料內容
- 資格摘要
- 進行中可靠性監測
內含資訊:
- 晶圓廠位置
- 組裝地點