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SN74GTL2014

現行

4 位元 LVTTL 至 GTL 收發器

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產品規格表

SN74GTL2014

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產品詳細資料

Bits (#) 4 Data rate (max) (Mbps) 100 Topology Open drain, Push-Pull Direction control (typ) Fixed-direction Vin (min) (V) 3 Vin (max) (V) 3.6 Vout (min) (V) 0.8 Vout (max) (V) 3.6 Applications GTL, SDIO Features Overvoltage tolerant inputs Technology family GTL Supply current (max) (mA) 10 Rating Catalog Operating temperature range (°C) -40 to 85
Bits (#) 4 Data rate (max) (Mbps) 100 Topology Open drain, Push-Pull Direction control (typ) Fixed-direction Vin (min) (V) 3 Vin (max) (V) 3.6 Vout (min) (V) 0.8 Vout (max) (V) 3.6 Applications GTL, SDIO Features Overvoltage tolerant inputs Technology family GTL Supply current (max) (mA) 10 Rating Catalog Operating temperature range (°C) -40 to 85
TSSOP (PW) 14 32 mm² (5 mm × 6.4 mm)
  • Operates as a GTL–/GTL/GTL+ to LVTTL or LVTTL to GTL–/GTL/GTL+ Translator
  • The LVTTL Inputs are Tolerant up to 5.5 V Allowing Direct Access to TTL or 5 V CMOS
  • The GTL Input/Output Operate up to 3.6 V, Allowing the Device to be Used in High Voltage Open-Drain Applications
  • VREF Goes Down to 0.5 V for Low Voltage CPU Usage
  • Partial Power-Down Permitted
  • Latch-up Protection Exceed 500 mA per JESD78
  • Package Option: TSSOP14
  • –40°C to 85°C Operating Temperature Range
  • ESD Protection on All Terminals
    • 2000 V HBM, JESD22-A114
    • 1000 V CDM, IEC61000-4-2
  • Operates as a GTL–/GTL/GTL+ to LVTTL or LVTTL to GTL–/GTL/GTL+ Translator
  • The LVTTL Inputs are Tolerant up to 5.5 V Allowing Direct Access to TTL or 5 V CMOS
  • The GTL Input/Output Operate up to 3.6 V, Allowing the Device to be Used in High Voltage Open-Drain Applications
  • VREF Goes Down to 0.5 V for Low Voltage CPU Usage
  • Partial Power-Down Permitted
  • Latch-up Protection Exceed 500 mA per JESD78
  • Package Option: TSSOP14
  • –40°C to 85°C Operating Temperature Range
  • ESD Protection on All Terminals
    • 2000 V HBM, JESD22-A114
    • 1000 V CDM, IEC61000-4-2

The SN74GTL2014 is a 4-channel translator to interface between 3.3-V LVTTL chip set I/O and Xeon processor GTL–/GTL/GTL+ I/O.

The SN74GTL2014 integrates ESD protection cells on all terminals and is available in a TSSOP package (5.0 mm × 4.4 mm). The device is characterized over the free air temperature range of –40°C to 85°C.

The SN74GTL2014 is a 4-channel translator to interface between 3.3-V LVTTL chip set I/O and Xeon processor GTL–/GTL/GTL+ I/O.

The SN74GTL2014 integrates ESD protection cells on all terminals and is available in a TSSOP package (5.0 mm × 4.4 mm). The device is characterized over the free air temperature range of –40°C to 85°C.

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應用說明 Logic in Live-Insertion Applications With a Focus on GTLP 2002/1/14
應用說明 Achieving Maximum Speed on Parallel Buses With Gunning Transceiver Logic (GTLP) 2001/4/5
應用說明 Basic Design Considerations for Backplanes (Rev. B) 2001/4/5
應用說明 Fast GTLP Backplanes With the GTLPH1655 (Rev. A) 2000/9/19
應用說明 GTLP in BTL Applications 2000/7/31
應用說明 High-Performance Backplane Design With GTL+ (Rev. A) 1999/10/25
應用說明 GTL/BTL: A Low-Swing Solution for High-Speed Digital Logic (Rev. A) 1997/3/1

設計與開發

如需其他條款或必要資源，請按一下下方的任何標題以檢視詳細頁面 (如有)。

開發板

14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組

14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。

使用指南: PDF | HTML
支援產品和硬體
有庫存
限制：
??asset.out-of-stock-ti_zh_TW??
無法提供
模擬型號

SN74GTL2014 IBIS Model

SCLM111.ZIP (24 KB) - IBIS 模型
支援產品和硬體
封裝 針腳 CAD 符號、佔位空間與 3D 模型
TSSOP (PW) 14 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

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若有關於品質、封裝或訂購 TI 產品的問題，請參閱 TI 支援。​​​​​​​​​​​​​​

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