TIDA-01378

Diseño de referencia de receptor de banda ancha para aplicaciones DOCSIS 3.1 del cliente al servidor

TIDA-01378

Archivos de diseño

Información general

Este diseño de referencia consta de una cadena de señal de frontal analógico (AFE) para aplicaciones de receptor de banda ancha que utilizan el amplificador de ganancia variable y control digital (DVGA) LMH2832 y el convertidor analógico a digital (ADC) ADS54J40. El diseño está pensado principalmente para aplicaciones del receptor DOCSIS 3.1 de flujo ascendente especificadas para sistemas de terminación de módem por cable (CMTS) y admite hasta 196 MHz de ancho de banda de señal ascendente. El circuito resuelve los requisitos de filtración y procesamiento de señales analógicas para cumplir con el estándar DOCSIS 3.1, lo que facilita a los diseñadores de sistemas incorporar fácilmente el diseño en el lado del sistema de terminación de módem por cable de la ruta de señal ascendente.

Funciones
  • Ruta de señal acoplada a la corriente alterna de 100 kHz a 204 MHz con 196 MHz de soporte de ancho de banda de señal de flujo ascendente para aplicaciones DOCSIS 3.1
  • 58 dBFS de relación señal-ruido mínima del sistema (BW de 200 MHz) para una entrada de –1 dBFS en el convertidor analógico a digital
  • 70 dBFS de rango dinámico libre de espurios (SFDR) mínimo del sistema para una entrada de –1 dBFS en el convertidor analógico a digital
  • Consumo medio de corriente en estado activo de 1.71 A en la fuente de alimentación nominal de 5 V para montaje en pared.
  • Tasa de datos de salida de cuatro carriles por convertidor analógico a digital a 5.0 Gbps con compatibilidad con la subclase 1 de interfaz JESD204B
Electrónica personal
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Se desarrolló una placa completamente integrada únicamente para pruebas y validación de rendimiento y no está disponible para la venta.

Archivos de diseño y productos

Archivos de diseño

Descargue archivos de sistema listos para usar para acelerar su proceso de diseño.

TIDUCG9.PDF (648 KB)

Descripción general del diseño de referencia y datos de las pruebas de rendimiento verificadas

TIDRPN4.ZIP (2005 KB)

Descripción detallada del diseño para la instalación de componentes

TIDRPN3.PDF (302 KB)

Lista completa de componentes de diseño, designadores de referencia y números de fabricantes/piezas

TIDRPN6.ZIP (445 KB)

Archivos para modelos 3D o dibujos 2D de componentes de IC

TIDCD46.ZIP (3337 KB)

Fichero de diseño que contiene información sobre la capa física de la PCB de diseño

TIDRPN5.PDF (2661 KB)

Archivo de trazado de capas de PCB para generar el trazado del diseño de PCB

TIDRPN2.PDF (139 KB)

Diagrama esquemático detallado del diseño y los componentes

Productos

Incluye productos de TI en el diseño y posibles alternativas.

Amplificadores de ganancia variable (VGA) de RF

LMH2832Amplificador completamente diferencial de ganancia variable digital doble de 1.1 GHz

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Limpiadores de fluctuación de reloj

LMK04828Limpiador de fluctuación de reloj compatible con JESD204B de ruido ultrabajo con VCO0 integrado de 2

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Hot-swap controllers

TPS2400Controlador de protección contra sobretensión de 5.5 V con protección contra transitorios de entrada

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Circuitos integrados LVDS, M-LVDS y PECL

SN65LVDS4Receptor LVDS único de 500 Mbps y alta velocidad

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MOSFET

CSD17313Q2MOSFET de potencia NexFET™ de 30 V y canal N, SON simple de 2 mm x 2 mm, 32 mOhm

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Reguladores lineales y de baja salida (LDO)

TPS735Regulador de tensión de baja caída, baja IQ, 500 mA con activación

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Reguladores lineales y de baja salida (LDO)

TPS7A8101Regulador de tensión de caída baja ajustable, de 1 A, alto PSRR, con habilitación

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Circuitos integrados LVDS, M-LVDS y PECL

SN65LVDS101Traductor y repetidor LVDS, LVPECL y CML a búfer LVPECL de 2 Gbps

Hoja de datos: PDF | HTML
Reguladores lineales y de baja salida (LDO)

TPS7A47Regulador de tensión de 1 A, 36 V, bajo ruido, alto PSRR y baja caída de tensión con activación

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ADC de alta velocidad (≥ 10 MSPS)

ADS54J40Convertidor analógico a digital (ADC) de dos canales, 14 bits y 1,0 GSPS

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Convertidores de CA/CC y CC/CC (FET integrado)

TPS54319Convertidor reductor sincrónico SWIFT™ de 2.95V a 6V dentrada, 3A y 2MHz en paquete QFN de 3 x 3 mm

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Inicio de desarrollo

Software

GUI para el módulo de evaluación (EVM)

SLAC594 — ADS54Jxx EVM GUI

Productos y hardware compatibles

Productos y hardware compatibles

Productos
ADC de alta velocidad (≥ 10 MSPS)
ADS54J40 Convertidor analógico a digital (ADC) de dos canales, 14 bits y 1,0 GSPS ADS54J60 Convertidor analógico a digital (ADC) de dos canales, 16 bits y 1,0 GSPS ADS54J66 Convertidor analógico a digital (ADC) de cuatro canales, 14 bits y 500 MSPS ADS54J69 Convertidor analógico a digital (ADC) de dos canales, 16 bits y 500 MSPS
Transmisores RF
ADS58J63 CI de receptor de telecomunicaciones de cuatro canales, 14 bits y 500 Msps
Desarrollo de hardware
Diseño de referencia
TIDA-01378 Diseño de referencia de receptor de banda ancha para aplicaciones DOCSIS 3.1 del cliente al servidor
Placa de evaluación
ADS54J20EVM Módulo de evaluación del convertidor analógico a digital ADS54J20 de dos canales, 12 bits y 1,0 GSPS ADS54J40EVM Módulo de evaluación del convertidor analógico a digital ADS54J40 de dos canales, 14 bits y 1,0 GSPS ADS54J60EVM Módulo de evaluación del convertidor analógico a digital ADS54J60 de dos canales, 16 bits y 1,0 GSPS ADS54J66EVM Módulo de evaluación del convertidor analógico a digital ADS54J66 de cuatro canales, 14 bits y 500 M ADS54J69EVM Módulo de evaluación del convertidor analógico a digital ADS54J69 de dos canales, 16 bits y 500 MSPS ADS58J63EVM Módulo de evaluación de ADS58J63 TSW54J60EVM Digitalizador de ancho de banda de entrada de 400 MHz: ADC doble de 16 bits, 1 GSPS y amperios de ga
Opciones de descarga

SLAC594 ADS54Jxx EVM GUI

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Última versión
Versión: 01.00.00.0J
Fecha de publicación: 4/05/2023

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Productos
ADC de alta velocidad (≥ 10 MSPS)
ADS54J40 Convertidor analógico a digital (ADC) de dos canales, 14 bits y 1,0 GSPS ADS54J60 Convertidor analógico a digital (ADC) de dos canales, 16 bits y 1,0 GSPS ADS54J66 Convertidor analógico a digital (ADC) de cuatro canales, 14 bits y 500 MSPS ADS54J69 Convertidor analógico a digital (ADC) de dos canales, 16 bits y 500 MSPS
Transmisores RF
ADS58J63 CI de receptor de telecomunicaciones de cuatro canales, 14 bits y 500 Msps
Desarrollo de hardware
Diseño de referencia
TIDA-01378 Diseño de referencia de receptor de banda ancha para aplicaciones DOCSIS 3.1 del cliente al servidor
Placa de evaluación
ADS54J20EVM Módulo de evaluación del convertidor analógico a digital ADS54J20 de dos canales, 12 bits y 1,0 GSPS ADS54J40EVM Módulo de evaluación del convertidor analógico a digital ADS54J40 de dos canales, 14 bits y 1,0 GSPS ADS54J60EVM Módulo de evaluación del convertidor analógico a digital ADS54J60 de dos canales, 16 bits y 1,0 GSPS ADS54J66EVM Módulo de evaluación del convertidor analógico a digital ADS54J66 de cuatro canales, 14 bits y 500 M ADS54J69EVM Módulo de evaluación del convertidor analógico a digital ADS54J69 de dos canales, 16 bits y 500 MSPS ADS58J63EVM Módulo de evaluación de ADS58J63 TSW54J60EVM Digitalizador de ancho de banda de entrada de 400 MHz: ADC doble de 16 bits, 1 GSPS y amperios de ga

Información de la versión

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Documentación técnica

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Tipo Título Descargar la versión más reciente en inglés Fecha
* Guía de diseño Wideband Receiver Reference Design for Upstream DOCSIS 3.1 Applications 26/10/2016

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