JAJSQK7D May   2013  – May 2026 ADS1220

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 デバイス比較表
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性
    6. 6.6 SPI のタイミング要件
    7. 6.7 SPI スイッチング特性
    8. 6.8 タイミング図
    9. 6.9 代表的特性
  8. 7 パラメータ測定情報
    1. 7.1 ノイズ性能
  9. 8 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1  マルチプレクサ
      2. 8.3.2  低ノイズ PGA
        1. 8.3.2.1 入力同相電圧の要件
        2. 8.3.2.2 PGA のバイパス
      3. 8.3.3  電圧リファレンス
      4. 8.3.4  クロック ソース
      5. 8.3.5  変調器
      6. 8.3.6  デジタル フィルタ
      7. 8.3.7  出力データ レート
      8. 8.3.8  励起電流源
      9. 8.3.9  ローサイド パワー スイッチ
      10. 8.3.10 センサ検出
      11. 8.3.11 システム モニタ
      12. 8.3.12 オフセット キャリブレーション
      13. 8.3.13 温度センサ
        1. 8.3.13.1 デジタル コードから温度への変換
    4. 8.4 デバイスの機能モード
      1. 8.4.1 パワーアップとリセット
      2. 8.4.2 変換モード
        1. 8.4.2.1 シングルショット 変換 モード
        2. 8.4.2.2 連続変換モード
      3. 8.4.3 動作モード
        1. 8.4.3.1 通常モード
        2. 8.4.3.2 デューティ サイクル モード
        3. 8.4.3.3 ターボ モード
        4. 8.4.3.4 パワーダウン モード
    5. 8.5 プログラミング
      1. 8.5.1 シリアル インターフェイス
        1. 8.5.1.1 チップ セレクト (CS)
        2. 8.5.1.2 シリアル クロック (SCLK)
        3. 8.5.1.3 データ準備完了 (DRDY)
        4. 8.5.1.4 データ入力 (DIN)
        5. 8.5.1.5 データ出力およびデータ準備完了 (DOUT/DRDY)
        6. 8.5.1.6 SPI タイムアウト
      2. 8.5.2 データ形式
      3. 8.5.3 コマンド
        1. 8.5.3.1 RESET (0000 011xb)
        2. 8.5.3.2 START/SYNC (0000 100xb)
        3. 8.5.3.3 POWERDOWN (0000 001xb)
        4. 8.5.3.4 RDATA (0001 xxxxb)
        5. 8.5.3.5 RREG (0010 rrnnb)
        6. 8.5.3.6 WREG (0100 rrnnb)
      4. 8.5.4 データの読み取り
      5. 8.5.5 コマンドの送信
      6. 8.5.6 複数のデバイスとのインターフェイス
    6. 8.6 レジスタ マップ
      1. 8.6.1 構成レジスタ
      2. 8.6.2 レジスタの説明
        1. 8.6.2.1 構成レジスタ 0 (アドレス = 00h) [リセット = 00h]
        2. 8.6.2.2 構成レジスタ 1 (アドレス = 01h) [リセット = 00h]
        3. 8.6.2.3 構成レジスタ 2 (アドレス = 02h) [リセット = 00h]
        4. 8.6.2.4 構成レジスタ 3 (アドレス = 03h) [リセット = 00h]
  10. 9 アプリケーションと実装
    1. 9.1 使用上の注意
      1. 9.1.1 シリアル インターフェイスの接続
      2. 9.1.2 アナログ入力フィルタリング
      3. 9.1.3 外部リファレンスおよびレシオメトリック測定
      4. 9.1.4 適切な同相入力電圧の確立
      5. 9.1.5 未使用入出力
      6. 9.1.6 疑似コードの例
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 K 型熱電対測定 (–200°C ~ +1250°C)
        1. 9.2.1.1 設計要件
        2. 9.2.1.2 詳細な設計手順
        3. 9.2.1.3 アプリケーション曲線
      2. 9.2.2 3 線式 RTD 測定 (–200°C ~ +850°C)
        1. 9.2.2.1 設計要件
        2. 9.2.2.2 詳細な設計手順
          1. 9.2.2.2.1 2 線式と 4 線式 RTD 測定の設計バリエーション
        3. 9.2.2.3 アプリケーション曲線
      3. 9.2.3 抵抗ブリッジ測定
        1. 9.2.3.1 設計要件
        2. 9.2.3.2 詳細な設計手順
    3. 9.3 電源に関する推奨事項
      1. 9.3.1 電源シーケンス
      2. 9.3.2 電源ランプ レート
      3. 9.3.3 電源のデカップリング
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントのサポート
      1. 10.1.1 関連資料
    2. 10.2 ドキュメントの更新通知を受け取る方法
    3. 10.3 サポート・リソース
    4. 10.4 商標
    5. 10.5 静電気放電に関する注意事項
    6. 10.6 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報

デジタル フィルタ

デバイスは、線形位相の有限インパルス応答 (FIR) デジタル フィルタを使用し、変調器からのデジタル データ ストリームのフィルタリングとデシメーションの両方を実行します。デジタル フィルタは、異なるデータ レートに合わせて自動的に調整され、常に 1 サイクル以内に収束されます。5SPS および 20SPS のデータ レートでは構成レジスタの 50/60[1:0] ビットを使用して、50Hz または 60Hz のライン周波数除去を選択するか、50Hz と 60Hz を同時に除去します。デジタル フィルタの周波数特性は、内部発振器または外部 4.096MHz クロックを使用した場合の異なる出力データ レートごとに、図 8-9 ~ 図 8-22 に図示されています。

フィルタ ノッチおよび出力データ レートは、クロック周波数に比例してスケーリングします。たとえば、4.096MHz クロックを使用した際に 20Hz で現れるノッチは、2.048MHz クロックを使用した場合は 10Hz で現れます。内部発振器は、「電気的特性」表に規定されている温度範囲全体にわたって変化する可能性があります。データ レートまたは変換時間、およびフィルタ ノッチは、結果的に同じ量によって異なります。より厳しい許容誤差で、特定の周波数にデジタル フィルタ ノッチが必要な場合は、外部高精度クロック ソースを使用することを検討してください。

ADS1220 フィルタ応答 (DR = 20SPS)
50Hz および 60Hz 同時除去、50/60[1:0] = 01b
図 8-9 フィルタ応答
(DR = 20SPS)
ADS1220 フィルタ応答の詳細図 (DR = 20SPS)
50Hz および 60Hz 同時除去、50/60[1:0] = 01b
図 8-10 フィルタ応答の詳細図
(DR = 20SPS)
ADS1220 フィルタ応答 (DR = 20SPS)
50Hz 除去のみ、50/60[1:0] = 10b
図 8-11 フィルタ応答
(DR = 20SPS)
ADS1220 フィルタ応答 (DR = 20SPS)
60Hz 除去のみ、0/60[1:0] = 11b
図 8-13 フィルタ応答
(DR = 20SPS)
ADS1220 フィルタ応答 (DR = 20SPS)
50/60[1:0] = 00b
図 8-15 フィルタ応答
(DR = 20SPS)
ADS1220 フィルタ応答 (DR = 90SPS)
図 8-17 フィルタ応答
(DR = 90SPS)
ADS1220 フィルタ応答 (DR = 330SPS)
図 8-19 フィルタ応答
(DR = 330SPS)
ADS1220 フィルタ応答 (DR = 1kSPS)
図 8-21 フィルタ応答
(DR = 1kSPS)
ADS1220 フィルタ応答の詳細図 (DR = 20SPS)
50Hz 除去のみ、50/60[1:0] = 10b
図 8-12 フィルタ応答の詳細図
(DR = 20SPS)
ADS1220 フィルタ応答の詳細図 (DR = 20SPS)
60Hz 除去のみ、0/60[1:0] = 11b
図 8-14 フィルタ応答の詳細図
(DR = 20SPS)
ADS1220 フィルタ応答 (DR = 45SPS)
 
図 8-16 フィルタ応答
(DR = 45SPS)
ADS1220 フィルタ応答 (DR = 175SPS)
図 8-18 フィルタ応答
(DR = 175SPS)
ADS1220 フィルタ応答 (DR = 600SPS)
図 8-20 フィルタ応答
(DR = 600SPS)
ADS1220 フィルタ応答 (DR = 2kSPS)
図 8-22 フィルタ応答
(DR = 2kSPS)