전력 관리 멀티 채널 IC(PMIC)

LP2996A

활성

DDR2/3/3L용 셧다운 핀을 갖춘 1.5A DDR 터미네이션 레귤레이터

제품 상세 정보

Product type DDR Vin (min) (V) 1.35 Vin (max) (V) 5.5 Vout (min) (V) 0.656 Vout (max) (V) 0.698 Features Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) 0 to 125 Iq (typ) (mA) 0.32 DDR memory type DDR, DDR2, DDR3, DDR3L
Product type DDR Vin (min) (V) 1.35 Vin (max) (V) 5.5 Vout (min) (V) 0.656 Vout (max) (V) 0.698 Features Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) 0 to 125 Iq (typ) (mA) 0.32 DDR memory type DDR, DDR2, DDR3, DDR3L
HSOIC (DDA) 8 29.4 mm² 4.9 x 6
  • Minimum VDDQ:
    • 1.8 V (LP2996-N)
    • 1.35 V (LP2996A)
  • Source and Sink Current
  • Low Output Voltage Offset
  • No External Resistors Required for Setting Output Voltage
  • Linear Topology
  • Suspend to Ram (STR) Functionality
  • Stable With Ceramic Capacitors With Appropriate ESR
  • Low External Component Count
  • Thermal Shutdown
  • Minimum VDDQ:
    • 1.8 V (LP2996-N)
    • 1.35 V (LP2996A)
  • Source and Sink Current
  • Low Output Voltage Offset
  • No External Resistors Required for Setting Output Voltage
  • Linear Topology
  • Suspend to Ram (STR) Functionality
  • Stable With Ceramic Capacitors With Appropriate ESR
  • Low External Component Count
  • Thermal Shutdown

The LP2996-N and LP2996A linear regulators are designed to meet the JEDEC SSTL-2 specifications for termination of DDR-SDRAM. The device also supports DDR2, while LP2996A supports DDR3 and DDR3L VTT bus termination with VDDQ minimum of 1.35 V. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5-A continuous current and transient peaks up to 3 A in the application as required for DDR-SDRAM termination. The LP2996-N and LP2996A also incorporate a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DIMMs.

An additional feature found on the LP2996-N and LP2996A is an active-low shutdown (SD) pin that provides Suspend To RAM (STR) functionality. When SD is pulled low the VTT output will tri-state providing a high impedance output, but VREF remains active. A power savings advantage can be obtained in this mode through lower quiescent current.

TI recommends the LP2998 and LP2998-Q1 devices for automotive applications and DDR applications that require operating at temperatures below zero.

WEBENCH® design tools can be used by application designers to generate, optimize, and simlulate applications using the LP2998 and LP2998-Q1.

The LP2996-N and LP2996A linear regulators are designed to meet the JEDEC SSTL-2 specifications for termination of DDR-SDRAM. The device also supports DDR2, while LP2996A supports DDR3 and DDR3L VTT bus termination with VDDQ minimum of 1.35 V. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5-A continuous current and transient peaks up to 3 A in the application as required for DDR-SDRAM termination. The LP2996-N and LP2996A also incorporate a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DIMMs.

An additional feature found on the LP2996-N and LP2996A is an active-low shutdown (SD) pin that provides Suspend To RAM (STR) functionality. When SD is pulled low the VTT output will tri-state providing a high impedance output, but VREF remains active. A power savings advantage can be obtained in this mode through lower quiescent current.

TI recommends the LP2998 and LP2998-Q1 devices for automotive applications and DDR applications that require operating at temperatures below zero.

WEBENCH® design tools can be used by application designers to generate, optimize, and simlulate applications using the LP2998 and LP2998-Q1.

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기술 자료

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유형 직함 날짜
* Data sheet LP2996/LP2996A DDR Termination Regulator datasheet (Rev. K) 2016/12/23
Application note Limiting DDR Termination Regulators’ Inrush Current 2016/08/23

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

LP2998EVAL — LP2998용 평가 보드

The LP2998 evaluation board is designed to provide the design Engineer with a fully functional prototype system in which to evaluate the LP2998 in both a static environment and with a complete memory system.

사용 설명서: PDF
TI.com에서 구매 불가
시뮬레이션 모델

LP2996A PSpice Transient Model

SNOM562.ZIP (85 KB) - PSpice Model
시뮬레이션 모델

LP2996A Unencrypted PSpice Transient Model

SNOM564.ZIP (7 KB) - PSpice Model
레퍼런스 디자인

TIDA-010011 — 보호 릴레이 프로세서 모듈을 위한 고효율 전원 공급 장치 아키텍처 레퍼런스 설계

이 레퍼런스 설계는 1A 이상의 부하 전류와 높은 효율이 필요한 애플리케이션 프로세서 모듈을 위한 여러 전압 레일을 생성하는 다양한 전력 아키텍처를 보여줍니다. 필요한 전원 공급은 백플레인에서 5V, 12V 또는 24V DC 입력을 사용하여 생성됩니다. 전원 공급은 통합 FET와 크기를 위해 인덕터가 통합된 전원 모듈을 사용하여 생성됩니다. 이 설계는 낮은 EMI가 필요한 애플리케이션을 위한 HotRod™ 패키지 유형을 갖추고 있습니다. 또한 설계 시간이 제한된 애플리케이션에 적합합니다. 추가 기능으로는 DDR 터미네이션 (...)
Design guide: PDF
회로도: PDF
레퍼런스 디자인

TIDEP0067 — 66AK2Gx DSP + ARM 프로세서 전원 솔루션 레퍼런스 디자인

이 레퍼런스 설계는 66AK2Gx 멀티코어 시스템 온 칩(SoC) 프로세서와 66AK2Gx 프로세서를 위한 전원 공급 장치 및 전원 시퀀싱을 단일 장치에 포함하는 컴패니언 TPS65911 전력 관리 통합 회로(PMIC)를 기반으로 합니다. 이 전원 솔루션 설계에는 12V 입력을 지원하는 1단계 벅 컨버터와 DDR3L 메모리용 DDR 종단 레귤레이터도 포함되어 있습니다. 레퍼런스 설계는 테스트를 거쳤으며 하드웨어 레퍼런스(EVM), 소프트웨어(프로세서 SDK) 및 테스트 데이터가 포함되어 있습니다.
Design guide: PDF
회로도: PDF
패키지 CAD 기호, 풋프린트 및 3D 모델
HSOIC (DDA) 8 Ultra Librarian

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

콘텐츠는 TI 및 커뮤니티 기고자에 의해 "있는 그대로" 제공되며 TI의 사양으로 간주되지 않습니다. 사용 약관을 참조하십시오.

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