JAJSXJ8 November   2025 ADC32RF72

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性 - 消費電力
    6. 5.6 電気的特性 - DC 仕様
    7. 5.7 電気的特性 - AC 仕様
    8. 5.8 タイミング要件
    9. 5.9 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 アナログ入力
        1. 7.3.1.1 入力帯域幅
        2. 7.3.1.2 バックグラウンドキャリブレーション
      2. 7.3.2 ADC チャネルの選択とパワー ダウン モード
      3. 7.3.3 サンプリング クロック入力
      4. 7.3.4 SYSREF
        1. 7.3.4.1 SYSREF モニタ
      5. 7.3.5 デジタルシグナルプロセッサ (DSP) 機能
        1. 7.3.5.1 DSP 入力マルチプレクサ
        2. 7.3.5.2 非整数遅延
        3. 7.3.5.3 イコライゼーション用のプログラム可能な FIR フィルタ
        4. 7.3.5.4 DSP 出力マルチプレクサ
        5. 7.3.5.5 デジタルダウンコンバータ (DDC)
          1. 7.3.5.5.1 デシメーションフィルタ入力
          2. 7.3.5.5.2 デシメーションモード
          3. 7.3.5.5.3 デシメーション フィルタ応答
          4. 7.3.5.5.4 数値制御発振器 (NCO)
            1. 7.3.5.5.4.1 NCO の更新
            2. 7.3.5.5.4.2 NCO リセット
      6. 7.3.6 デジタル出力インターフェイス
        1. 7.3.6.1 JESD204B/C インターフェイス
          1. 7.3.6.1.1 JESD204B 初期レーン アライメント (ILA)
          2. 7.3.6.1.2 SYNC 信号
          3. 7.3.6.1.3 JESD204B/C フレーム アセンブリ
          4. 7.3.6.1.4 バイパスモードの JESD204B/C フレームアセンブリ
          5. 7.3.6.1.5 実際のデシメーションを使用する JESD204B/C フレーム アセンブリ
          6. 7.3.6.1.6 複雑なデシメーションを使用する JESD204B、C フレーム アセンブリ
        2. 7.3.6.2 JESD 出力リファレンスクロック
    4. 7.4 デバイスの機能モード
      1. 7.4.1 デバイス動作モードの比較
    5. 7.5 プログラミング
      1. 7.5.1 GPIO 制御
      2. 7.5.2 SPI レジスタへの書き込み
      3. 7.5.3 SPI レジスタの読み取り
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション：スペクトル アナライザ
      1. 8.2.1 設計要件
        1. 8.2.1.1 入力信号パス：広帯域レシーバ
        2. 8.2.1.2 クロック処理
      2. 8.2.2 詳細な設計手順
        1. 8.2.2.1 サンプリングクロックの要件
      3. 8.2.3 アプリケーション特性の波形
    3. 8.3 代表的なアプリケーション：時間ドメインデジタイザ
      1. 8.3.1 設計要件
        1. 8.3.1.1 入力信号パス：時間ドメインデジタイザ
      2. 8.3.2 アプリケーション特性の波形
    4. 8.4 初期化セットアップ
    5. 8.5 電源に関する推奨事項
    6. 8.6 レイアウト
      1. 8.6.1 レイアウトのガイドライン
      2. 8.6.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
      2. 9.1.2 サード・パーティ製品に関する免責事項
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

5.7 電気的特性 - AC 仕様

最大値と最小値は、自由気流での動作温度範囲および公称電源電圧について規定されています。特に記述のない限り、標準値は TA = 25°C、ADC サンプリングレート = 1.5GSPS、100Ω 終端、DDC バイパスモード、50% クロックデューティサイクル、公称電源電圧、-1dBFS 差動入力で規定されています。
パラメータ テスト条件 最小値(2) 標準値 最大値 単位
AC精度
NSDflat ノイズ スペクトル密度 fIN = 600MHz、AIN = -20dBFS -163.7 dBFS/Hz
NF ノイズ指数 (100Ω 終端) fIN = 600MHz、AIN = -20dBFS 14.4 dB
SNR 信号対雑音比 fIN = 100MHz 73.0 dBFS
SNRflat(1) ナイキストゾーン内の 100MHz から FS/2 で測定された信号対雑音比 fIN = 100MHz 72.0 75.3 dBFS
fIN = 600MHz 73.4
fIN = 600MHz、AIN = -20dBFS 75.5
fIN = 900MHz 72.1
fIN = 1.4GHz 69.0
SINADflat(1) 信号対雑音歪み比 fIN = 100MHz 74.3 dBFS
ENOB 有効ビット数 fIN = 100MHz 11.8 ビット
THD 全高調波歪み (最初の 5 つの高調波) fIN = 100MHz 82 dBc
fIN = 600MHz 74
fIN = 900MHz 68
fIN = 1.4GHz 57
HD2 2 次高調波歪み fIN = 100MHz 74 88 dBc
fIN = 600MHz 77
fIN = 900MHz 74
fIN = 1.4GHz 64
HD3 3 次高調波歪み fIN = 100MHz 74 83 dBc
fIN = 600MHz 77
fIN = 900MHz 68
fIN = 1.4GHz 58
Non HD2,3 スプリアス フリー ダイナミック レンジ (HD2 と HD3 を除く) fIN = 100MHz 80 95 dBFS
fIN = 600MHz 90
fIN = 900MHz 93
fIN = 1.4GHz 79
IMD3 2 トーンの相互変調歪み f1 = 100MHz、f2 = 200MHz、AIN = -7dBFS/tone 89 dBFS
f1 = 0.9GHz、f2 = 1.0GHz、AIN = -7dBFS/tone 76
(1) SNRflat および NSDflat の詳細な説明については、セクション 6 を参照してください。
(2) SNRflat、HD3、および非 HD23 の最小値は最終テストで規定されています。HD2 はベンチ特性評価により規定されています。