드라이버 또는 라이브러리
AFE5932-DESIGN — AFE5932 design resources
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AFE5932
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- AFE5932 supports:
- 32-channels attenuator, PGA+LPF, 12-bit ADC, digital features with a decimation block
- Input Attenuator (ATTEN) with DTGC
- 24dB to 0dB attenuation range with 0.125dB step. Using in-built DTGC engine attenuation can be changed in real time.
- Post-gain Amplifier (PGA) and low-pass filter LPF
- Programmable gain of 12, 15 & 18 dB
- Maximum output swing support 1.6 Vpp
- LPF supported corners: First order filter with corner 10, 15 & 20 MHz
- Analog to digital convertor
- Maximum input swing support: 1.6 Vpp
- Resolution: 12bit
- Maximum ADC clock frequency (fADC_CLK): 50MHz
- Full scale SNR: 62 dBFS
- Decimation: Optional decimation block after ADC to decimate data by 2 or 4.
- Compression block to combine data in fewer LVDS lanes as per the decimation factor
- Total Power: 17 mW/ch at ADC Clock of 50MHz
- Low speed CMOS serial programming interface to program front end and ADC upto 40MHz speed
- Supply: 1.8V and 1.15V
- Small package: FC-BGA-100 (10mm × 10mm) with 0.8mm pitch
The AFE5932 is a highly integrated, low power receiver device designed for portable ultrasound imaging systems. The device boasts a total of 32 receiver channels, each featuring an attenuator, PGA and low-pass filter, and ADC.
기술 자료
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1개 모두 보기 | 상위 문서 | 유형 | 직함 | 형식 옵션 | 날짜 |
|---|---|---|---|---|
| * | Data sheet | AFE5932, 32-Channel Ultrasound AFE With 17-mW/Channel Power, 2-nV/√Hz Noise, 12-Bit, 50-MSPS Output datasheet | PDF | HTML | 2026/03/13 |
설계 및 개발
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