CDCBT1001
- Low additive jitter and phase noise:
- 0.8ps maximum 12kHz to 5MHz additive RMS jitter (fout = 24MHz)
- –120dBc/Hz maximum phase noise at 1kHz offset (fout = 24MHz)
- –148dBc/Hz maximum phase noise floor (fout = 24MHz, foffset ≥ 1MHz)
- 5ns 20% to 80% rise/fall time
- 10ns propagation delay
- Low current consumption
- –40°C to 85°C operating temperature range
- Flexible output from operational frequency
The CDCBT1001 is a 1.2V to 3.3V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2V, 1.8V, 2.5V, or 3.3V ± 10%. VDD_OUT = 1.2V, 1.8V, 2.5V, or 3.3V ± 10%.
The 12kHz to 5MHz additive RMS jitter at 24MHz is less than 0.8ps.
기술 자료
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2개 모두 보기 | 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | CDCBT1001 1.2V to 3.3 V Clock Buffer and Level Translator datasheet (Rev. A) | PDF | HTML | 2025/10/24 |
| Certificate | CDCBT1001EVM EU RoHS Declaration of Conformity (DoC) | 2022/03/25 |
설계 및 개발
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시뮬레이션 툴
PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®
TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.
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| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| X2SON (DPW) | 5 | Ultra Librarian |
주문 및 품질
포함된 정보:
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
포함된 정보:
- 팹 위치
- 조립 위치
권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.