JAJSPK0A December 2022 – October 2023 DRV8461
PRODUCTION DATA
図 7-59 に DIAG3 レジスタを示し、表 7-39 にこのレジスタのフィールドの説明を示します。
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7 | 6 | 5 | 4 | 3 | 2 | 1 | 0 |
RSVD |
NHOME |
CNT_OFLW |
CNT_UFLW | RSVD |
NPOR |
RSVD |
|
R-0b | R-0b | R-0b | R-0b | R-0b | R-0b |
R-00b |
ビット | フィールド | 種類 | デフォルト | 説明 |
---|---|---|---|---|
7 | RSVD | R | 0b |
予約済み |
6 |
NHOME |
R | 0b | このビットが「1」の場合、インデクサがホーム以外の位置にあることを示します |
5 |
CNT_OFLW |
R | 0b |
このビットが「1」の場合、ATQ_CNT が ATQ_UL より大きいことを示します |
4 | CNT_UFLW | R | 0b |
このビットが「1」の場合、ATQ_CNT が ATQ_LL より小さいことを示します |
3 | RSVD | R | 0b |
予約済み |
2 |
NPOR |
R |
0b |
0b=前の VCC UVLO イベントを示します 1b = VCC UVLO イベント後に、NPOR ビットが CLR_FLT または nSLEEP リセット・パルス入力によってクリアされたことを示します |
1-0 |
RSVD | R | 00b |
予約済み |