JAJSVL3B November   2024  – October 2025 MSPM0G1518 , MSPM0G1519 , MSPM0G3518 , MSPM0G3519

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 機能ブロック図
  6. 5 デバイスの比較
    1. 5.1 デバイス比較チャート
  7. 6 ピン構成および機能
    1. 6.1 ピン配置図
    2. 6.2 ピン属性
      1.      11
    3. 6.3 信号の説明
      1.      13
      2.      14
      3.      15
      4.      16
      5.      17
      6.      18
      7.      19
      8.      20
      9.      21
      10.      22
      11.      23
      12.      24
      13.      25
      14.      26
      15.      27
      16.      28
      17.      29
    4. 6.4 未使用ピンの接続
  8. 7 仕様
    1. 7.1  絶対最大定格
    2. 7.2  ESD 定格
    3. 7.3  推奨動作条件
    4. 7.4  熱に関する情報
    5. 7.5  電源電流特性
      1. 7.5.1 RUN / SLEEP モード
      2. 7.5.2 STOP / STANDBY モード
      3. 7.5.3 SHUTDOWN モード
    6. 7.6  電源シーケンス
      1. 7.6.1 電源ランプ
      2. 7.6.2 POR および BOR
    7. 7.7  フラッシュ メモリの特性
    8. 7.8  タイミング特性
    9. 7.9  クロック仕様
      1. 7.9.1 システム発振器 (SYSOSC)
      2. 7.9.2 低周波数発振器 (LFOSC)
      3. 7.9.3 システム フェーズ ロック ループ (SYSPLL)
      4. 7.9.4 低周波数クリスタル / クロック
      5. 7.9.5 高周波数クリスタル / クロック
    10. 7.10 デジタル IO
      1. 7.10.1 電気的特性
      2. 7.10.2 スイッチング特性
    11. 7.11 アナログ マルチプレクサ VBOOST
    12. 7.12 ADC
      1. 7.12.1 電気的特性
      2. 7.12.2 スイッチング特性
      3. 7.12.3 直線性パラメータ
      4. 7.12.4 代表的な接続図
    13. 7.13 温度センサ
    14. 7.14 VREF
      1. 7.14.1 電圧特性
      2. 7.14.2 電気的特性
    15. 7.15 コンパレータ (COMP)
      1. 7.15.1 コンパレータ電気的特性
    16. 7.16 DAC
      1. 7.16.1 DAC 電源仕様
      2. 7.16.2 DAC 出力仕様
      3. 7.16.3 DAC 動的仕様
      4. 7.16.4 DAC 直線性仕様
      5. 7.16.5 DAC タイミング仕様
    17. 7.17 I2C
      1. 7.17.1 I2C 特性
      2. 7.17.2 I2C フィルタ
      3. 7.17.3 I2C のタイミング図
    18. 7.18 SPI
      1. 7.18.1 SPI
      2. 7.18.2 SPI タイミング図
    19. 7.19 UART
    20. 7.20 TIMx
    21. 7.21 TRNG
      1. 7.21.1 TRNG 電気的特性
      2. 7.21.2 TRNG スイッチング特性
    22. 7.22 エミュレーションおよびデバッグ
      1. 7.22.1 SWD タイミング
  9. 8 詳細説明
    1. 8.1  機能ブロック図
    2. 8.2  CPU
    3. 8.3  動作モード
      1. 8.3.1 動作モード別の機能 (MSPM0Gx51x)
    4. 8.4  パワー マネージメント ユニット (PMU)
    5. 8.5  クロック モジュール (CKM)
    6. 8.6  DMA
    7. 8.7  イベント
    8. 8.8  メモリ
      1. 8.8.1 メモリ構成
      2. 8.8.2 ペリフェラル ファイル マップ
      3. 8.8.3 ペリフェラルの割り込みベクタ
    9. 8.9  フラッシュ メモリ
    10. 8.10 SRAM
    11. 8.11 GPIO
    12. 8.12 IOMUX
    13. 8.13 ADC
    14. 8.14 温度センサ
    15. 8.15 VREF
    16. 8.16 COMP
    17. 8.17 DAC
    18. 8.18 セキュリティ
    19. 8.19 TRNG
    20. 8.20 AESADV
    21. 8.21 キーストア
    22. 8.22 CRC-P
    23. 8.23 MATHACL
    24. 8.24 UART
    25. 8.25 I2C
    26. 8.26 SPI
    27. 8.27 CAN-FD
    28. 8.28 低周波数サブシステム (LFSS)
    29. 8.29 RTC_B
    30. 8.30 IWDT_B
    31. 8.31 WWDT
    32. 8.32 タイマ (TIMx)
    33. 8.33 デバイスのアナログ接続
    34. 8.34 入力 / 出力の回路図
    35. 8.35 シリアル ワイヤ デバッグ インターフェイス
    36. 8.36 ブート ストラップ ローダ (BSL)
    37. 8.37 デバイス ファクトリ定数
    38. 8.38 識別
  10. 9 アプリケーション、実装、およびレイアウト
    1. 9.1 代表的なアプリケーション
      1. 9.1.1 回路図
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 入門と次のステップ
    2. 10.2 デバイスの命名規則
    3. 10.3 ツールとソフトウェア
    4. 10.4 ドキュメントのサポート
    5. 10.5 サポート・リソース
    6. 10.6 商標
    7. 10.7 静電気放電に関する注意事項
    8. 10.8 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報
    1. 12.1 トレイ情報
    2.     付録：パッケージ･オプション

8.6 DMA

ダイレクト メモリ アクセス (DMA) コントローラを使うと、CPU を介さずに、いずれかのメモリ アドレスから別のメモリ アドレスにデータを移動できます。たとえば、DMA を使って ADC 変換メモリから SRAM にデータを移動できます。DMA を使用すると、ペリフェラルとの間でデータをやりとりするとき、CPU をウェークアップする必要がなく、低消費電力モードのまま維持できるため、システムの消費電力を削減できます。

これらのデバイスの DMA は、以下の主な機能をサポートしています。

  • 12 つの独立した DMA 転送チャネル
    • 6 つのフル機能チャネル (DMA0-DMA5)。繰り返し転送モードをサポートします。
    • 6 つの基本チャネル (DMA6-DMA11)、シングル転送モードをサポートします。
  • DMA チャネルの優先度を設定可能
  • バイト (8 ビット)、ショート ワード (16 ビット)、ワード (32 ビット)、ロング ワード (64 ビット)、ロングロングワード (128 ビット)、またはバイトとワードの混合の転送機能
  • 最大 64k のブロック サイズのすべてのデータ タイプの転送をサポートする転送カウンタ
  • DMA 転送トリガの選択を設定可能
  • 他のチャネルにサービスを提供するためのアクティブ チャネル割り込み
  • ピンポン バッファ アーキテクチャのための早期割り込み生成
  • 他のチャネルでのアクティビティ完了時のチャネルのカスケード化
  • データの再構成をサポートするためのストライド モード (3 相測定アプリケーションなど)
  • 収集モード

表 8-2 DMA の機能
機能 完全 基本
チャネル番号 0、1、2、3、4、5 6、7、8、9、10、11
反復モード あり -
テーブルとフィルモード あり -
収集モード あり -
IRQ 前 あり -
オート イネーブル あり あり
ロング ロング (128 ビット) 転送 あり あり
ストライド モード あり あり
カスケード チャネルのサポート あり あり

DMA で使用可能なトリガの一覧を 表 8-3 に示します。これらは、DMA メモリ マップ レジスタの DMATCTL.DMATSEL 制御ビットで設定されます。

表 8-3 DMA のトリガの割り当て
DMACTL.DMATSEL トリガ ソース DMACTL.DMATSEL トリガ ソース
0 ソフトウェア 17 SPI2 パブリッシャ 2
1 一般サブスクライバ (FSUB_0) 18 UART3 パブリッシャ 1
2 一般サブスクライバ (FSUB_1) 19 UART3 パブリッシャ 2
3 AESADV パブリッシャ 1 20 UART4 パブリッシャ 1
4 AESADV パブリッシャ 2 21 UART4 パブリッシャ 2
5 DAC0 パブリッシャ 2 22 UART5 パブリッシャ 1
6 I2C0 パブリッシャ 1 23 UART5 パブリッシャ 2
7 I2C0 パブリッシャ 2 24 UART6 パブリッシャ 1
8 I2C1 パブリッシャ 1 25 UART6 パブリッシャ 2
9 I2C1 パブリッシャ 2 26 UART0 パブリッシャ 1
10 I2C2 パブリッシャ 1 27 UART0 パブリッシャ 2
11 I2C2 パブリッシャ 2 28 UART7 パブリッシャ 1
12 SPI0 パブリッシャ 1 29 UART7 パブリッシャ 2
13 SPI0 パブリッシャ 2 30 UART1 パブリッシャ 1
14 SPI1 パブリッシャ 1 31 UART1 パブリッシャ 2
15 SPI1 パブリッシャ 2 32 ADC0 DMA トリガ
16 SPI2 パブリッシャ 1 33 ADC1 DMA トリガ
詳細については、『MSPM0 G シリーズ 80MHz マイクロコントローラ テクニカル リファレンス マニュアル』の「DMA」の章を参照してください。