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DS90CR217

アクティブ

+3.3V、立ち上がりエッジでのデータ ストローブ、LVDS、21 ビット、チャネル リンク トランスミッタ - 85 MHz

製品詳細

Protocols Catalog Device type Transmitter Rating Catalog Operating temperature range (°C) -10 to 70
Protocols Catalog Device type Transmitter Rating Catalog Operating temperature range (°C) -10 to 70
TSSOP (DGG) 48 101.25 mm² (12.5 mm × 8.1 mm)
  • 20 to 85 MHz Shift Clock Support
  • 50% Duty Cycle on Receiver Output Clock
  • Best-in-Class Set & Hold Times on TxINPUTs
  • Low Power Consumption
  • ±1V Common-Mode Range (Around +1.2V)
  • Narrow Bus Reduces Cable Size and Cost
  • Up to 1.785 Gbps Throughput
  • Up to 223 Mbytes/sec Bandwidth
  • 345 mV (typ) Swing LVDS Devices for Low EMI
  • PLL Requires No External Components
  • Rising Edge Data Strobe
  • Compatible with TIA/EIA-644 LVDS Standard
  • Low Profile 48-Lead TSSOP Package

All trademarks are the property of their respective owners.

  • 20 to 85 MHz Shift Clock Support
  • 50% Duty Cycle on Receiver Output Clock
  • Best-in-Class Set & Hold Times on TxINPUTs
  • Low Power Consumption
  • ±1V Common-Mode Range (Around +1.2V)
  • Narrow Bus Reduces Cable Size and Cost
  • Up to 1.785 Gbps Throughput
  • Up to 223 Mbytes/sec Bandwidth
  • 345 mV (typ) Swing LVDS Devices for Low EMI
  • PLL Requires No External Components
  • Rising Edge Data Strobe
  • Compatible with TIA/EIA-644 LVDS Standard
  • Low Profile 48-Lead TSSOP Package

All trademarks are the property of their respective owners.

The DS90CR217 transmitter converts 21 bits of CMOS/TTL data into three LVDS (Low Voltage Differential Signaling) data streams. A phase-locked transmit clock is transmitted in parallel with the data streams over a fourth LVDS link. Every cycle of the transmit clock 21 bits of input data are sampled and transmitted. At a transmit clock frequency of 85 MHz, 21 bits of TTL data are transmitted at a rate of 595 Mbps per LVDS data channel. Using a 85 MHz clock, the data throughput is 1.785 Gbit/s (223 Mbytes/sec).

The narrow bus and LVDS signalling of the DS90CR217 is an ideal means to solve EMI and cable size problems associated with wide, high-speed TTL interfaces.

The DS90CR217 transmitter converts 21 bits of CMOS/TTL data into three LVDS (Low Voltage Differential Signaling) data streams. A phase-locked transmit clock is transmitted in parallel with the data streams over a fourth LVDS link. Every cycle of the transmit clock 21 bits of input data are sampled and transmitted. At a transmit clock frequency of 85 MHz, 21 bits of TTL data are transmitted at a rate of 595 Mbps per LVDS data channel. Using a 85 MHz clock, the data throughput is 1.785 Gbit/s (223 Mbytes/sec).

The narrow bus and LVDS signalling of the DS90CR217 is an ideal means to solve EMI and cable size problems associated with wide, high-speed TTL interfaces.

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技術資料

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* データシート DS90CR217 +3.3V Rising Edge Data Strobe LVDS 21-Bit Channel Link - 85 MHz データシート (Rev. A) 2013/02/19
アプリケーション・ノート High-Speed Layout Guidelines for Reducing EMI for LVDS SerDes Designs 2018/11/09
アプリケーション・ノート Receiver Skew Margin for Channel Link I and FPD Link I Devices PDF | HTML 2016/01/13
アプリケーション・ノート Improving the Robustness of Channel Link Designs with Channel Link II Ser/Des (Rev. A) 2013/04/26
設計ガイド Channel Link I Design Guide 2007/03/29
アプリケーション・ノート Multi-Drop Channel-Link Operation 2004/10/04
アプリケーション・ノート CHANNEL LINK Moving and Shaping Information In Point-To-Point Applications 1998/10/05

設計と開発

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シミュレーション・モデル

DS90CR217 IBIS Model

SNLM056.ZIP (7 KB) - IBIS モデル
サポート対象の製品とハードウェア
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
TSSOP (DGG) 48 Ultra Librarian

購入と品質

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