인터페이스 LVDS, M-LVDS 및 PECL

SN55LVDS32-SP

활성

쿼드 LVDS 리시버

제품 상세 정보

Function Receiver Protocols LVDS Number of transmitters 0 Number of receivers 4 Supply voltage (V) 3.3 Signaling rate (Mbps) 100 Input signal LVDS Output signal LVTTL Rating Space Operating temperature range (°C) -55 to 125
Function Receiver Protocols LVDS Number of transmitters 0 Number of receivers 4 Supply voltage (V) 3.3 Signaling rate (Mbps) 100 Input signal LVDS Output signal LVTTL Rating Space Operating temperature range (°C) -55 to 125
CFP (W) 16 69.319 mm² 10.3 x 6.73
  • QML-V Qualified, SMD 5962-97621
  • Operate From a Single 3.3-V Supply
  • Designed for Signaling Rates of up to 100 Mbps
  • Differential Input Thresholds ±100 mV Max
  • Typical Propagation Delay Times of 2.1 ns
  • Power Dissipation 60 mW Typical Per Receiver at Maximum Data Rate
  • Bus-Terminal ESD Protection Exceeds 8 kV
  • Low-Voltage TTL (LVTTL) Logic Input Levels
  • Open-Circuit Fail-Safe
  • Cold Sparing for Space and High Reliability Applications Requiring Redundancy

  • QML-V Qualified, SMD 5962-97621
  • Operate From a Single 3.3-V Supply
  • Designed for Signaling Rates of up to 100 Mbps
  • Differential Input Thresholds ±100 mV Max
  • Typical Propagation Delay Times of 2.1 ns
  • Power Dissipation 60 mW Typical Per Receiver at Maximum Data Rate
  • Bus-Terminal ESD Protection Exceeds 8 kV
  • Low-Voltage TTL (LVTTL) Logic Input Levels
  • Open-Circuit Fail-Safe
  • Cold Sparing for Space and High Reliability Applications Requiring Redundancy

The SN55LVDS32 is a differential line receiver that implements the electrical characteristics of low-voltage differential signaling (LVDS). This signaling technique lowers the output voltage levels of 5-V differential standard levels (such as EIA/TIA-422B) to reduce the power, increase the switching speeds, and allow operation with a 3.3-V supply rail. Any of the four differential receivers provides a valid logical output state with a ±100-mV differential input voltage within the input common-mode voltage range. The input common-mode voltage range allows 1 V of ground potential difference between two LVDS nodes.

The intended application of these devices and signaling technique is both point-to-point and multidrop (one driver and multiple receivers) data transmission over controlled impedance media of approximately 100 Ω. The transmission media may be printed-circuit board traces, backplanes, or cables. The ultimate rate and distance of data transfer depends on the attenuation characteristics of the media and the noise coupling to the environment.

The SN55LVDS32 is characterized for operation from –55°C to 125°C.

The SN55LVDS32 is a differential line receiver that implements the electrical characteristics of low-voltage differential signaling (LVDS). This signaling technique lowers the output voltage levels of 5-V differential standard levels (such as EIA/TIA-422B) to reduce the power, increase the switching speeds, and allow operation with a 3.3-V supply rail. Any of the four differential receivers provides a valid logical output state with a ±100-mV differential input voltage within the input common-mode voltage range. The input common-mode voltage range allows 1 V of ground potential difference between two LVDS nodes.

The intended application of these devices and signaling technique is both point-to-point and multidrop (one driver and multiple receivers) data transmission over controlled impedance media of approximately 100 Ω. The transmission media may be printed-circuit board traces, backplanes, or cables. The ultimate rate and distance of data transfer depends on the attenuation characteristics of the media and the noise coupling to the environment.

The SN55LVDS32 is characterized for operation from –55°C to 125°C.

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기술 자료

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9개 모두 보기
유형 직함 날짜
* Data sheet High-Speed Differential Line Receiver. datasheet 2012/03/01
* SMD SN55LVDS32-SP SMD 5962-97622 2016/07/08
* Radiation & reliability report SN55LVDS31 and SN55LVDS32 SEE Report 2015/03/31
* Radiation & reliability report SN55LVDS32J Radiation Test Report 2015/03/31
Application brief DLA Approved Optimizations for QML Products (Rev. B) PDF | HTML 2024/05/17
Selection guide TI Space Products (Rev. J) 2024/02/12
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설계 및 개발

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시뮬레이션 모델

SN55LVDS32-SP IBIS MODEL

SLYM090.ZIP (4 KB) - IBIS Model
시뮬레이션 툴

PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®

TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.

TI 설계 및 시뮬레이션 환경용 PSpice는 기본 제공 라이브러리를 이용해 복잡한 혼합 신호 설계를 시뮬레이션할 수 있습니다. 레이아웃 및 제작에 (...)
시뮬레이션 툴

TINA-TI — SPICE 기반 아날로그 시뮬레이션 프로그램

TINA-TI provides all the conventional DC, transient and frequency domain analysis of SPICE and much more. TINA has extensive post-processing capability that allows you to format results the way you want them. Virtual instruments allow you to select input waveforms and probe circuit nodes voltages (...)
사용 설명서: PDF
패키지 CAD 기호, 풋프린트 및 3D 모델
CFP (W) 16 Ultra Librarian

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

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