계산 툴
TPS3430
- Factory-programmed precision watchdog timers:
- ±2.5% Accurate watchdog timeout and watchdog reset delays typical at 25°C
- Watchdog disable feature
- User-programmable watchdog timeout
- User-programmable watchdog reset delay
- Input voltage range: VDD = 1.6 V to 6.5 V
- Low supply current: IDD = 10 µA (typical)
- Open-drain output
- Small 3-mm × 3-mm, 10-Pin VSON package
- Junction operating temperature range: –40°C to +125°C
The TPS3430 is a standalone window watchdog timer with programmable watchdog window and programmable watchdog reset delay for a wide variety of applications. The TPS3430 window watchdog achieves 2.5% timing accuracy (typical at 25°C) and the watchdog output ( WDO) reset delay can be set by factory-programmed default delay settings, or programmed by an external capacitor. The watchdog can be disabled via the SET pins to avoid undesired watchdog timeouts during the development process or during power on.
The TPS3430 is available in a small 3.00-mm × 3.00-mm, 10-pin VSON package.
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기술 자료
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7개 모두 보기 | 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | TPS3430 Window Watchdog Timer with Programmable Reset Delay datasheet (Rev. A) | PDF | HTML | 2021/10/01 |
| Application note | Voltage Supervisors (Reset ICs): Frequently Asked Questions (FAQs) (Rev. A) | 2020/03/17 | ||
| Application note | Open Load Detection and Limp Home Function in BCM | 2019/08/30 | ||
| E-book | Voltage Supervisor and Reset ICs: Tips, Tricks and Basics | 2019/06/28 | ||
| Technical article | Voltage supervisor requirements for e-meter applications | PDF | HTML | 2019/01/18 | |
| Technical article | Improve circuit breaker leakage current response with a voltage supervisor | PDF | HTML | 2019/01/10 | |
| Application brief | Latching a Watchdog Timer | 2018/08/26 |
설계 및 개발
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평가 보드
TPS3430EVM — 프로그래머블 리셋 지연을 지원하는 TPS3430 윈도우 워치독 타이머 평가 모듈
TPS3430 평가 모듈(EVM)은 TP3430 장치를 평가하기 위한 플랫폼입니다. TPS3430은 광범위한 애플리케이션에서 사용할 수 있는 프로그래밍 가능한 기간 워치독 및 프로그래밍 가능한 리셋 지연을 지원하는 독립형 윈도우 워치독 타이머입니다. 이 장치는 MCU의 워치독 입력을 모니터링하고 프로그래밍된 워치독 기간 내에 펄스에 도달하지 않는 경우 워치독 출력을 트리거하는 데 사용됩니다. SET0 및 SET1 핀을 구성하고 CRST 및 CWD에서 커패시터를 변경하여 장치를 프로그래밍할 수 있습니다.
사용 설명서: PDF
시뮬레이션 툴
PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®
TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.
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| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| VSON (DRC) | 10 | Ultra Librarian |
주문 및 품질
포함된 정보:
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
포함된 정보:
- 팹 위치
- 조립 위치