製品詳細

Resolution (Bits) 16 Number of DAC channels (#) 2 Interface type JESD204B Sample/update rate (MSPS) 2800 Features Ultra High Speed Rating Catalog Interpolation 16x, 1x, 2x, 4x, 8x Power consumption (Typ) (mW) 1135 SFDR (dB) 81 Architecture Current Source Operating temperature range (C) -40 to 85 Reference type Int
Resolution (Bits) 16 Number of DAC channels (#) 2 Interface type JESD204B Sample/update rate (MSPS) 2800 Features Ultra High Speed Rating Catalog Interpolation 16x, 1x, 2x, 4x, 8x Power consumption (Typ) (mW) 1135 SFDR (dB) 81 Architecture Current Source Operating temperature range (C) -40 to 85 Reference type Int
FCBGA (AAV) 144 100 mm² 10 x 10
  • 分解能:16ビット
  • 最大サンプル・レート:2.8GSPS
  • 最大入力データ・レート:1.4GSPS
  • JESD204Bインターフェイス
    • 8つのJESD204Bシリアル入力レーン
    • レーンごとに最大12.5Gbpsのビット・レート
    • サブクラス1のマルチDAC同期
  • オンチップの超低ジッタPLL
  • 1x~16xの補間を選択可能
  • 48ビットNCO/または±n × Fs/8の、独立の複合ミ
    キサー
  • 広帯域デジタル直交変調器補正
  • Sinx/x補正フィルタ
  • フラクショナル・サンプル・グループ遅延の補正
  • 出力マルチプレクサによる、4つのアナログ出力へ
    の柔軟なルーティング
  • 3/4線のシリアル制御バス(SPI)
  • 組み込みの温度センサ
  • JTAG境界スキャン
  • クワッド・チャネルのDAC39J84とピン互換
  • 消費電力:2.8GSPSにおいて1.1W
  • パッケージ:10 × 10mm、144ボールのフリップ・
    チップBGA

アプリケーション

  • 携帯基地局
  • ダイバーシティ送信
  • 広帯域通信
  • 直接デジタル合成(DDS)計測器
  • ミリメートル/マイクロ波のバックホール
  • 自動テスト機器
  • ケーブル・インフラストラクチャ
  • レーダー

  • 分解能:16ビット
  • 最大サンプル・レート:2.8GSPS
  • 最大入力データ・レート:1.4GSPS
  • JESD204Bインターフェイス
    • 8つのJESD204Bシリアル入力レーン
    • レーンごとに最大12.5Gbpsのビット・レート
    • サブクラス1のマルチDAC同期
  • オンチップの超低ジッタPLL
  • 1x~16xの補間を選択可能
  • 48ビットNCO/または±n × Fs/8の、独立の複合ミ
    キサー
  • 広帯域デジタル直交変調器補正
  • Sinx/x補正フィルタ
  • フラクショナル・サンプル・グループ遅延の補正
  • 出力マルチプレクサによる、4つのアナログ出力へ
    の柔軟なルーティング
  • 3/4線のシリアル制御バス(SPI)
  • 組み込みの温度センサ
  • JTAG境界スキャン
  • クワッド・チャネルのDAC39J84とピン互換
  • 消費電力:2.8GSPSにおいて1.1W
  • パッケージ:10 × 10mm、144ボールのフリップ・
    チップBGA

アプリケーション

  • 携帯基地局
  • ダイバーシティ送信
  • 広帯域通信
  • 直接デジタル合成(DDS)計測器
  • ミリメートル/マイクロ波のバックホール
  • 自動テスト機器
  • ケーブル・インフラストラクチャ
  • レーダー

DAC39J82は、非常に低消費電力でJESD204Bインターフェイスを搭載した16ビット、デュアル・チャネル、2.8GSPSのデジタル/アナログ・コンバータ(DAC)です。 最大入力データ・レートは1.4GSPSです。/P>

デジタル・データは1、2、4、8本の構成可能なシリアルJESD204Bレーンでデバイスへ入力され、それぞれが最大12.5Gbpsで動作し、オンチップのターミネーションとプログラマブルなイコライゼーションが搭載されています。 こインターフェイスにより、JESD204Bはサブクラス1のSYSREFベースの調整可能なレイテンシと、複数デバイスの完全な同期を実現しています。

このデバイスには、複雑な転送アーキテクチャの設計を簡素化するための機能が組み込まれています。 完全にバイパス可能な、90dBを超えるストップ・バンド減衰を持つ2x~16xのデジ タル補間フィルタにより、データ・インターフェイスとフィルタを簡素化できます。 オンチップの48ビット数値制御発振器 (NCO)および独立の複合ミキサーにより、柔軟かつ正確なキャリアの配置が可能です。

高パフォーマンスで低ジッタのPLLにより、デバイスのダイナミック・レンジに大きな影響を及ぼすことなく、クロック設 定を簡素化できます。 デジタル直交変調器補正(QMC)およびグループ遅延補正(QDC)により、直接の昇圧変換アプリケーションにおいて、チャネル間のゲイン、オフセット、位相、お よびグループ遅延の完全なIQ補償が可能になります。 入力データに異常な電力動作が検出された場合にパワーアンプ(PA)を 保護するため、プログラマブルなPA保護機構が利用可能です。

DAC39J82には4つのアナログ出力があり、内部にある2つのデジタル・パスからのデータは、出力マルチプレクサ経由で、こ れら4つのDAC出力のうち任意の2つへルーティングできます。

DAC39J82は、非常に低消費電力でJESD204Bインターフェイスを搭載した16ビット、デュアル・チャネル、2.8GSPSのデジタル/アナログ・コンバータ(DAC)です。 最大入力データ・レートは1.4GSPSです。/P>

デジタル・データは1、2、4、8本の構成可能なシリアルJESD204Bレーンでデバイスへ入力され、それぞれが最大12.5Gbpsで動作し、オンチップのターミネーションとプログラマブルなイコライゼーションが搭載されています。 こインターフェイスにより、JESD204Bはサブクラス1のSYSREFベースの調整可能なレイテンシと、複数デバイスの完全な同期を実現しています。

このデバイスには、複雑な転送アーキテクチャの設計を簡素化するための機能が組み込まれています。 完全にバイパス可能な、90dBを超えるストップ・バンド減衰を持つ2x~16xのデジ タル補間フィルタにより、データ・インターフェイスとフィルタを簡素化できます。 オンチップの48ビット数値制御発振器 (NCO)および独立の複合ミキサーにより、柔軟かつ正確なキャリアの配置が可能です。

高パフォーマンスで低ジッタのPLLにより、デバイスのダイナミック・レンジに大きな影響を及ぼすことなく、クロック設 定を簡素化できます。 デジタル直交変調器補正(QMC)およびグループ遅延補正(QDC)により、直接の昇圧変換アプリケーションにおいて、チャネル間のゲイン、オフセット、位相、お よびグループ遅延の完全なIQ補償が可能になります。 入力データに異常な電力動作が検出された場合にパワーアンプ(PA)を 保護するため、プログラマブルなPA保護機構が利用可能です。

DAC39J82には4つのアナログ出力があり、内部にある2つのデジタル・パスからのデータは、出力マルチプレクサ経由で、こ れら4つのDAC出力のうち任意の2つへルーティングできます。

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技術資料

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6 をすべて表示
種類 タイトル 最新の英語版をダウンロード 日付
* データシート Dual-Channel, 16-Bit, 2.8 GSPS, Digital-to-Analog Converter データシート 英語版をダウンロード PDF | HTML 2015年 3月 31日
アプリケーション・ノート DAC3xJ8x SYSREF Configuration 2017年 9月 27日
EVM ユーザー ガイド (英語) DAC3XJ8XEVM User's Guide (Rev. B) 2016年 4月 28日
アプリケーション・ノート System solution for avionics & defense 2015年 9月 23日
アプリケーション・ノート 高速データ変換 英語版をダウンロード 2009年 12月 11日
アプリケーション・ノート データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす 2009年 4月 22日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

評価ボード

DAC39J82EVM — DAC39J82 デュアルチャネル、16 ビット、2.8GSPS、1x ~ 16x 補間 D/A コンバータの評価基板 (EVM)

 DAC39J82EVM は、JESD204B インターフェイスを搭載した高速 DAC である DAC39J82 を評価するための設計を採用した評価基板 (EVM) です。オンボードのクロック処理ソリューション (LMK04828)、トランス結合型出力、包括的な電源ソリューション、使いやすいソフトウェア GUI、USB インターフェイスを搭載しています。

DAC39J82EVM は高速データ・コンバータ評価向けの高速データ・コンバータ Pro (HSDCPro) ソフトウェア・ツールを通じて、TI の JESD204B パターン・ジェネレータ・カードである TSW14J56EVM (...)

TI.com で取り扱いなし
ファームウェア

TI-JESD204-IP — 高速データ・コンバータへの FPGA 接続に役立つ、JESD204 Rapid Design IP (JESD204 採用の迅速設計知的財産)

JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション・ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように設計者を支援します。

JESD204 rapid design IP (迅速設計知的財産) は、TI (...)

評価基板 (EVM) 向けの GUI

DAC3XJ8XEVM Software (Rev. C)

SLAC644C.ZIP (202500 KB)
シミュレーション・モデル

DAC38J84 IBIS Model

SLAM197.ZIP (50 KB) - IBIS Model
シミュレーション・モデル

DAC38RF8x IBIS-AMI Model (Rev. A)

SLAM343A.ZIP (24658 KB) - IBIS-AMI Model
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リファレンス・デザイン

TIDA-00996 — 同期マルチトランスミッタのリファレンス・デザイン:複数の DAC を時間整合させる方法

To further increase the range, data rate, and reliability of modern mobile communications systems, system designers continue to place more emphasis on multiple-antenna transmitter systems to achieve combinations of spatial diversity and spatial multiplexing. Such implementations can further (...)
回路図: PDF
リファレンス・デザイン

TIDA-00335 — High Bandwidth, High Frequency Transmitter Reference Design

このリファレンス・デザインでは、DAC38J84 のような電流源 DAC を TRF3704 変調器と組み合わせて、高帯域および高周波のアプリケーションをサポートする場合に必要とされる回路の変更を示します。  TRF3704 は 6GHz の変調器であり、BB の広い帯域幅をサポートできます。  DAC38J84 は 2.5GSPS のコンバータであり、600MHz のベースバンド帯域幅をサポートできます。  この組み合わせにより、従来はハイエンド通信システムで達成が困難だった周波数と帯域幅での動作を容易に実現できるようになります。
ユーザー・ガイド: PDF
回路図: PDF
パッケージ ピン数 ダウンロード
FCBGA (AAV) 144 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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