DAC39J84
- 分解能：16ビット
- 最大サンプル・レート：2.8GSPS
- 最大入力データ・レート：1.25GSPS
- JESD204Bインターフェイス
- 8つのJESD204Bシリアル入力レーン
- レーンごとに最大12.5Gbpsのビット・レート
- サブクラス1のマルチDAC同期
- オンチップの超低ジッタPLL
- 1×～16×の補間を選択可能
- 48ビットNCO/または±n × Fs/8の、独立の複合ミ
キサー - 広帯域デジタル直交変換器補正
- Sinx/x補正フィルタ
- フラクショナル・サンプル・グループ遅延の補正
- マルチバンド・モード：独立した複合信号のデジタ
ル加算 - 3/4線のシリアル制御バス（SPI）
- 組み込みの温度センサ
- JTAG境界スキャン
- クワッド・チャネルDAC37J84/DAC38J84ファミ
リーとピン互換 - 消費電力：2.8GSPSにおいて1.8W
- パッケージ：10 × 10 mm、144ボールのフリップ・ チップBGA
アプリケーション
- 携帯基地局
- ダイバーシティ送信
- 広帯域通信
- 直接デジタル合成（DDS）計測器
- ミリメートル/マイクロ波のバックホール
- 自動テスト機器
- ケーブル・インフラストラクチャ
DAC39J84は、低消費電力でJESD204Bインターフェイスを搭載した16ビット、クワッド・チャネル、2.8GSPSのデジタル/アナログ・コンバータ（DAC）です。
デジタル・データは1、2、4、8本の構成可能なシリアルJESD204Bレーンでデバイスへ入力され、それぞれが最大12.5Gbpsで動作し、オンチップのターミネーションとプログラマブルなイコライゼーションが搭載されています。 こインターフェイスにより、JESD204Bはサブクラス1のSYSREFベースの調整可能なレイテンシと、複数デバイスの完全な同期を実現しています。
このデバイスには、複雑な転送アーキテクチャの設計を簡素化するための機能が組み込まれています。 完全にバイパス可能な、90dBを超えるストップ・バンド減衰を持つ2x～16xのデ ジタル補間フィルタにより、データ・インターフェイスとフィルタを簡素化できます。 オンチップの48ビット数値制御発振器 （NCO）および独立の複合ミキサーにより、柔軟かつ正確なキャリアの配置が可能です。
高パフォーマンスで低ジッタのPLLにより、デバイスのダイナミック・レンジに大きな影響を及ぼすことなく、クロック設定を簡素化できます。 デジタル直交変調器補正（QMC）および グループ遅延補正（QDC）により、直接の昇圧変換アプリケーションにおいて、チャネル間のゲイン、オフセット、位相、お よびグループ遅延の完全なIQ補償が可能になります。 入力データに異常な電力動作が検出された場合にパワーアンプ（PA）を 保護するため、プログラマブルなPA保護機構が利用可能です。
技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | Quad-Channel, 16-Bit, 2.8 GSPS, Digital-to-Analog Converter データシート (Rev. A 翻訳版) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2015/03/31 |
| アプリケーション・ノート | DAC3xJ8x Device Initialization and SYSREF Configuration | 2017/09/27 | ||||
| アプリケーション・ノート | System solution for avionics & defense | 2015/09/23 |
設計と開発
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