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2 チャネル、電流入力 20 ビット AD コンバータ

製品詳細

Number of input channels 2 Resolution (Bits) 20 Features Computed Tomography (CT) Operating temperature range (°C) -40 to 85 Interface type Serial Rating Catalog
Number of input channels 2 Resolution (Bits) 20 Features Computed Tomography (CT) Operating temperature range (°C) -40 to 85 Interface type Serial Rating Catalog
TQFP (PJT) 32 81 mm² (9 mm × 9 mm) SOIC (DW) 28 184.37 mm² (17.9 mm × 10.3 mm)
  • モノリシック電荷測定AD コンバータ
  • デジタル・フィルタによるノイズ低減: 3.2ppm、RMS
  • 積分直線性:±0.005% Reading ±0.5ppm FSR
  • 高精度真の積分機能
  • プログラマブル・フルスケール
  • 単電源
  • カスケード可能出力
  • アプリケーション
    • ダイレクト光センサ・デジタル変換
    • CT スキャナDAS
    • 赤外線パイロメータ
    • 高精度プロセス制御
    • 液体/ガスクロマトグラフィ
    • 血液分析

米国特許 #5841310 による保護対象

  • モノリシック電荷測定AD コンバータ
  • デジタル・フィルタによるノイズ低減: 3.2ppm、RMS
  • 積分直線性:±0.005% Reading ±0.5ppm FSR
  • 高精度真の積分機能
  • プログラマブル・フルスケール
  • 単電源
  • カスケード可能出力
  • アプリケーション
    • ダイレクト光センサ・デジタル変換
    • CT スキャナDAS
    • 赤外線パイロメータ
    • 高精度プロセス制御
    • 液体/ガスクロマトグラフィ
    • 血液分析

米国特許 #5841310 による保護対象

DDC112は、デュアル入力、広ダイナミック・レンジ、電荷デ ジタイジングの分解能20ビットのADコンバータです。また、光 センサ等の低電流出力デバイスを、ADコンバータ入力に直接 接続可能です。各入力に2つの積分器を持ち、一方がデジタル 変換中に他方が積分を行う為、電荷積分は連続して行います。

高精度/高ダイナミックレンジのデジタル出力を得るため、2入 力のそれぞれについてDDC112は、電流/電圧変換、連続積分 、プログラマブルなフルスケール・レンジ、AD変換、およびデ ジタルフィルタなどの機能を組み合わせています。プログラマ ブルな内蔵フルスケール・レンジに加え、外付けの積分コンデ ンサを使用する事により最大1000pCの、ユーザー・プログラマ ブルなフルスケール・レンジが可能です。

単電源動作を実現するため、内蔵ADコンバータは差動入力と なっており、正入力はVREFに接続されています。各積分サイ クルの初期のリセット区間で、積分コンデンサはVREFに充電 されます。この電荷は、入力電流に比例して放電され、積分サ イクルの終了時、残電圧がVREFと比較されます。

直前の変換結果を保持する高速シリアル・シフト・レジスタは 、複数のDDC112ユニットのカスケード構成が可能で、相互接 続線数を最小限とします。DDC112は、SO-28またはTQFP-32パ ッケージで供給され、2つの性能グレードがあります。

DDC112は、デュアル入力、広ダイナミック・レンジ、電荷デ ジタイジングの分解能20ビットのADコンバータです。また、光 センサ等の低電流出力デバイスを、ADコンバータ入力に直接 接続可能です。各入力に2つの積分器を持ち、一方がデジタル 変換中に他方が積分を行う為、電荷積分は連続して行います。

高精度/高ダイナミックレンジのデジタル出力を得るため、2入 力のそれぞれについてDDC112は、電流/電圧変換、連続積分 、プログラマブルなフルスケール・レンジ、AD変換、およびデ ジタルフィルタなどの機能を組み合わせています。プログラマ ブルな内蔵フルスケール・レンジに加え、外付けの積分コンデ ンサを使用する事により最大1000pCの、ユーザー・プログラマ ブルなフルスケール・レンジが可能です。

単電源動作を実現するため、内蔵ADコンバータは差動入力と なっており、正入力はVREFに接続されています。各積分サイ クルの初期のリセット区間で、積分コンデンサはVREFに充電 されます。この電荷は、入力電流に比例して放電され、積分サ イクルの終了時、残電圧がVREFと比較されます。

直前の変換結果を保持する高速シリアル・シフト・レジスタは 、複数のDDC112ユニットのカスケード構成が可能で、相互接 続線数を最小限とします。DDC112は、SO-28またはTQFP-32パ ッケージで供給され、2つの性能グレードがあります。

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技術資料

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* データシート デュアル電流入力20ビット AD コンバータ データシート (Rev. B 翻訳版) 英語版 (Rev.B) 2007/03/30
技術記事 Designing signal chains for portable diagnostics PDF | HTML 2022/05/18
アナログ デザイン ジャーナル Selecting a multichannel ultra-low-current measurement IC PDF | HTML 2022/03/18
技術記事 Helping physicians achieve faster, more accurate patient diagnoses with molecular PDF | HTML 2020/05/20
その他の技術資料 DDC11xEVM Readme Page Thank You Letter 2007/11/07
アプリケーション・ノート Using External Integration Capacitors on the DDC112 2000/09/27
ユーザー・ガイド DEM-DDC112U-C: Demonstration Fixture for the DDC112 2000/09/27
アプリケーション・ノート Retrieving Data from the DDC112 2000/09/27
アプリケーション・ノート The DDC112\'s Test Mode 2000/09/27
アプリケーション・ノート DDC112 の継続モード・非継続モードを理解する 2000/09/27
アプリケーション・ノート Creating a Bipolar Input Range for the DDC112 2000/09/27
アプリケーション・ノート Multi-DDC112 DUT Board for the DDC112 Evaluation Fixture 2000/09/27

設計と開発

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評価ボード

DDC11XEVM-PDK — DDC11xEVM PDK のパフォーマンス デモ キット

DDC11xEVM-PDK は、DDC112 または DDC114 の電荷デジタイズ型 A/D コンバータを評価するために使いやすいプラットフォームです。PC インターフェイス ボード (DDCMB) と、DDC112/DDC114 用のドータ ボードが同梱されており、これらのデバイスの解析とテストを容易にするソフトウェアも付属しています。

ユーザー ガイド: PDF
サポート対象の製品とハードウェア
在庫あり
制限:
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入手不可
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
TQFP (PJT) 32 Ultra Librarian
SOIC (DW) 28 Ultra Librarian

購入と品質

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サポートとトレーニング

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