超低ノイズ、小さいゲート電流、オーディオ向けの N チャネル JFET

製品詳細

Vn at 1 kHz (nV/rtHz) 0.8 Breakdown voltage (V) 40 VDS (V) 40 VGS (V) -40 VGSTH typ (V) -1.2 Rating Catalog Operating temperature range (C) -40 to 125
Vn at 1 kHz (nV/rtHz) 0.8 Breakdown voltage (V) 40 VDS (V) 40 VGS (V) -40 VGSTH typ (V) -1.2 Rating Catalog Operating temperature range (C) -40 to 125
SOT-SC70 (DCK) 5 4 mm² 2 x 2.1
  • 超低ノイズ
    • 電圧ノイズ:
      • 1kHz 、IDS = 5mA で 0.8nV/√Hz
      • 1kHz 、IDS = 2mA で 0.9nV/√Hz
    • 電流ノイズ:1kHz で 1.8fA/√Hz
  • 低消費電流:10pA (最大)
  • 低入力容量VDS = 5V で 24pF

  • ゲート-ドレイン間およびゲート-ソース間の高ブレークダウン電圧:-40V

  • 高相互コンダクタンス:68mS

  • パッケージ:小型 SC70 および SOT-23 (プレビュー)

  • 超低ノイズ
    • 電圧ノイズ:
      • 1kHz 、IDS = 5mA で 0.8nV/√Hz
      • 1kHz 、IDS = 2mA で 0.9nV/√Hz
    • 電流ノイズ:1kHz で 1.8fA/√Hz
  • 低消費電流:10pA (最大)
  • 低入力容量VDS = 5V で 24pF

  • ゲート-ドレイン間およびゲート-ソース間の高ブレークダウン電圧:-40V

  • 高相互コンダクタンス:68mS

  • パッケージ:小型 SC70 および SOT-23 (プレビュー)

JFE150 は、テキサス・インスツルメンツの最新の高性能アナログ・バイポーラ・プロセスで構築された Burr-Brown™ ディスクリート JFET です。JFE150 は、従来のディスクリート JFET テクノロジでは利用できなかった性能を備えています。JFE150 は、ノイズから電力までの効率と柔軟性を最大化します。このため、静止電流をユーザーが設定し、50µA~20mA の電流で優れたノイズ性能を発揮できます。5mA でバイアスすると、入力換算ノイズ 0.8nV/√Hz が得られ、超高入力インピーダンス (1TΩ 超)で超低ノイズ性能を実現します。また、JFE150 は、個別のクランプノードに接続されたダイオードも内蔵しており、高リークの非線形外部ダイオードを追加せずに保護機能を提供します。

JFE150 は、ドレイン-ソース間で 40V、ゲート-ソース間、ゲート-ドレイン間で -40V の耐圧です。温度範囲は -40℃~+125℃ で規定され、5 ピンの SOT-23 および SC-70 パッケージで供給されます。

JFE150 は、テキサス・インスツルメンツの最新の高性能アナログ・バイポーラ・プロセスで構築された Burr-Brown™ ディスクリート JFET です。JFE150 は、従来のディスクリート JFET テクノロジでは利用できなかった性能を備えています。JFE150 は、ノイズから電力までの効率と柔軟性を最大化します。このため、静止電流をユーザーが設定し、50µA~20mA の電流で優れたノイズ性能を発揮できます。5mA でバイアスすると、入力換算ノイズ 0.8nV/√Hz が得られ、超高入力インピーダンス (1TΩ 超)で超低ノイズ性能を実現します。また、JFE150 は、個別のクランプノードに接続されたダイオードも内蔵しており、高リークの非線形外部ダイオードを追加せずに保護機能を提供します。

JFE150 は、ドレイン-ソース間で 40V、ゲート-ソース間、ゲート-ドレイン間で -40V の耐圧です。温度範囲は -40℃~+125℃ で規定され、5 ピンの SOT-23 および SC-70 パッケージで供給されます。

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート JFE150 超低ノイズ、低ゲート電流、オーディオ、N チャネル JFET データシート (Rev. A 翻訳版) PDF | HTML 英語版をダウンロード (Rev.A) PDF | HTML 2022年 1月 31日
証明書 JFE150EVM EU RoHS Declaration of Conformity (DoC) 2022年 2月 28日
ユーザー・ガイド JFE150EVM User's Guide PDF | HTML 2022年 2月 25日
アプリケーション・ノート JFE150 Pre Amp Application Report PDF | HTML 2021年 10月 6日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

評価ボード

DIP-ADAPTER-EVM — DIP アダプタの評価基板

DIP-Adapter-EVM は、オペアンプの迅速なプロトタイプ製作とテストを可能にする評価基板です。小型の表面実装 IC とのインターフェイスを迅速、容易、低コストで実現します。付属の Samtec 端子ストリップか、回路への直接配線により、サポートされているオペアンプを接続できます。

DIP-Adapter-EVM キットは、業界標準の最も一般的なパッケージをサポートしています:

  • D と U(SOIC-8)
  • PW(TSSOP-8)
  • DGK(MSOP-8、VSSOP-8)
  • DBV(SOT23-6、SOT23-5、SOT23-3)
  • DCK(SC70-6、SC70-5)
  • DRL(SOT563-6)
TI.com で取り扱いなし
評価ボード

JFE150EVM — JFE150 -40VGS、40VDS、超低ノイズ、小さいゲート電流、オーディオ、N チャネル JFET の評価基板

JFE150EVM 評価基板 (EVM) は、JFE150 デバイスの基本機能を評価することを意図しています。この評価基板 (EVM) の構成は閉ループのプリアンプ構成であり、12V 単一電源電圧で 60dB のゲインを達成します。さまざまな回路構成に合わせて、開発ユーザーが変更を加えることができます。

TI.com で取り扱いなし
シミュレーション・モデル

JFE150 PSpice Model JFE150 PSpice Model

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JFE150 TINA-TI Spice Model JFE150 TINA-TI Spice Model

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JFE150 TINA-TI Reference Design JFE150 TINA-TI Reference Design

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JFE150 Ultra-Low Noise Piezoelectric Amplifier TINA-TI Reference Circuit JFE150 Ultra-Low Noise Piezoelectric Amplifier TINA-TI Reference Circuit

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シミュレーション・ツール

PSPICE-FOR-TI TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

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TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

パッケージ ピン数 ダウンロード
SC70 (DCK) 5 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

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