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SN74AUP2G08

アクティブ

2 チャネル、2 入力、0.8V ~ 3.6V、低消費電力 (1μA 未満)、AND ゲート

製品詳細

Technology family AUP Number of channels 2 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AUP Number of channels 2 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
VSSOP (DCU) 8 6.2 mm² (2 mm × 3.1 mm) DSBGA (YZP) 8 2.8125 mm² (— mm × — mm) DSBGA (YFP) 8 1.8 mm² (— mm × — mm) X2SON (DQE) 8 1.4 mm² (1.4 mm × 1 mm) UQFN (RSE) 8 2.25 mm² (1.5 mm × 1.5 mm)
  • 広い動作 VCC 範囲:0.8V~3.6V
  • 小さい静的消費電力 (ICC = 0.9µA、最大値)
  • 小さい動的消費電力 (3.3V で Cpd = 4.3pF、標準値)
  • 小さいノイズ – オーバーシュートおよびアンダーシュートは VCC の <10%
  • Ioff により部分的パワーダウン モードでの動作をサポート
  • シュミット トリガ アクションにより、低速の入力遷移が可能で、入力におけるスイッチング ノイズ耐性が向上 (3.3V で Vhys = 250mV、標準値)
  • 3.6V I/O 許容で混在モードの信号動作に対応
  • 3.3V で tpd = 5.9ns (最大値)
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
  • 広い動作 VCC 範囲:0.8V~3.6V
  • 小さい静的消費電力 (ICC = 0.9µA、最大値)
  • 小さい動的消費電力 (3.3V で Cpd = 4.3pF、標準値)
  • 小さいノイズ – オーバーシュートおよびアンダーシュートは VCC の <10%
  • Ioff により部分的パワーダウン モードでの動作をサポート
  • シュミット トリガ アクションにより、低速の入力遷移が可能で、入力におけるスイッチング ノイズ耐性が向上 (3.3V で Vhys = 250mV、標準値)
  • 3.6V I/O 許容で混在モードの信号動作に対応
  • 3.3V で tpd = 5.9ns (最大値)
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能

このデュアル 2 入力正論理 AND ゲートは 0.8V~3.6V の VCC 動作用に設計されており、ブール関数 Y = A ● B を正論理で実行します。

このデバイスは、Ioff を使用する部分的パワーダウン アプリケーション用の動作が完全に規定されています。VCC = 0V になると、Ioff 回路で出力をディセーブルすることにより、電源切断時にデバイスに電流が逆流して損傷するのを回避できます。

このデュアル 2 入力正論理 AND ゲートは 0.8V~3.6V の VCC 動作用に設計されており、ブール関数 Y = A ● B を正論理で実行します。

このデバイスは、Ioff を使用する部分的パワーダウン アプリケーション用の動作が完全に規定されています。VCC = 0V になると、Ioff 回路で出力をディセーブルすることにより、電源切断時にデバイスに電流が逆流して損傷するのを回避できます。

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技術資料

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* データシート SN74AUP2G08 低消費電力、デュアル、2 入力、正論理 AND ゲート データシート (Rev. F 翻訳版) PDF | HTML 英語版 (Rev.F) PDF | HTML 2025/07/25
アプリケーション概要 シュミット トリガについて (Rev. B 翻訳版) PDF | HTML 英語版 (Rev.B) PDF | HTML 2025/05/08

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

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5 ~ 8 ピンで DCK、DCT、DCU、DRL、DBV の各パッケージを使用する多様なデバイスをサポートできる設計のフレキシブルな評価基板です。
ユーザー ガイド: PDF
サポート対象の製品とハードウェア
在庫あり
制限:
??asset.out-of-stock-ti_ja_JP??
入手不可
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5-8-NL-LOGIC-EVM — 5 ~ 8 ピン の DPW、DQE、DRY、DSF、DTM、DTQ、DTT の各パッケージに対応する、ロジック IC と変換 IC 向けの汎用評価基板 (EVM)

DTT、DRY、DPW、DTM、DQE、DQM、DSF、DTQ の各パッケージに封止済みの任意のロジック デバイスまたは変換デバイスに対応する設計を採用した汎用 EVM (評価基板) です。フレキシブルな評価が可能な基板設計を採用しています。

ユーザー ガイド: PDF | HTML
サポート対象の製品とハードウェア
在庫あり
制限:
??asset.out-of-stock-ti_ja_JP??
入手不可
シミュレーション・モデル

SN74AUP2G08 Behavioral SPICE Model

SCEM678.ZIP (7 KB) - PSpice モデル
サポート対象の製品とハードウェア

多くの TI リファレンス デザインには、SN74AUP2G08 があります。

TI のリファレンス デザイン セレクション ツールを使用すると、開発中のアプリケーションやパラメータとの適合度が最も高いデザインの確認と特定を進めることができます。

パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VSSOP (DCU) 8 Ultra Librarian
DSBGA (YZP) 8 Ultra Librarian
DSBGA (YFP) 8 Ultra Librarian
X2SON (DQE) 8 Ultra Librarian
UQFN (RSE) 8 Ultra Librarian

購入と品質

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