SN74LVC8T245
- 完全に構成可能なデュアル レール設計により、1.65V~5.5V の電源電圧の全範囲にわたって各ポートが動作可能
- 堅牢でグリッチの発生しない電源シーケンシング
- 制御入力の VIH/VIL レベルは VCCA 電圧を基準
- VCC 絶縁機能および VCC 切断機能
- どちらかの VCC 入力が 100mV を下回るかフローティングのままになると、すべての I/O 出力がディスエーブルになり、ハイ インピーダンス状態に移行
- Ioff により部分的パワーダウン モードでの動作をサポート
- JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
- 動作温度範囲:-40℃~85℃
- JESD 22 を上回る ESD 保護
- 4000V、人体モデル (A114-A)
- 1000V、デバイス帯電モデル (C101)
SN74LVC8T245 は、8 ビット非反転バス トランシーバであり、双方向の電圧レベル変換を可能にする構成可能なデュアル電源レールを備えています。SN74LVC8T245 は、VCCA および VCCB を 1.65V ~ 5.5V に設定した場合の動作用に最適化されています。A ポートは VCCA に追従するように設計されています。VCCA ピンには、1.65V~5.5V の電源電圧を入力できます。B ポートは、VCCB に追従する設計になっています。VCCB ピンには、1.65V~5.5V の電源電圧を入力できます。これにより、1.8V、2.5V、3.3V、5.5V の任意の電圧ノード間での低電圧双方向変換が可能です。
SN74LVC8T245 は、2 つのデータ バス間の非同期通信用に設計されています。方向制御 (DIR) 入力および出力イネ ーブル (OE) 入力のロジック レベルに応じて、 B ポート出力もしくは A ポート出力のいずれかがアクティブになるか、または、両方の出力ポートが高インピーダンス モードになります。本デバイスは、B ポート出力がアクティブになった場合、A バスから B バスへデータを転送し、A ポート出力がアクティブになった場合、B バスから A バスへデータを転送します。
A ポートと B ポートの入力回路はどちらも常にアクティブであるため、これらのポートには論理 High または Low レベルを印加して、ICC と ICCZ が過剰に流れないようにする必要があります。
このデバイスは、Ioff を使用する部分的パワーダウン アプリケーション用の動作が完全に規定されています。Ioff 回路が出力をディセーブルにするため、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。VCC 絶縁機能は、いずれかの VCC 入力が GND レベルになると、すべての出力がハイ インピーダンス状態になるよう設計されています。電源投入または電源オフの間にデバイスを高インピーダンス状態にするには、OE をプルアップ抵抗を介して VCC に接続します。この抵抗の最小値は、ドライバの電流シンク能力によって決まります。
SN74LVC8T245 は、制御ピン (DIR および OE) が VCCA から電源を供給されるように設計されています。
技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | SN74LVC8T245 8 ビット デュアル電源 バス・トランシーバ、 構成可能電圧変換、3 ステート出力 | PDF | HTML | PDF | HTML | 2026/07/05 | |
| アプリケーション・ノート | レベル シフタにおける過渡駆動能力と DC 駆動能力との関係 | PDF | HTML | PDF | HTML | 2026/08/11 | ||
| アプリケーション・ノート | Schematic Checklist - A Guide to Designing With Fixed or Direction Control Translators | PDF | HTML | 2024/10/02 | |||
| アプリケーション・ノート | Schematic Checklist - A Guide to Designing with Auto-Bidirectional Translators | PDF | HTML | 2024/07/12 | |||
| セレクション・ガイド | Voltage Translation Buying Guide (Rev. A) | 2021/04/15 | ||||
| アプリケーション・ノート | Designing with SN74LVCXT245 and SN74LVCHXT245 Family of Direction Controlled | 2015/10/27 |
設計と開発
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| TSSOP (PW) | 24 | Ultra Librarian |
| SSOP (DBQ) | 24 | Ultra Librarian |
| SSOP (DB) | 24 | Ultra Librarian |
| VQFN (RHL) | 24 | Ultra Librarian |
| SOIC (DW) | 24 | Ultra Librarian |
| SOP (NS) | 24 | Ultra Librarian |
| TVSOP (DGV) | 24 | Ultra Librarian |